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芯片的設(shè)計流程

倩倩 ? 來源:IP與SoC設(shè)計 ? 作者:IP與SoC設(shè)計 ? 2022-08-12 14:57 ? 次閱讀
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1. 緒論

經(jīng)過了立項和規(guī)格和計劃的確認,此處我們開始講芯片設(shè)計。

這個內(nèi)容就挺多了,也可能是大家最關(guān)心的一個部分,可能要分幾次講。在整個流程中處于這位置。

5dccc34a-19f6-11ed-ba43-dac502259ad0.png

此處由于我自己還是對數(shù)字芯片系統(tǒng)更了解,所以按數(shù)字的來。模擬芯片的設(shè)計流程后續(xù)有精力或者請個大佬補個概述。芯片的設(shè)計流程還是比較長的,我們先來個birdmap。這個圖很復(fù)雜,看不懂的名詞不要慌,我會一步一步講。

5dea5964-19f6-11ed-ba43-dac502259ad0.jpg

2. 算法設(shè)計

5e139c48-19f6-11ed-ba43-dac502259ad0.jpg

我們先來講第一部分,這個部分其實比較簡單。所以就在此處講講,后續(xù)不再單獨開章節(jié)來講這個東西。芯片最終還是算法的一種加速。如果一個東西你用C++都實現(xiàn)不了,芯片怎么可能實現(xiàn)。第一步就是算法。

算法實現(xiàn)其實有兩個步驟的。為什么有兩個步驟呢,這就涉及到浮點和定點的區(qū)別。浮點精讀高,但是硬件實現(xiàn)代價大,定點成本低,硬件實現(xiàn)代價小。一般先設(shè)計浮點算法,然后再犧牲一點精度,搞成定點算法。

浮點算法設(shè)計浮點算法偏重于功能,由于浮點精度高,最原始的功能一般會用浮點實現(xiàn)。比如你要整一個AI芯片,你首先得用pytorch或者tensorflow訓(xùn)練出一個浮點網(wǎng)絡(luò),看看效果是不是還行,能不能實現(xiàn)網(wǎng)絡(luò)正常的功能。算法鏈路先測試好了后續(xù)才能用芯片加速。浮點算法一般由純軟件工程師設(shè)計的。他們并不需要知道硬件實現(xiàn),只需要對功能的正確性負責(zé)即可。

定點算法設(shè)計定點算法就是找個位置,把浮點中的指數(shù)為給歸一了。精度是肯定會損失的,但是換來了硬件設(shè)計的簡單。這個也容易理解,用芯片算一個3.5+0.025和用芯片算一個3500+25復(fù)雜程度完全不一樣啊。為了平衡精度和定點位寬,此處定點化可以有各種門道,比如采用批處理的定點化,一部分數(shù)據(jù)采用一個定點位置,另一部分數(shù)據(jù)采用另一個定點位置等等??傊褪?,這一步實現(xiàn)的是如何用最小的定點位寬,在精度可接受的前提下實現(xiàn)浮點的算法。

3. 前端設(shè)計

和其他一些復(fù)雜的東西類似,比如編譯器,網(wǎng)站等等類似,芯片設(shè)計也有前端和后端之分,前端到網(wǎng)表,后端到版圖。

5e27eb26-19f6-11ed-ba43-dac502259ad0.jpg

前端主要包含4個步驟:文檔設(shè)計、編碼、驗證、前端實現(xiàn)。主要就是從設(shè)計需求到網(wǎng)表的一個流程。

4. 后端設(shè)計

這個步驟,主要是把網(wǎng)表整成我們最后的版圖??梢灾苯觼G給代工廠生產(chǎn)了。

5e495fea-19f6-11ed-ba43-dac502259ad0.jpg

一共7個步驟。此處給個概述,后面專門寫文章介紹。

準備:這一個步驟中準備主要是準備一些庫文件,前端準備好的網(wǎng)表,劃分好harden, 然后穿線。

設(shè)計規(guī)劃:設(shè)計規(guī)劃主要是擺放一些大件,比如memory硬核,IO PAD, 電源網(wǎng)絡(luò)等等,方便下一個步驟擺放小單元。

布局:這個步驟就把具體的單元擺放到版圖上。

綜合時鐘:把時鐘網(wǎng)絡(luò)擺放好,保證到各個地方的長度都差不多。

布線:真正把線聯(lián)通。此處會通過STA,不斷調(diào)整布局以及routing。

ECO:版圖搞定后,需要工程師手動修一些東西。

芯片收尾:加入dummy, filler cells等等,讓密度滿足光刻需求。

最后驗證:交芯片前,最后再驗證一把。主要包含了后仿,形式驗證,物理驗證。

這7個步驟完成以后,就可以交版圖給代工廠了,接下來就是等芯片回片。

最后的輸出大概這設(shè)個樣子的。

5e597b50-19f6-11ed-ba43-dac502259ad0.jpg

5. 總結(jié)

本篇內(nèi)容是芯片設(shè)計的提綱。這個階段的輸入是設(shè)計需求,輸出是芯片版圖。設(shè)計主要涉及到3方面的內(nèi)容,算法設(shè)計,芯片前端設(shè)計,芯片后端設(shè)計。一整個流程很長,至此芯片的設(shè)計過程就結(jié)束了,下一個過程就是制造!

審核編輯 :李倩

聲明:本文內(nèi)容及配圖由入駐作者撰寫或者入駐合作網(wǎng)站授權(quán)轉(zhuǎn)載。文章觀點僅代表作者本人,不代表電子發(fā)燒友網(wǎng)立場。文章及其配圖僅供工程師學(xué)習(xí)之用,如有內(nèi)容侵權(quán)或者其他違規(guī)問題,請聯(lián)系本站處理。 舉報投訴
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原文標題:一顆芯片的前世今生:設(shè)計(流程概述)

文章出處:【微信號:IP與SoC設(shè)計,微信公眾號:IP與SoC設(shè)計】歡迎添加關(guān)注!文章轉(zhuǎn)載請注明出處。

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