實現(xiàn)簽核時,為了保證芯片設(shè)計的耐用性,設(shè)計師會面臨重重挑戰(zhàn),利用 Cadence Tempus 設(shè)計穩(wěn)健性分析(DRA)套件為設(shè)計工程師提供領(lǐng)先的建模技術(shù),可實現(xiàn)最佳功耗、性能和面積目標(PPA)。
相較于傳統(tǒng)方法,Tempus DRA 套件提供了一套全面的高級分析功能,有望增強設(shè)計級穩(wěn)健性,實現(xiàn)更優(yōu) PPA。

使用 Tempus DRA 套件完成完整分析后,設(shè)計工程師可以利用 Cadence Innovus 設(shè)計實現(xiàn)系統(tǒng)中的 Tempus ECO 選項進行模塊級的收斂,并使用 Cadence Certus 收斂解決方案進行子系統(tǒng)/全芯片層的簽核收斂,顯著提高設(shè)計收斂速度,優(yōu)化 PPA 目標達成。

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關(guān)于 Cadence
Cadence 是電子系統(tǒng)設(shè)計領(lǐng)域的關(guān)鍵領(lǐng)導(dǎo)者,擁有超過 30 年的計算軟件專業(yè)積累。基于公司的智能系統(tǒng)設(shè)計戰(zhàn)略,Cadence 致力于提供軟件、硬件和 IP 產(chǎn)品,助力電子設(shè)計概念成為現(xiàn)實。Cadence 的客戶遍布全球,皆為最具創(chuàng)新能力的企業(yè),他們向超大規(guī)模計算、5G 通訊、汽車、移動設(shè)備、航空、消費電子、工業(yè)和醫(yī)療等最具活力的應(yīng)用市場交付從芯片、電路板到完整系統(tǒng)的卓越電子產(chǎn)品。Cadence 已連續(xù)九年名列美國財富雜志評選的 100 家最適合工作的公司。如需了解更多信息,請訪問公司網(wǎng)站 www.cadence.com。
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原文標題:Tempus DRA 套件:使用先進的芯片建模實現(xiàn)高達 10% 的 PPA 提升
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