Silicon Labs PCI Express Gen 4時鐘為數(shù)據(jù)中心和消費類產品設計確立新的性能標桿

新型Si522xx PCIe時鐘系列產品提供業(yè)界領先的抖動性能、電源效率和單芯片集成度

Silicon Labs(亦稱“芯科科技”，NASDAQ：SLAB）日前宣布針對PCI Express^? (PCIe^?) Gen 1/2/3/4應用推出一系列具有業(yè)界最低抖動、最高集成度、最低功耗的時鐘發(fā)生器產品。Silicon Labs新型Si522xx PCIe時鐘發(fā)生器滿足PCIe Gen 4的嚴格要求且提供20%的抖動裕度，同時為PCIe Gen 3抖動規(guī)格提供60%的抖動裕度。開發(fā)人員現(xiàn)在可以信心十足地采用Silicon Labs PCIe時鐘設計出符合PCIe標準的解決方案，而且可以獲得最大限度的抖動裕度，降低產品開發(fā)風險。請點擊“閱讀原文”探索完整的產品發(fā)布新聞！

憑借兼容PCIe Gen 4和高達12路時鐘輸出，Si522xx時鐘非常適合在數(shù)據(jù)中心應用中提供低抖動PCIe時鐘生成和分發(fā)，無需添加額外的獨立時鐘緩沖器。除了提供一流的抖動裕度外，Si522xx時鐘完全符合PCIe Gen 4通用時鐘和獨立展頻分離參考（SRIS）架構。

Si522xx器件輸出驅動器利用了Silicon Labs創(chuàng)新的推挽式HCSL技術，消除了采用傳統(tǒng)恒流輸出驅動器技術的PCIe時鐘所需的片外終端電阻。內部電源濾波能夠防止電源噪聲降低時鐘抖動性能，器件數(shù)量和占板面積與競爭解決方案相比減少30%。

設計電池供電應用（例如數(shù)碼相機）的開發(fā)人員特別關注功耗。2路輸出的Si52202時鐘特別針對低功耗1.5-1.8V應用進行了優(yōu)化，為PCIe應用提供業(yè)界最低功耗。它采用小尺寸3mmx 3mm 20-QFN封裝，器件尺寸比競爭解決方案小45%。

Silicon Labs時鐘產品高級營銷總監(jiān)James Wilson表示：“Silicon Labs持續(xù)推動PCI Express時鐘的創(chuàng)新、性能和集成度。隨著Si522xx系列產品的發(fā)布，我們現(xiàn)在可以完全滿足整個PCIe應用需求，覆蓋從服務器和存儲到工業(yè)和消費類應用。”

由于時鐘抖動是所有PCIe應用的關鍵設計參數(shù)，Silicon Labs為開發(fā)人員提供了免費的PCIe Gen 1/2/3/4抖動測量工具，請瀏覽網(wǎng)站：www.silabs.com/pcie-learningcenter

Si522xx PCIe時鐘發(fā)生器系列產品已經量產，可提供樣片，支持多種輸出路數(shù)選項。Si52212、Si52208和Si52204時鐘提供12、8和4路100MHzPCIe時鐘輸出，以及1路25MHzLVCMOS參考時鐘輸出。Si52202時鐘支持2路100MHz PCIe時鐘輸出。樣片可在2周內發(fā)貨，量產產品可在4周內發(fā)貨。

Silicon Labs新型Si52204-EVB開發(fā)套件提供快速、方便的PCIe時鐘評估。有關Si522xx PCIe時鐘系列產品或訂購樣片和開發(fā)套件的更多信息，請瀏覽網(wǎng)站：https://www.silabs.com/products/timing/clocks