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LMK03328 具有兩個獨立 PLL 的超低抖動時鐘發(fā)生器系列技術(shù)手冊

科技綠洲 ? 2025-09-14 09:37 ? 次閱讀
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LMK03328器件是一款超低噪聲時鐘發(fā)生器,具有兩個集成VCO的小數(shù)N頻率合成器、靈活的時鐘分配和扇出,以及存儲在片內(nèi)EEPROM中的引腳可選配置狀態(tài)。該器件可為各種多千兆串行接口和數(shù)字器件生成多個時鐘,可降低BOM成本和板面積,并通過替代多個振蕩器和時鐘分配器件來提高可靠性。超低抖動可降低高速串行鏈路中的誤碼率 (BER)。
*附件:lmk03328.pdf

特性

  • 超低噪音,高性能
    • 抖動:100fs RMS(典型值),F(xiàn)OUT > 100MHz
    • PSNR:–80dBc,強(qiáng)大的電源抗噪性
  • 靈活的設(shè)備選項
    • 多達(dá) 8 個 AC-LVPECL、AC-LVDS、AC-CML、HCSL 或 LVCMOS 輸出,或任意組合
    • 引腳模式、I2C模式和EEPROM模式
    • 71 引腳可選預(yù)編程默認(rèn)啟動選項
  • 具有自動或手動選擇功能的雙輸入
    • 晶體輸入:10MHz至52MHz
    • 外部輸入:1MHz至300MHz
  • 頻率裕量選項
    • 使用低成本可拉取晶體基準(zhǔn)電壓源的精細(xì)頻率裕度(典型值 ±50ppm)
    • 使用輸出分頻器的無毛刺粗頻裕度 (%)
  • 其他功能
    • 電源:3.3V 內(nèi)核,1.8V、2.5V、3.3V 輸出
    • 工業(yè)溫度范圍(–40°C 至 85°C)
    • 封裝:7mm × 7mm 48-WQFN

參數(shù)
image.png

方框圖

image.png

1. 產(chǎn)品概述

LMK03328是德州儀器(TI)生產(chǎn)的一款超低抖動時鐘發(fā)生器,具有以下關(guān)鍵特性:

  • 雙獨立PLL設(shè)計,8個可配置輸出
  • 集成EEPROM用于存儲配置
  • 超低抖動性能:典型值100fs RMS(FOUT > 100MHz)
  • 高PSNR:-80dBc,具有強(qiáng)大的電源噪聲抑制能力

2. 主要特性

  • ?靈活的時鐘輸出?:支持8個AC-LVPECL、AC-LVDS、AC-CML、HCSL或LVCMOS輸出,或任意組合
  • ?多種工作模式?:支持引腳模式、I2C模式和EEPROM模式
  • ?雙輸入選擇?:支持自動或手動選擇晶體輸入(10MHz-52MHz)或外部輸入(1MHz-300MHz)
  • ?頻率微調(diào)功能?:
    • 精細(xì)頻率微調(diào)(±50ppm典型值)
    • 無毛刺粗調(diào)頻率微調(diào)(通過輸出分頻器實現(xiàn))
  • ?工作溫度范圍?:-40°C至85°C工業(yè)級
  • ?封裝?:7mm × 7mm 48-WQFN

3. 應(yīng)用領(lǐng)域

  • 交換機(jī)和路由器
  • 網(wǎng)絡(luò)和電信線路卡
  • 服務(wù)器和存儲系統(tǒng)
  • 無線基站
  • PCIe Gen1-Gen6
  • 測試測量設(shè)備
  • 廣播基礎(chǔ)設(shè)施

4. 功能描述

LMK03328包含兩個分?jǐn)?shù)-N頻率合成器,具有以下功能模塊:

  • 兩個集成VCO的PLL(4.8-5.4GHz范圍)
  • 靈活的時鐘分配和扇出
  • 可編程輸出分頻器(1-256分頻)
  • 片上EEPROM存儲配置狀態(tài)
  • 支持I2C接口編程

5. 關(guān)鍵性能參數(shù)

  • ?抖動性能?:
    • 100fs RMS典型值(FOUT > 100MHz)
    • 156.25MHz輸出相位噪聲:-164.5dBc/Hz @ 20MHz偏移
  • ?電源特性?:
    • 核心電壓:3.3V
    • 輸出電壓:1.8V/2.5V/3.3V可選
  • ?功耗?:
    • 典型總電流消耗:約400mA(全功能工作)
    • 待機(jī)模式:30-50mA

6. 配置與控制

  • ?三種配置模式?:
    1. 硬引腳模式(HW_SW_CTRL=1):通過GPIO[5:0]引腳選擇64種預(yù)定義配置
    2. 軟引腳模式(HW_SW_CTRL=0):通過GPIO[3:2]選擇6種EEPROM配置
    3. I2C寄存器模式:通過I2C接口完全編程
  • ?輸出同步?:支持所有輸出分頻器和PLL后分頻器的同步

7. 設(shè)計優(yōu)勢

  • 可替代多個振蕩器和時鐘分配器件,降低BOM成本和PCB面積
  • 超低抖動可降低高速串行鏈路中的誤碼率(BER)
  • 集成的電源調(diào)節(jié)提供出色的電源噪聲抑制
  • 靈活的頻率規(guī)劃支持多種應(yīng)用場景

該器件特別適合需要高性能時鐘生成和分配的應(yīng)用,如高速通信、數(shù)據(jù)存儲和測試測量設(shè)備。

聲明:本文內(nèi)容及配圖由入駐作者撰寫或者入駐合作網(wǎng)站授權(quán)轉(zhuǎn)載。文章觀點僅代表作者本人,不代表電子發(fā)燒友網(wǎng)立場。文章及其配圖僅供工程師學(xué)習(xí)之用,如有內(nèi)容侵權(quán)或者其他違規(guī)問題,請聯(lián)系本站處理。 舉報投訴
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