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?ADS1672 高精度模數(shù)轉換器技術文檔總結

科技綠洲 ? 2025-11-25 14:15 ? 次閱讀
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ADS1672是一種高速、高精度模數(shù)轉換器ADC)。采用先進的三角西格瑪(delta-sigma)架構,最高可達625kSPS運行,交流性能和直流精度均為卓越。
*附件:ads1672.pdf

ADS1672 ADC由一個低漂移、斬波穩(wěn)定調(diào)制器(帶超出范圍檢測)和雙徑可編程數(shù)字濾波器組成。雙重濾波路徑允許用戶在兩種后處理濾波器之間選擇:低延遲或寬帶寬。低延遲濾波器在一個周期內(nèi)迅速穩(wěn)定,適用于具有大瞬時變化的應用,如多路復用器。寬帶寬路徑為交流測量提供了優(yōu)化的頻率響應,通帶紋波小于0.001dB,停止帶衰減86dB,帶寬305kHz。

ADS1672通過I/O引腳控制——無需寄存器編程。專用的START引腳允許直接控制轉換:切換START引腳開始轉換,然后檢索輸出數(shù)據(jù)。靈活的串行接口支持標準CMOS和LVDS邏輯電平的數(shù)據(jù)回讀,使ADS1672能夠直接連接到各種微控制器、數(shù)字信號處理器DSP)或現(xiàn)場可編程網(wǎng)格陣列(FPGA)。

ADS1672采用5V模擬電源和3V數(shù)字電源,耗電350mW。不使用時,PDWN引腳可用于關閉所有設備電路。該器件在工業(yè)溫度范圍內(nèi)完全規(guī)范,并采用TQFP-64封裝。

特性

  • 交流性能:
    動態(tài)范圍107dB,625kSPS
    ;動態(tài)范圍115.5dB,78kSPS
    ;動態(tài)范圍113dB,THD 113dB。
  • 直流精度:
    3ppm 內(nèi)傾
    2μ/°C 偏移漂
    移 2ppm/°C 增益漂移
  • 可編程數(shù)字濾波器,用戶可選擇路徑:
    • 低延遲:完全穩(wěn)定在5.5微秒內(nèi)
    • 寬帶:305kHz BW,平坦通帶
  • 靈活的只讀串行接口:
    • 標準CMOS
    • 串行LVDS
  • 通過START引腳實現(xiàn)簡易轉換控制
  • 超出范圍檢測
  • 電源:模擬+5V,數(shù)字+3V
  • 功率:350mW
  • 應用
    • 自動化測試設備
    • 振動分析
    • 聲納
    • 測試與測量

參數(shù)
image.png

方框圖

image.png
一、產(chǎn)品概述?
ADS1672是德州儀器(TI)推出的高速高精度24位ΔΣ模數(shù)轉換器,采用先進的調(diào)制器架構,最高采樣率625kSPS,兼具優(yōu)異的交流性能和直流精度。該器件專為工業(yè)級應用設計,工作溫度范圍-40°C至+85°C,采用TQFP-64封裝。

?二、核心特性?

  1. ?性能參數(shù)?
    • 動態(tài)范圍:107dB(625kSPS)/115.5dB(78kSPS)
    • 總諧波失真:-113dB
    • 積分非線性:3ppm
    • 失調(diào)漂移:2mV/°C
    • 增益漂移:2ppm/°C
  2. ?雙路徑可編程數(shù)字濾波器?
    • 低延遲路徑:單周期完全建立(5.5ms)
    • 寬帶寬路徑:305kHz帶寬,通帶紋波<0.001dB

?三、系統(tǒng)架構?

  1. ?模擬前端?
    • 差分輸入范圍:±VREF
    • 推薦共模電壓:2.5V
    • 輸入阻抗:與時鐘頻率相關(如20MHz時為3.125kΩ)
  2. ?參考電壓?
    • 差分參考輸入:VREF = VREFP - VREFN
    • 工作范圍:2.75V至3.25V

?四、接口與控制?

  1. ?串行接口選項?
    • 標準CMOS電平
    • LVDS串行接口(TIA/EIA-644A兼容)
  2. ?時鐘配置?
    • 支持內(nèi)部/外部SCLK生成
    • 主時鐘要求:20MHz(典型)

?五、電源管理?

  1. ?供電要求?
    • 模擬電源:5V(4.75V至5.25V)
    • 數(shù)字電源:3V(2.7V至3.3V)
    • 功耗:350mW(典型)

?六、應用領域?

  • 自動化測試設備
  • 振動分析系統(tǒng)
  • 聲納設備
  • 測試測量儀器

?七、關鍵功能?

  1. ?START引腳?:提供精確的轉換控制
  2. ?OTRD功能?:超量程檢測指示
  3. ?同步功能?:支持多器件同步采樣
  4. ?省電模式?:通過PDWN引腳實現(xiàn)全電路關斷

?八、設計要點?

  1. 推薦使用晶體振蕩器作為時鐘源
  2. 參考電壓需高質量低噪聲驅動
  3. 模擬輸入需差分驅動以獲得最佳性能
  4. 電源去耦要求:每個電源引腳就近布置1μF和0.1μF電容

該器件通過引腳配置實現(xiàn)功能控制,無需寄存器編程,簡化了系統(tǒng)設計。其靈活的接口設計和優(yōu)異的性能指標使其成為高精度數(shù)據(jù)采集系統(tǒng)的理想選擇。

聲明:本文內(nèi)容及配圖由入駐作者撰寫或者入駐合作網(wǎng)站授權轉載。文章觀點僅代表作者本人,不代表電子發(fā)燒友網(wǎng)立場。文章及其配圖僅供工程師學習之用,如有內(nèi)容侵權或者其他違規(guī)問題,請聯(lián)系本站處理。 舉報投訴
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