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芯片晶片低于0.3nm的表面粗糙度測量-3D白光干涉儀應(yīng)用

jf_14507239 ? 來源:jf_14507239 ? 作者:jf_14507239 ? 2026-01-27 10:10 ? 次閱讀
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1 、引言

芯片晶片作為半導(dǎo)體器件的核心基材,其表面粗糙度直接影響光刻、蝕刻、薄膜沉積等后續(xù)工藝的穩(wěn)定性與器件最終性能。尤其是在先進(jìn)制程中,低于0.3 nm的超光滑表面要求成為關(guān)鍵技術(shù)瓶頸——表面微小凸起或凹陷會導(dǎo)致光刻膠涂覆不均、薄膜附著力下降,進(jìn)而引發(fā)器件漏電、良率降低等問題。傳統(tǒng)表面粗糙度測量方法受限于分辨率或測量模式,難以實(shí)現(xiàn)低于0.3 nm精度的非接觸全域檢測。3D白光干涉儀憑借亞納米級垂直分辨率、非接觸測量特性及全域三維形貌表征能力,成為芯片晶片超低表面粗糙度測量的核心技術(shù)手段。本文重點(diǎn)探討3D白光干涉儀在芯片晶片低于0.3 nm表面粗糙度測量中的應(yīng)用。

2 、3D白光干涉儀測量原理

3D白光干涉儀以寬光譜白光為光源,經(jīng)分束器分為參考光與物光兩路。參考光射向高精度固定參考鏡反射,物光照射至待測芯片晶片表面后反射,兩束反射光匯交產(chǎn)生干涉條紋。由于白光相干長度極短(僅數(shù)微米),僅在光程差接近零時(shí)形成清晰干涉條紋。通過壓電陶瓷驅(qū)動裝置帶動參考鏡進(jìn)行納米級精密掃描,高靈敏度探測器同步采集干涉條紋強(qiáng)度變化,形成干涉信號包絡(luò)曲線,曲線峰值位置精準(zhǔn)對應(yīng)晶片表面高度坐標(biāo)。結(jié)合像素級高度計(jì)算與全域二維拼接技術(shù),可快速重建晶片表面三維輪廓,通過專業(yè)粗糙度分析算法精準(zhǔn)計(jì)算Ra(算術(shù)平均偏差)等核心參數(shù),其垂直分辨率可達(dá)0.01 nm,完全適配芯片晶片低于0.3 nm的超光滑表面檢測需求。

3 、3D白光干涉儀在芯片晶片超低粗糙度測量中的應(yīng)用

3.1 低于0.3nm粗糙度精準(zhǔn)量化

針對芯片晶片低于0.3 nm的粗糙度檢測要求,3D白光干涉儀可通過優(yōu)化測量參數(shù)實(shí)現(xiàn)精準(zhǔn)量化。測量時(shí),選取低噪聲測量模式,搭配高數(shù)值孔徑物鏡,對晶片光學(xué)功能區(qū)進(jìn)行全域掃描,通過三維輪廓重建獲取全表面高度數(shù)據(jù)。系統(tǒng)內(nèi)置的粗糙度分析模塊可自動剔除測量噪聲,精準(zhǔn)計(jì)算Ra值,且支持不同區(qū)域的參數(shù)對比分析。實(shí)驗(yàn)數(shù)據(jù)表明,其測量結(jié)果與原子力顯微鏡(AFM)比對誤差≤0.02 nm,可有效捕捉拋光工藝中磨料粒徑、拋光壓力變化導(dǎo)致的0.05 nm級粗糙度波動,為先進(jìn)制程晶片拋光工藝參數(shù)優(yōu)化提供精準(zhǔn)量化依據(jù)。同時(shí),采用二維拼接技術(shù)可實(shí)現(xiàn)8英寸、12英寸大尺寸晶片的全表面覆蓋測量,避免局部測量的片面性。

3.2 表面微缺陷同步識別

芯片晶片表面的納米級微劃痕、殘留顆粒、微小凹陷等缺陷,即使尺寸僅數(shù)十納米,也會嚴(yán)重影響后續(xù)工藝及器件性能,且與表面粗糙度密切相關(guān)。3D白光干涉儀在實(shí)現(xiàn)低于0.3 nm粗糙度測量的同時(shí),可通過三維輪廓重建同步識別此類微缺陷。當(dāng)檢測到深度超過0.5 nm、長度超過200 nm的微劃痕,或直徑超過50 nm的殘留顆粒/凹陷時(shí),可判定為不合格產(chǎn)品。通過缺陷的尺寸、位置量化分析,可追溯拋光、清洗等制備環(huán)節(jié)的問題。例如,當(dāng)表面出現(xiàn)密集微小殘留顆粒時(shí),可反饋調(diào)整清洗工藝的超聲功率、清洗劑配比等參數(shù),提升晶片表面潔凈度與光滑度。

4 、測量優(yōu)勢與應(yīng)用價(jià)值

相較于傳統(tǒng)觸針式粗糙度儀,3D白光干涉儀的非接觸測量模式可避免劃傷芯片晶片的超光滑表面,保障樣品完整性;相較于原子力顯微鏡(AFM)的點(diǎn)掃描局限,其具備更快的全域掃描速度(12英寸晶片全表面測量時(shí)間≤15 s),可滿足半導(dǎo)體產(chǎn)業(yè)批量生產(chǎn)檢測需求。通過為芯片晶片低于0.3 nm表面粗糙度測量提供精準(zhǔn)、全面的量化數(shù)據(jù)及微缺陷檢測結(jié)果,3D白光干涉儀可助力構(gòu)建先進(jìn)制程晶片的嚴(yán)格質(zhì)量管控體系,提升芯片制備良率,為半導(dǎo)體產(chǎn)業(yè)向更高精度制程發(fā)展提供關(guān)鍵技術(shù)支撐。

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審核編輯 黃宇

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