AD9269:高性能16位雙路ADC的卓越之選
在電子設(shè)計領(lǐng)域,模擬到數(shù)字的轉(zhuǎn)換是一個關(guān)鍵環(huán)節(jié),它直接影響著系統(tǒng)的性能和精度。今天,我們來深入探討一款備受矚目的16位、20/40/65/80 MSPS、1.8 V雙路模擬到數(shù)字轉(zhuǎn)換器——AD9269。
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產(chǎn)品概述
AD9269是一款單芯片、雙通道、1.8 V供電的16位ADC,具備高性能的采樣保持電路和片上電壓基準(zhǔn)。它采用多級差分流水線架構(gòu),結(jié)合輸出誤差校正邏輯,能夠在80 MSPS的數(shù)據(jù)速率下實現(xiàn)16位的精度,并確保在整個工作溫度范圍內(nèi)無丟失碼。
產(chǎn)品特性亮點(diǎn)
供電與輸出靈活性
AD9269采用單一1.8 V模擬電源供電,同時配備獨(dú)立的數(shù)字輸出驅(qū)動器電源,可兼容1.8 V至3.3 V的邏輯系列,為不同的應(yīng)用場景提供了極大的靈活性。
出色的性能指標(biāo)
- 高信噪比(SNR):在9.7 MHz輸入時,SNR可達(dá)77.6 dBFS;在200 MHz輸入時,仍能保持71 dBFS。
- 高無雜散動態(tài)范圍(SFDR):9.7 MHz輸入時,SFDR為93 dBc;200 MHz輸入時,SFDR為80 dBc。
- 低功耗:20 MSPS時,每通道功耗僅44 mW;80 MSPS時,每通道功耗為100 mW。
集成校正功能
集成了可選的直流校正和正交誤差校正(QEC)功能,能夠校正兩個通道之間的直流偏移、增益和相位失配,這對于復(fù)雜信號處理應(yīng)用,如直接轉(zhuǎn)換接收器,具有重要意義。
豐富的功能特性
- 多種數(shù)據(jù)格式:支持偏移二進(jìn)制、格雷碼或二進(jìn)制補(bǔ)碼數(shù)據(jù)格式。
- 時鐘靈活性:具備可選的時鐘占空比穩(wěn)定器(DCS)和整數(shù)1至6的輸入時鐘分頻器。
- 數(shù)據(jù)輸出選項:提供數(shù)據(jù)輸出復(fù)用選項和內(nèi)置可選的數(shù)字測試模式生成功能。
- 節(jié)能模式:具備節(jié)能的掉電模式和可編程的時鐘與數(shù)據(jù)對齊的數(shù)據(jù)時鐘輸出(DCO)。
應(yīng)用領(lǐng)域廣泛
AD9269的高性能和豐富功能使其在多個領(lǐng)域得到廣泛應(yīng)用,包括通信、雷達(dá)、醫(yī)療成像等。
- 通信領(lǐng)域:適用于分集無線電系統(tǒng)、多模式數(shù)字接收器、GSM、EDGE、W - CDMA、LTE、CDMA2000、WiMAX、TD - SCDMA等通信標(biāo)準(zhǔn)。
- 其他領(lǐng)域:可用于I/Q解調(diào)系統(tǒng)、智能天線系統(tǒng)、電池供電儀器、手持示波器、便攜式醫(yī)療成像、超聲和雷達(dá)/LIDAR等。
技術(shù)細(xì)節(jié)剖析
架構(gòu)設(shè)計
AD9269采用多級流水線ADC架構(gòu),每一級都提供足夠的重疊來校正前一級的閃存誤差。量化輸出在數(shù)字校正邏輯中組合成最終的16位結(jié)果。這種架構(gòu)允許第一級處理新的輸入樣本,而其余級處理先前的樣本,提高了轉(zhuǎn)換效率。
模擬輸入考慮
- 差分輸入電路:模擬輸入為差分開關(guān)電容電路,能夠支持寬共模范圍,同時保持出色的性能。通過設(shè)置輸入共模電壓為電源電壓的一半,可以最小化信號相關(guān)誤差,實現(xiàn)最佳性能。
- 輸入配置:在不同的應(yīng)用場景中,可以選擇不同的輸入配置,如差分輸入、單端輸入等。對于基帶應(yīng)用,推薦使用AD8138、ADA4937 - 2和ADA4938 - 2等差分驅(qū)動器;對于低頻率、高SNR要求的應(yīng)用,差分變壓器耦合是首選;對于高頻應(yīng)用,差分雙巴倫耦合或AD8352差分驅(qū)動器是不錯的選擇。
時鐘輸入
- 時鐘信號要求:為了實現(xiàn)最佳性能,建議使用差分信號對AD9269的采樣時鐘輸入(CLK+和CLK - )進(jìn)行時鐘驅(qū)動。時鐘源的抖動是需要重點(diǎn)關(guān)注的因素,因為它會影響ADC的動態(tài)范圍。
- 時鐘輸入選項:AD9269的時鐘輸入結(jié)構(gòu)非常靈活,支持CMOS、LVDS、LVPECL或正弦波信號。可以通過RF巴倫、RF變壓器或直接使用差分PECL、LVDS信號進(jìn)行時鐘驅(qū)動。此外,還可以使用內(nèi)部時鐘分頻器對輸入時鐘進(jìn)行分頻,同時啟用內(nèi)部占空比穩(wěn)定器(DCS)來補(bǔ)償時鐘占空比的變化。
電源與功耗
- 電源供應(yīng):建議使用兩個獨(dú)立的電源,一個1.8 V的模擬電源(AVDD)和一個1.8 V至3.3 V的數(shù)字輸出電源(DRVDD)。如果使用公共電源,需要使用鐵氧體磁珠或濾波器進(jìn)行隔離,并使用適當(dāng)?shù)娜ヱ铍娙荨?/li>
- 功耗控制:AD9269的模擬核心功耗與采樣率成正比,數(shù)字功耗主要由數(shù)字驅(qū)動器的強(qiáng)度和輸出負(fù)載決定??梢酝ㄟ^降低輸出驅(qū)動器的電容負(fù)載來最小化數(shù)字功耗。此外,AD9269還提供了掉電模式和待機(jī)模式,以實現(xiàn)節(jié)能。
數(shù)字輸出
- 輸出配置:AD9269的輸出驅(qū)動器可以配置為與1.8 V至3.3 V的CMOS邏輯系列接口,輸出數(shù)據(jù)可以復(fù)用在單個輸出總線上,以減少所需的走線數(shù)量。
- 數(shù)據(jù)格式選擇:可以通過設(shè)置SCLK/DFS引腳或使用SPI控制來選擇輸出數(shù)據(jù)格式,如偏移二進(jìn)制、二進(jìn)制補(bǔ)碼或格雷碼。
- 輸出使能功能:AD9269提供了靈活的三態(tài)輸出功能,可以通過OEB引腳或SPI接口進(jìn)行控制。
內(nèi)置測試功能
- 內(nèi)置自測試(BIST):用于驗證AD9269數(shù)字?jǐn)?shù)據(jù)路徑的完整性。通過運(yùn)行BIST測試,可以檢查設(shè)備是否正常工作。
- 輸出測試模式:提供多種輸出測試選項,可將可預(yù)測的值放置在AD9269的輸出上,方便進(jìn)行板級調(diào)試。
通道/芯片同步
AD9269的SYNC輸入提供了靈活的同步選項,可用于跨多個ADC同步采樣時鐘。輸入時鐘分頻器可以在SYNC信號的單次或每次出現(xiàn)時進(jìn)行同步。
直流和正交誤差校正(QEC)
- 誤差校正原理:在直接轉(zhuǎn)換或其他正交系統(tǒng)中,I和Q信號路徑之間的失配會導(dǎo)致頻譜中的頻率鏡像,影響信號的質(zhì)量。AD9269的QEC算法可以測量和校正I和Q信號路徑的幅度和相位不平衡,提高圖像抑制能力。
- 校正范圍:QEC和直流校正的范圍包括增益( - 1.1 dB至 + 1.0 dB)、相位( - 1.79度至 + 1.79度)和直流( - 6%至 + 6%)。
串行端口接口(SPI)
- SPI功能:AD9269的SPI接口允許用戶通過結(jié)構(gòu)化的寄存器空間配置轉(zhuǎn)換器的特定功能或操作。通過SPI,可以進(jìn)行讀寫操作,實現(xiàn)對芯片的編程和狀態(tài)讀取。
- 硬件接口:SPI接口由SCLK、SDIO和CSB三個引腳組成,可由FPGA或微控制器進(jìn)行控制。在使用SPI時,需要注意避免在轉(zhuǎn)換器需要全動態(tài)性能的期間激活SPI,以免引入噪聲影響性能。
設(shè)計指南
電源和接地
- 電源隔離:使用兩個獨(dú)立的電源分別為模擬和數(shù)字部分供電,以減少電源噪聲的影響。
- 去耦電容:在PCB上靠近器件引腳的位置放置適當(dāng)?shù)娜ヱ铍娙?,以濾除高頻和低頻噪聲。
- 接地設(shè)計:使用單一的PCB接地平面,并確保暴露的焊盤(Pin 0)連接到模擬地(AGND),以實現(xiàn)良好的電氣和熱性能。
參考電壓
- 內(nèi)部參考連接:通過檢測SENSE引腳的電位,可以將參考配置為內(nèi)部1.0 V參考或外部1.0 V參考。
- 外部參考操作:在需要提高增益精度或改善熱漂移特性時,可以使用外部參考。
時鐘設(shè)計
- 時鐘源選擇:選擇低抖動的時鐘源,如晶體控制振蕩器,以確保ADC的動態(tài)范圍。
- 時鐘信號處理:將時鐘輸入視為模擬信號,避免與數(shù)字噪聲相互干擾。
總結(jié)
AD9269以其高性能、豐富的功能和靈活的配置選項,成為電子工程師在設(shè)計高性能ADC系統(tǒng)時的理想選擇。無論是在通信、雷達(dá)還是醫(yī)療成像等領(lǐng)域,AD9269都能夠提供出色的性能和可靠的解決方案。在實際設(shè)計中,工程師需要根據(jù)具體的應(yīng)用需求,合理選擇輸入配置、時鐘源和電源方案,以充分發(fā)揮AD9269的優(yōu)勢。你在使用AD9269的過程中遇到過哪些挑戰(zhàn)呢?歡迎在評論區(qū)分享你的經(jīng)驗和見解。
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