數(shù)字設(shè)計(jì)FPGA應(yīng)用：測(cè)試138工程
本課程以目前流行的Xilinx 7系列FPGA的開發(fā)為主線，全面講解FPGA的原理及電路設(shè)計(jì)、Verilog HDL語(yǔ)言及VIVADO的應(yīng)用，并循序漸進(jìn)地從組合邏輯、時(shí)序邏輯的開發(fā)開始，深入到FPGA的基礎(chǔ)應(yīng)用、綜合應(yīng)用和進(jìn)階應(yīng)用。
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發(fā)表于 02-17 11:06
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發(fā)表于 01-09 10:00
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發(fā)表于 07-11 06:15
請(qǐng)問(wèn)FPGA與OMAPL138的upp信號(hào)線直接需要上拉嗎？
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發(fā)表于 07-16 10:14
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發(fā)表于 11-09 11:03
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發(fā)表于 10-12 17:20
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發(fā)表于 10-16 13:57
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發(fā)表于 10-19 08:45
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發(fā)表于 11-18 10:44
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發(fā)表于 08-25 14:41
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