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Vivado 專家系列演講

Xilinx賽靈思官微 ? 來源:djl ? 作者:賽靈思 ? 2019-07-31 17:54 ? 次閱讀
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賽靈思“Vivado 專家系列”研討會(huì)將由來自賽靈思 Vivado 開發(fā)者及資深技術(shù)支持團(tuán)隊(duì)成員為您帶來包括技術(shù)分享、設(shè)計(jì)方法學(xué)、設(shè)計(jì)技巧等內(nèi)容,以幫助用戶快速提高其基于 FPGA 的設(shè)計(jì)效率。此次研討會(huì)為該系列的第一期,旨在深入剖析 Vivado 高速時(shí)序收斂技術(shù)。另外我們還將總結(jié)高速設(shè)計(jì)面臨的挑戰(zhàn),介紹設(shè)計(jì)分析、設(shè)計(jì)向?qū)б约霸O(shè)計(jì)復(fù)雜性和擁塞的分析方法。

演 講 嘉 賓

高亞軍(Lauren Gao)

賽靈思戰(zhàn)略應(yīng)用高級工程師

專注于 C/C++ 高層次綜合,擁有多年利用 Xilinx FPGA 實(shí)現(xiàn)數(shù)字信號處理算法的經(jīng)驗(yàn),對 Xilinx FPGA 的架構(gòu)、開發(fā)工具和設(shè)計(jì)理念有深入的理解。發(fā)布《Vivado入門與提高》,《Vivado HLS 快速上手》等網(wǎng)絡(luò)視頻課程,點(diǎn)擊率超過10萬、出版《基于FPGA的數(shù)字信號處理(第2版)》及《Vovadp從此開始》等書籍,廣受好評。

聲明:本文內(nèi)容及配圖由入駐作者撰寫或者入駐合作網(wǎng)站授權(quán)轉(zhuǎn)載。文章觀點(diǎn)僅代表作者本人,不代表電子發(fā)燒友網(wǎng)立場。文章及其配圖僅供工程師學(xué)習(xí)之用,如有內(nèi)容侵權(quán)或者其他違規(guī)問題,請聯(lián)系本站處理。 舉報(bào)投訴
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