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代碼

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代碼就是程序員用開(kāi)發(fā)工具所支持的語(yǔ)言寫(xiě)出來(lái)的源文件，是一組由字符、符號(hào)或信號(hào)碼元以離散形式表示信息的明確的規(guī)則體系。

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代碼技術(shù)

C語(yǔ)言的函數(shù)如何返回多個(gè)數(shù)據(jù)

C語(yǔ)言的函數(shù)如何返回多個(gè)數(shù)據(jù)？這個(gè)操作在寫(xiě)代碼的時(shí)候還經(jīng)常遇到。

2023-07-25 標(biāo)簽：C語(yǔ)言函數(shù)指針 1.4k 0

嵌入式系統(tǒng)C語(yǔ)言編程中主要的錯(cuò)誤處理方式

本文主要總結(jié)嵌入式系統(tǒng)C語(yǔ)言編程中，主要的錯(cuò)誤處理方式。

2023-07-24 標(biāo)簽：嵌入式嵌入式系統(tǒng)C語(yǔ)言 1.7k 0

兼顧內(nèi)存和速度的C語(yǔ)言代碼優(yōu)化的方法

在本篇文章中，我(指原作者)收集了很多經(jīng)驗(yàn)和方法。應(yīng)用這些經(jīng)驗(yàn)和方法，可以幫助我們從執(zhí)行速度和內(nèi)存使用等方面來(lái)優(yōu)化C語(yǔ)言代碼。

2023-07-24 標(biāo)簽：arm 內(nèi)存 C語(yǔ)言 1.2k 0

優(yōu)化Python代碼有哪些工具

Python是一種強(qiáng)大的編程語(yǔ)言，但在面對(duì)復(fù)雜項(xiàng)目和緊迫的時(shí)間要求時(shí)，提高Python的使用效率變得至關(guān)重要。為此，以下是詳細(xì)介紹十大工具，它們可以幫助...

2023-07-24 標(biāo)簽：編程代碼 python 2.2k 0

基于DWC2的USB驅(qū)動(dòng)開(kāi)發(fā)-控制傳輸中斷相關(guān)寄存器

本篇講解Scatter/Gather DMA模式下控制傳輸相關(guān)的寄存器?？刂苽鬏斒荱SB驅(qū)動(dòng)的核心部分，控制傳輸調(diào)通了驅(qū)動(dòng)就完成了一大半，而驅(qū)動(dòng)的核心又...

2023-07-24 標(biāo)簽：寄存器 usb 編程 5.4k 0

基于DWC2的USB驅(qū)動(dòng)開(kāi)發(fā)-USB包詳解

不管什么通訊協(xié)議，比如UART，SPI，USB等等，不管是并口還是串口，不管是同步還是異步，我們從抽象的角度去看，其本質(zhì)都是一樣的。都是先定義物理信號(hào)，...

2023-07-23 標(biāo)簽：usb SPI 編程 4.5k 0

基于DWC2的USB驅(qū)動(dòng)開(kāi)發(fā)-PING協(xié)議詳解

這里先介紹下PING協(xié)議的背景和原理，我們不一上來(lái)就介紹PING包格式和協(xié)議，因?yàn)橹挥兄淙恢渌匀徊拍芗由罾斫猓魏问聞?wù)都是有其出現(xiàn)的歷史背景的，不...

2023-07-23 標(biāo)簽：usb 編程 Ping 3.3k 0

【FireBeetle 2 ESP32-S3開(kāi)發(fā)板測(cè)評(píng)】MIDI音樂(lè)播放器

本片我們使用PWM輸出不同頻率占空比的信號(hào)來(lái)驅(qū)動(dòng)喇叭，實(shí)現(xiàn)MIDI音樂(lè)播放器的Demo。

2023-07-23 標(biāo)簽：播放器編程開(kāi)發(fā)板 7.5k 0

【FireBeetle 2 ESP32-S3開(kāi)發(fā)板測(cè)評(píng)】MicroPython開(kāi)發(fā)體驗(yàn)

2023-07-23 標(biāo)簽：編程開(kāi)發(fā)板代碼 3.7k 0

【FireBeetle 2 ESP32-S3開(kāi)發(fā)板測(cè)評(píng)】Arduino IDE快速開(kāi)發(fā)體驗(yàn)

2023-07-23 標(biāo)簽：編程 IDE 開(kāi)發(fā)板 4.7k 0

FireBeetle 2 ESP32-S3開(kāi)發(fā)板測(cè)評(píng)

一. 開(kāi)箱 FireBeetle 2 ESP32-S3是dfrobot基于ESP32-S3-WROOM-1-N16R8模組出品的一款小巧的開(kāi)發(fā)板。擁有1...

2023-07-23 標(biāo)簽：編程程序開(kāi)發(fā)板 5k 0

什么是ASIC設(shè)計(jì)？使用HDL和SystemC代碼生成進(jìn)行ASIC設(shè)計(jì)

ASIC 設(shè)計(jì)是開(kāi)發(fā)復(fù)雜電子系統(tǒng)的過(guò)程。該系統(tǒng)可制造成特殊用途的半導(dǎo)體設(shè)備，通常用于大批量應(yīng)用或具有嚴(yán)格的功耗、性能和尺寸限制的應(yīng)用。ASIC 系統(tǒng)設(shè)計(jì)...

2023-07-20 標(biāo)簽：fpga asic 仿真 1.9k 0

分享一些優(yōu)秀的verilog代碼高質(zhì)量verilog代碼的六要素

高質(zhì)量的verilog代碼至少需要包含以下幾個(gè)要素：可讀性、功能、性能、標(biāo)準(zhǔn)化、穩(wěn)定性、可定位。

2023-07-18 標(biāo)簽：Verilog 時(shí)鐘編程 2k 0

談一談開(kāi)發(fā)團(tuán)隊(duì)代碼質(zhì)量如何管控與提升

在技術(shù)行業(yè)做了一定時(shí)間的人應(yīng)該都知道code review是多么的重要，一可以促進(jìn)團(tuán)隊(duì)人員之間互相交流，二可以提升整體團(tuán)隊(duì)的技術(shù)水平，學(xué)習(xí)優(yōu)秀人員寫(xiě)的代...

2023-07-16 標(biāo)簽：編碼代碼 962 0

有了chatGPT搞IT的是否要下崗了！看chatGPT怎樣寫(xiě)代碼

能給我寫(xiě)一個(gè)貪吃蛇游戲代碼嗎？當(dāng)然可以！以下是一個(gè)簡(jiǎn)單的貪吃蛇游戲的 Python 代碼示例： import pygame import random...

2023-07-24 標(biāo)簽：IT 人工智能代碼 1.5k 0

如何在開(kāi)發(fā)板上實(shí)現(xiàn)話題發(fā)布流程

你好，我是愛(ài)吃魚(yú)香ROS的小魚(yú)。本節(jié)將學(xué)習(xí)在開(kāi)發(fā)板上實(shí)現(xiàn)話題的發(fā)布，最終實(shí)現(xiàn)通過(guò)話題發(fā)布當(dāng)前開(kāi)發(fā)板的電池電量信息，關(guān)于電量信息的測(cè)量，請(qǐng)參考：4.電池電...

2023-07-15 標(biāo)簽：Micro adc 開(kāi)發(fā)板 1.4k 0

使用I2C協(xié)議點(diǎn)亮OLED

你好，我是愛(ài)吃魚(yú)香ROS的小魚(yú)。本節(jié)我們就嘗試直接使用I2C協(xié)議來(lái)點(diǎn)亮OLED，因?yàn)橹饕獪y(cè)試I2C協(xié)議，所以對(duì)于復(fù)雜的顯示處理部分小魚(yú)就略過(guò)了，畢竟有方...

2023-07-15 標(biāo)簽：OLED 代碼學(xué)習(xí)板 3.3k 0

Verilog代碼封裝后門訪問(wèn)

關(guān)于仿真里的后門訪問(wèn)，之前的文章《三分鐘教會(huì)你SpinalHDL仿真中的后門讀寫(xiě)》中有做過(guò)介紹，其針對(duì)的都是針對(duì)以SpinalHDL中的代碼進(jìn)行的后門訪...

2023-07-15 標(biāo)簽：封裝仿真 Verilog 1.6k 0

基于matlab免疫算法求解生產(chǎn)調(diào)度零等待問(wèn)題

經(jīng)典的優(yōu)化問(wèn)題，免疫算法（IA）是求解該問(wèn)題的常用方法之一。其數(shù)學(xué)原理公式如下。

2023-07-15 標(biāo)簽：matlab 算法函數(shù) 1.3k 0

分享只有一行代碼的實(shí)用小工具

比如我來(lái)說(shuō)吧，大概有 10 個(gè)左右的軟件要一一打開(kāi)，包括：微信、Vitual Studio、MobaXterm、LuaEdior、XMind、印象筆記等等。

2023-07-14 標(biāo)簽：軟件代碼工具 1k 0

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Protues

Protues

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Proteus軟件是英國(guó)Lab Center Electronics公司出版的EDA工具軟件（該軟件中國(guó)總代理為廣州風(fēng)標(biāo)電子技術(shù)有限公司）。它不僅具有其它EDA工具軟件的仿真功能，還能仿真單片機(jī)及外圍器件。
靜電防護(hù)

靜電防護(hù)

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為防止靜電積累所引起的人身電擊、火災(zāi)和爆炸、電子器件失效和損壞，以及對(duì)生產(chǎn)的不良影響而采取的防范措施。其防范原則主要是抑制靜電的產(chǎn)生，加速靜電泄漏，進(jìn)行靜電中和等。
Altium Designer

Altium Designer

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FPGA芯片

FPGA芯片

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FPGA（Field－Programmable Gate Array），即現(xiàn)場(chǎng)可編程門陣列，它是在PAL、GAL、CPLD等可編程器件的基礎(chǔ)上進(jìn)一步發(fā)展的產(chǎn)物。
ArduBlock

ArduBlock

+關(guān)注

ArduBlock軟件是Arduino官方編程環(huán)境的第三方軟件，目前必須依附于Arduino軟件下運(yùn)行，區(qū)別于Arduino文本式編程環(huán)境，ArduBlock是以圖形化積木搭建的方式編程的，這樣的方式會(huì)使編程的可視化和交互性加強(qiáng)，編程門檻降低，即使沒(méi)有編程經(jīng)驗(yàn)的人也可以嘗試給Arduino控制器編寫(xiě)程序。
AD10

AD10

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識(shí)別

識(shí)別

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FPGA開(kāi)發(fā)板

FPGA開(kāi)發(fā)板

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FPGA開(kāi)發(fā)板在基于MCU、定制ASIC和體積龐大的電線束來(lái)實(shí)現(xiàn)引擎及控制電子的系統(tǒng)方案已發(fā)展至接近其技術(shù)和應(yīng)用極限，汽車工業(yè)正面臨新的設(shè)計(jì)挑戰(zhàn)。過(guò)去汽車電子產(chǎn)品的開(kāi)發(fā)周期是漫長(zhǎng)的，而許多汽車制造商現(xiàn)正致力于在更短的時(shí)間內(nèi)，裝備消費(fèi)者所需的新一代汽車。
PCB封裝

PCB封裝

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pcb封裝就是把實(shí)際的電子元器件，芯片等的各種參數(shù)（比如元器件的大小，長(zhǎng)寬，直插，貼片，焊盤(pán)的大小，管腳的長(zhǎng)寬，管腳的間距等）用圖形方式表現(xiàn)出來(lái)，以便可以在畫(huà)pcb圖時(shí)進(jìn)行調(diào)用。
QUARTUS II

QUARTUS II

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Quartus II 是Altera公司推出的綜合性CPLD/FPGA開(kāi)發(fā)軟件，軟件支持原理圖、VHDL、VerilogHDL以及AHDL（Altera Hardware 支持Description Language）等多種設(shè)計(jì)輸入形式，內(nèi)嵌自有的綜合器以及仿真器，可以完成從設(shè)計(jì)輸入到硬件配置的完整PLD設(shè)計(jì)流程。
語(yǔ)音交互

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PCB封裝庫(kù)

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PDN

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QuickPcb

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Artix-7

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　　Artix-7 系列：相對(duì)于 Spartan-6 系列而言，Artix-7 系列功耗降低了一半，成本降低了 35%，采用小型化封裝、統(tǒng)一的 Virtex 系列架構(gòu)，能滿足低成本大批量市場(chǎng)的性能要求，這也正是此前 ASSP、ASIC 和低成本 FPGA 所針對(duì)的市場(chǎng)領(lǐng)域。
VHDL代碼

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powerlink

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Protel 99 se

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面包板

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面包板是由于板子上有很多小插孔，專為電子電路的無(wú)焊接實(shí)驗(yàn)設(shè)計(jì)制造的。由于各種電子元器件可根據(jù)需要隨意插入或拔出，免去了焊接，節(jié)省了電路的組裝時(shí)間，而且元件可以重復(fù)使用，所以非常適合電子電路的組裝、調(diào)試和訓(xùn)練。
candence

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AXI

AXI

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AXI是一種總線協(xié)議，該協(xié)議是ARM公司提出的AMBA3.0協(xié)議中最重要的部分，是一種面向高性能、高帶寬、低延遲的片內(nèi)總線。它的地址/控制和數(shù)據(jù)相位是分離的，支持不對(duì)齊的數(shù)據(jù)傳輸，同時(shí)在突發(fā)傳輸中，只需要首地址，同時(shí)分離的讀寫(xiě)數(shù)據(jù)通道、并支持Outstanding傳輸訪問(wèn)和亂序訪問(wèn)，并更加容易進(jìn)行時(shí)序收斂。AXI是AMBA中一個(gè)新的高性能協(xié)議。
特性阻抗

特性阻抗

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特性阻抗又稱特征阻抗，它不是直流電阻，屬于長(zhǎng)線傳輸中的概念。特性阻抗是射頻傳輸線影響無(wú)線電波電壓、電流的幅值和相位變化的固有特性，等于各處的電壓與電流的比值，用V/I表示。在射頻電路中，電阻、電容、電感都會(huì)阻礙交變電流的流動(dòng)，合稱阻抗。電阻是吸收電磁能量的，理想電容和電感不消耗電磁能量。
時(shí)鐘源

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時(shí)鐘源用來(lái)為環(huán)形脈沖發(fā)生器提供頻率穩(wěn)定且電平匹配的方波時(shí)鐘脈沖信號(hào)。它通常由石英晶體振蕩器和與非門組成的正反饋振蕩電路組成，其輸出送至環(huán)形脈沖發(fā)生器。
AD采樣

AD采樣

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　　AD轉(zhuǎn)換采樣頻率指完成一次從模擬轉(zhuǎn)換到數(shù)字的AD轉(zhuǎn)換所需時(shí)間的倒數(shù)，模擬量可以是電壓、電流等電信號(hào)，也可以是壓力、溫度、濕度、位移、聲音等非電信號(hào)；而AD分辨率指數(shù)字量變化一個(gè)最小量時(shí)模擬信號(hào)的變化量。
驅(qū)動(dòng)電流

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Kintex-7

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　　Kintex-7系列：Kintex-7 系列是一種新型 FPGA，能以不到 Virtex-6 系列一半的價(jià)格實(shí)現(xiàn)與其相當(dāng)性能，性價(jià)比提高了一倍，功耗降低了一半。
Protel DXP

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FPGA教程

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紅外觸摸屏

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