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代碼

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代碼就是程序員用開發(fā)工具所支持的語言寫出來的源文件，是一組由字符、符號(hào)或信號(hào)碼元以離散形式表示信息的明確的規(guī)則體系。

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代碼技術(shù)

linux命令和shell編程有什么聯(lián)系

Linux命令和Shell編程之間存在密切的聯(lián)系。首先，Shell是Linux命令行下的解釋器，它提供了一個(gè)用戶界面，使用戶能夠與Linux內(nèi)核進(jìn)行交...

2023-11-08 標(biāo)簽：Linux 函數(shù)命令 1.7k 0

NullPointerException及其產(chǎn)生的場(chǎng)景

如果一個(gè)Java程序到處拋出NullPointerException，那么我們可能會(huì)各種吐槽代碼的質(zhì)量。但是我們的項(xiàng)目又經(jīng)常會(huì)拋出空指針異常，空指針異常...

2023-10-09 標(biāo)簽：數(shù)據(jù)代碼應(yīng)用程序 1.7k 0

布局合理的原理圖

不光代碼有可讀性，原理圖也有。原理圖不僅僅是自己看，其他人也會(huì)看。把原理圖分模塊，可以讓原理圖更清晰，也可以快速地找到具體的位置。一張?jiān)韴D就好像一...

2023-10-16 標(biāo)簽：模塊連接器接口 1.7k 0

如何實(shí)現(xiàn)代碼的高內(nèi)聚、低耦合

大家在談到面向?qū)ο缶幊痰臅r(shí)候基本都是討論軟件的“高內(nèi)聚、低耦合”的特點(diǎn)，這6個(gè)字也是算是成為了大部分評(píng)判代碼質(zhì)量的一個(gè)標(biāo)準(zhǔn)，所以很多小伙伴一開始學(xué)習(xí)編程...

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Python常用函數(shù)大全

在 Python 世界里，有一些寶藏函數(shù)和模塊，它們可以讓你編程更輕松、代碼更高效。這篇文章將帶你一一認(rèn)識(shí)這些神器，讓你的開發(fā)生活瞬間輕松不少！

2024-10-27 標(biāo)簽：編程函數(shù)代碼 1.7k 0

Perl腳本原理和使用方法

Verilog編碼過程中會(huì)存在有規(guī)律的代碼，其中不少代碼不適合用for循環(huán)實(shí)現(xiàn)。如MAC、PCS模塊里就有很多重復(fù)有規(guī)律的模塊例化，此時(shí)使用Perl循環(huán)...

2023-09-25 標(biāo)簽：Linux Verilog 代碼 1.7k 0

網(wǎng)站總被攻擊？寫個(gè)自動(dòng)封禁IP的腳本給你

個(gè)人網(wǎng)站總被攻擊？寫個(gè)自動(dòng)封禁IP的腳本給你！

2023-01-29 標(biāo)簽：IP HTTP 代碼 1.6k 0

剖析Android項(xiàng)目組件化重構(gòu)架構(gòu)

重構(gòu)前的代碼業(yè)務(wù)封裝在宿主app中，業(yè)務(wù)耦合嚴(yán)重，如果修改一個(gè)業(yè)務(wù)模塊，需要對(duì)整個(gè)app進(jìn)行完整測(cè)試，測(cè)試工作量巨大而**重構(gòu)后，我們只需要對(duì)單一a...

2023-03-30 標(biāo)簽：Android APP 代碼 1.6k 0

Web漏洞靶場(chǎng)搭建-wavsep

滲透測(cè)試切記紙上談兵，學(xué)習(xí)滲透測(cè)試知識(shí)的過程中，我們通常需要一個(gè)包含漏洞的測(cè)試環(huán)境來進(jìn)行訓(xùn)練。而在非授權(quán)情況下，對(duì)于網(wǎng)站進(jìn)行滲透測(cè)試攻擊，是觸及法律法規(guī)...

2022-10-13 標(biāo)簽：Web Linux 代碼 1.6k 0

NLP類別不均衡問題之loss大集合

　　NLP 任務(wù)中，數(shù)據(jù)類別不均衡問題應(yīng)該是一個(gè)極常見又頭疼的的問題了。最近在工作中也是碰到這個(gè)問題，花了些時(shí)間梳理并實(shí)踐了下類別不均衡問題的解決方式，...

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10種聚類算法和Python代碼2

分享一篇關(guān)于聚類的文章： **10種聚類算法和Python代碼** 。文末提供`<span>jupyter notebook</spa...

2023-02-20 標(biāo)簽：代碼數(shù)據(jù)分析 python 1.6k 0

LVGL前臺(tái)程序開發(fā)相關(guān)操作介紹

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在SpinalHDL里在頂層一鍵優(yōu)化Stream/Flow代碼生成

? ? 在SpinalHDL里在頂層一鍵優(yōu)化代碼中Stream/Flow代碼生成的payload，fragment。難看的代碼 ? ????來看一段代...

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從代碼到實(shí)踐：ARMv8 PMUv3性能監(jiān)控的實(shí)際應(yīng)用解析

本文結(jié)合perf_event.c代碼片段，聚焦實(shí)際開發(fā)場(chǎng)景，將通過以下內(nèi)容展開。

2026-02-04 標(biāo)簽：中斷處理代碼 ARMv8 1.6k 0

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軟件問題的分析與解決嵌入式軟件由于調(diào)試手段的限制、部署場(chǎng)景的多樣化、軟硬件問題混合在一起、外部環(huán)境因素的影響等因素，導(dǎo)致軟件經(jīng)常會(huì)遇到一些非常難以解決...

2023-12-07 標(biāo)簽：軟件嵌入式軟件代碼 1.6k 0

Verilog代碼封裝后門訪問

關(guān)于仿真里的后門訪問，之前的文章《三分鐘教會(huì)你SpinalHDL仿真中的后門讀寫》中有做過介紹，其針對(duì)的都是針對(duì)以SpinalHDL中的代碼進(jìn)行的后門訪...

2023-07-15 標(biāo)簽：封裝仿真 Verilog 1.6k 0

關(guān)于快速知識(shí)蒸餾的視覺框架

知識(shí)蒸餾框架包含了一個(gè)預(yù)訓(xùn)練好的 teacher 模型（蒸餾過程權(quán)重固定），和一個(gè)待學(xué)習(xí)的 student 模型, teacher 用來產(chǎn)生 soft ...

2022-08-31 標(biāo)簽：數(shù)據(jù)開源代碼 1.6k 0

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2018-10-18 標(biāo)簽：英特爾代碼 1.6k 0

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Proteus軟件是英國Lab Center Electronics公司出版的EDA工具軟件（該軟件中國總代理為廣州風(fēng)標(biāo)電子技術(shù)有限公司）。它不僅具有其它EDA工具軟件的仿真功能，還能仿真單片機(jī)及外圍器件。
靜電防護(hù)

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為防止靜電積累所引起的人身電擊、火災(zāi)和爆炸、電子器件失效和損壞，以及對(duì)生產(chǎn)的不良影響而采取的防范措施。其防范原則主要是抑制靜電的產(chǎn)生，加速靜電泄漏，進(jìn)行靜電中和等。
Altium Designer

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FPGA芯片

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FPGA（Field－Programmable Gate Array），即現(xiàn)場(chǎng)可編程門陣列，它是在PAL、GAL、CPLD等可編程器件的基礎(chǔ)上進(jìn)一步發(fā)展的產(chǎn)物。
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ArduBlock軟件是Arduino官方編程環(huán)境的第三方軟件，目前必須依附于Arduino軟件下運(yùn)行，區(qū)別于Arduino文本式編程環(huán)境，ArduBlock是以圖形化積木搭建的方式編程的，這樣的方式會(huì)使編程的可視化和交互性加強(qiáng)，編程門檻降低，即使沒有編程經(jīng)驗(yàn)的人也可以嘗試給Arduino控制器編寫程序。
AD10

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FPGA開發(fā)板

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FPGA開發(fā)板在基于MCU、定制ASIC和體積龐大的電線束來實(shí)現(xiàn)引擎及控制電子的系統(tǒng)方案已發(fā)展至接近其技術(shù)和應(yīng)用極限，汽車工業(yè)正面臨新的設(shè)計(jì)挑戰(zhàn)。過去汽車電子產(chǎn)品的開發(fā)周期是漫長的，而許多汽車制造商現(xiàn)正致力于在更短的時(shí)間內(nèi)，裝備消費(fèi)者所需的新一代汽車。
PCB封裝

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pcb封裝就是把實(shí)際的電子元器件，芯片等的各種參數(shù)（比如元器件的大小，長寬，直插，貼片，焊盤的大小，管腳的長寬，管腳的間距等）用圖形方式表現(xiàn)出來，以便可以在畫pcb圖時(shí)進(jìn)行調(diào)用。
QUARTUS II

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Quartus II 是Altera公司推出的綜合性CPLD/FPGA開發(fā)軟件，軟件支持原理圖、VHDL、VerilogHDL以及AHDL（Altera Hardware 支持Description Language）等多種設(shè)計(jì)輸入形式，內(nèi)嵌自有的綜合器以及仿真器，可以完成從設(shè)計(jì)輸入到硬件配置的完整PLD設(shè)計(jì)流程。
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PCB封裝庫

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Artix-7

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　　Artix-7 系列：相對(duì)于 Spartan-6 系列而言，Artix-7 系列功耗降低了一半，成本降低了 35%，采用小型化封裝、統(tǒng)一的 Virtex 系列架構(gòu)，能滿足低成本大批量市場(chǎng)的性能要求，這也正是此前 ASSP、ASIC 和低成本 FPGA 所針對(duì)的市場(chǎng)領(lǐng)域。
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面包板是由于板子上有很多小插孔，專為電子電路的無焊接實(shí)驗(yàn)設(shè)計(jì)制造的。由于各種電子元器件可根據(jù)需要隨意插入或拔出，免去了焊接，節(jié)省了電路的組裝時(shí)間，而且元件可以重復(fù)使用，所以非常適合電子電路的組裝、調(diào)試和訓(xùn)練。
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AXI

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AXI是一種總線協(xié)議，該協(xié)議是ARM公司提出的AMBA3.0協(xié)議中最重要的部分，是一種面向高性能、高帶寬、低延遲的片內(nèi)總線。它的地址/控制和數(shù)據(jù)相位是分離的，支持不對(duì)齊的數(shù)據(jù)傳輸，同時(shí)在突發(fā)傳輸中，只需要首地址，同時(shí)分離的讀寫數(shù)據(jù)通道、并支持Outstanding傳輸訪問和亂序訪問，并更加容易進(jìn)行時(shí)序收斂。AXI是AMBA中一個(gè)新的高性能協(xié)議。
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特性阻抗又稱特征阻抗，它不是直流電阻，屬于長線傳輸中的概念。特性阻抗是射頻傳輸線影響無線電波電壓、電流的幅值和相位變化的固有特性，等于各處的電壓與電流的比值，用V/I表示。在射頻電路中，電阻、電容、電感都會(huì)阻礙交變電流的流動(dòng)，合稱阻抗。電阻是吸收電磁能量的，理想電容和電感不消耗電磁能量。
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時(shí)鐘源用來為環(huán)形脈沖發(fā)生器提供頻率穩(wěn)定且電平匹配的方波時(shí)鐘脈沖信號(hào)。它通常由石英晶體振蕩器和與非門組成的正反饋振蕩電路組成，其輸出送至環(huán)形脈沖發(fā)生器。
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　　AD轉(zhuǎn)換采樣頻率指完成一次從模擬轉(zhuǎn)換到數(shù)字的AD轉(zhuǎn)換所需時(shí)間的倒數(shù)，模擬量可以是電壓、電流等電信號(hào)，也可以是壓力、溫度、濕度、位移、聲音等非電信號(hào)；而AD分辨率指數(shù)字量變化一個(gè)最小量時(shí)模擬信號(hào)的變化量。
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　　Kintex-7系列：Kintex-7 系列是一種新型 FPGA，能以不到 Virtex-6 系列一半的價(jià)格實(shí)現(xiàn)與其相當(dāng)性能，性價(jià)比提高了一倍，功耗降低了一半。
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