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標(biāo)簽 > 低功耗設(shè)計(jì)
低功耗設(shè)計(jì)(design for low power)是2018年公布的計(jì)算機(jī)科學(xué)技術(shù)名詞。從系統(tǒng)、結(jié)構(gòu)、電路、工藝等方面著手,在滿(mǎn)足功能、性能要求的前提下,盡量降低集成電路能耗的設(shè)計(jì)方法。
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2025-12-29 標(biāo)簽:以太網(wǎng)交換機(jī)低功耗設(shè)計(jì)KSZ8864CNX/RMNUB 509 0
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2025-12-24 標(biāo)簽:低功耗設(shè)計(jì)SN65LVDS311顯示串行接口發(fā)射器 370 0
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2025-12-16 標(biāo)簽:低功耗設(shè)計(jì)TCAN1162-Q1汽車(chē)CAN FD收發(fā)器 675 0
低功耗與低抖動(dòng)振蕩器應(yīng)用解析:支持1ps RMS和±20ppm頻穩(wěn)
在高集成、低功耗與高速通信日益融合的系統(tǒng)設(shè)計(jì)中,振蕩器的選擇變得至關(guān)重要。 本文將深入解析一種同時(shí)具備 1ps RMS相位抖動(dòng) 與 ±20ppm頻率穩(wěn)定...
2025-04-30 標(biāo)簽:晶體振蕩器低功耗設(shè)計(jì)低抖動(dòng) 1.3k 0
如何利用低功耗設(shè)計(jì)技術(shù)實(shí)現(xiàn)超大規(guī)模集成電路(VLSI)的電源完整性?
本文要點(diǎn)超大規(guī)模集成電路(Verylargescaleintegration,VLSI)是一種主流的集成電路(IC)設(shè)計(jì)模式。芯片尺寸微型化有助于降低單...
2024-08-03 標(biāo)簽:集成電路低功耗設(shè)計(jì)電源完整性 2.1k 0
隨著科技的發(fā)展和智能化設(shè)備的普及,我們對(duì)于高效能、低功耗的半導(dǎo)體設(shè)備需求愈加強(qiáng)烈,對(duì)低功耗仿真的需求成指數(shù)級(jí)增長(zhǎng)。X態(tài)傳播分析是低功耗仿真的重要部分,但...
低功耗設(shè)計(jì)之Power Switch Cell
CMOS電路中的功耗分為兩部分:靜態(tài)功耗和動(dòng)態(tài)功耗;
2024-01-16 標(biāo)簽:動(dòng)態(tài)功耗靜態(tài)功耗低功耗設(shè)計(jì) 8.1k 0
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