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ASIC是Application Specific Integrated Circuit的英文縮寫，在集成電路界被認(rèn)為是一種為專門目的而設(shè)計的集成電路。ASIC也是Australian Securities and Investment Commission的英文縮寫，即澳大利亞證券和投資委員會，它是澳大利亞金融服務(wù)和市場的法定監(jiān)管機構(gòu)。

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芯原精彩亮相ICCAD-Expo 2025

11月20至21日，2025集成電路發(fā)展論壇 (成渝) 暨三十一屆集成電路設(shè)計業(yè)展覽會 (ICCAD-Expo 2025)在成都·中國西部國際博覽城舉辦...

2025-11-24 標(biāo)簽：集成電路 asic eda 1.6k 0

PT2021WS電容式觸摸控制ASIC概述及主要特性

PT2021WS 是一款電容式觸摸控制 ASIC，支持單通道觸摸輸入和單路 PWM 輸出，可引腳配置 2種功能模式。PT2021WS 主要應(yīng)用于觸摸調(diào)光...

2022-06-15 標(biāo)簽：asic 電容式觸摸控制 1.5k 0

智原FPGA-Go-ASIC成功打進多元的應(yīng)用市場

ASIC設(shè)計服務(wù)暨IP研發(fā)銷售廠商智原科技（Faraday Technology Corporation，TWSE：3035）今日宣布其FPGA-Go-...

2022-11-23 標(biāo)簽：fpga arm asic 1.5k 0

萊迪思發(fā)ECP5 FPGA產(chǎn)品系列適用于眾多應(yīng)用

萊迪思半導(dǎo)體公司（NASDAQ： LSCC）今日宣布推出ECP5?產(chǎn)品系列，面向?qū)τ跇O低成本、極低功耗、極小尺寸有著苛刻要求的小型蜂窩網(wǎng)絡(luò)、微型服務(wù)器、...

2014-04-16 標(biāo)簽：FPGA ASIC 萊迪思 1.5k 0

MathWorks通過Universal Verification Methodology (UVM)支持加快 FPGA和ASIC驗證速度

Wilson Research Group 的一項最近研究發(fā)現(xiàn)，48% 的 FPGA 設(shè)計項目和 71% 的 ASIC設(shè)計項目依賴 UVM 進行設(shè)計驗證。

2020-03-02 標(biāo)簽：fpga asic MathWorks 1.5k 0

使用Cumulus 4.4實現(xiàn)創(chuàng)新、先進功能和擴展增強功能

　　最后，NVIDIA AIR也更新到了Cumulus 4.4?，F(xiàn)在就可以創(chuàng)建您的第一個網(wǎng)絡(luò)數(shù)字孿生模擬器，檢查和升級您的環(huán)境，然后就可以使用所有新功能！

2022-04-22 標(biāo)簽：asic NVIDIA 1.5k 0

針對不同的應(yīng)用和設(shè)計需求,FPGA器件的發(fā)展策略和方案

綜上所述，隨著系統(tǒng)設(shè)備功能要求的不斷增加，系統(tǒng)級芯片的設(shè)計愈趨復(fù)雜，并且在設(shè)計周期、靈活度和NRE成本等方面都面臨著更大的挑戰(zhàn)。這一趨勢使得FPGA器件...

2020-07-17 標(biāo)簽：fpga 芯片 asic 1.5k 0

智原推出推出FIE3240 FPGA開發(fā)驗證平臺，加速ASIC前期開發(fā)

智原FIE3240平臺支持業(yè)界標(biāo)準(zhǔn)擴充接口以整合DDR、USB、Ethernet、MIPI和LCD控制器等功能，且提供多電平I/O以直接連接各種周邊組件...

2019-12-23 標(biāo)簽：fpga asic 物聯(lián)網(wǎng) 1.5k 0

ASIC設(shè)計方案提供商燦芯半導(dǎo)體為NVDIMM OEM提供控制器芯片方案

此前，國際領(lǐng)先的定制化芯片（ASIC）設(shè)計方案提供商及DDR控制器和物理層IP供應(yīng)商燦芯半導(dǎo)體（上海）有限公司（以下簡稱燦芯半導(dǎo)體）對外宣布為一家著名的...

2020-10-28 標(biāo)簽：asic 存儲器 DDR 1.5k 0

數(shù)據(jù)中心開發(fā)者怎樣才能快速上手SoC設(shè)計呢？

芯片開發(fā)者們每天都在迎接和解決新的挑戰(zhàn)?？萍荚谝砸庀氩坏降乃俣蕊w速發(fā)展，開發(fā)者需要走在最前沿，緊跟最新、最先進的技術(shù)發(fā)展步伐，從容應(yīng)對高度復(fù)雜的環(huán)境。

2023-10-19 標(biāo)簽：asic SoC設(shè)計 COT 1.5k 0

英特爾14nm制程助陣 Altera打造地表最強FPGA

Altera對第10代元件進行了最佳化，支援客戶開發(fā)可高度訂制的解決方案，大幅提高系統(tǒng)性能和系統(tǒng)整合度，同時降低了營運成本。

2013-06-14 標(biāo)簽：FPGA 英特爾 ASIC 1.5k 0

MathWorks 引入像素流處理算法

MathWorks 引入像素流處理算法，針對在FPGA和 ASIC上進行視覺系統(tǒng)設(shè)計和實現(xiàn)。新的 Vision HDL Toolbox 縮短了從概念到設(shè)...

2015-05-07 標(biāo)簽：FPGA ASIC MathWorks 1.5k 0

羅德與施瓦茨為MXO系列示波器配備基于ASIC的區(qū)域觸發(fā)功能

羅德與施瓦茨（以下簡稱“R&S”）推出業(yè)界首款基于 ASIC 的區(qū)域觸發(fā)功能，進一步加強其示波器產(chǎn)品組合。 MXO 系列示波器可提供目前業(yè)界最快...

2024-07-25 標(biāo)簽：示波器 asic 羅德與施瓦茨 1.5k 0

FPGA、ASIC有望在機器學(xué)習(xí)領(lǐng)域中崛起

機器學(xué)習(xí)已經(jīng)被廣泛的的使用在了各個領(lǐng)域，在一年之內(nèi)它的成長速度超過了預(yù)期。同時隨著AI芯片的發(fā)展，在以后，F(xiàn)PGA和ASIC芯片將有望成為機器學(xué)習(xí)領(lǐng)域的新主力。

2017-12-26 標(biāo)簽：fpga asic 機器學(xué)習(xí) 1.5k 0

ASIC都去哪兒了？賽靈思專家告訴你答案

上周在看了我的朋友Dave Jones拆解一臺舊的Fluke 91 ScopeMeter DSO（數(shù)字采樣示波器）的視頻時，我突然發(fā)現(xiàn)，這款有20年歷史...

2013-03-11 標(biāo)簽：ASIC 賽靈思 All Programmable 1.5k 0

聯(lián)發(fā)科Q3營收增10.8% CEO蔡力行表示半導(dǎo)體市場明年變數(shù)多

聯(lián)發(fā)科第3季合并營收為670.3億元，季增10.8％，接近原預(yù)測區(qū)間高標(biāo)，蔡力行提到，聯(lián)發(fā)科第3季行動運算平臺包括手機與平板產(chǎn)品，營收占比約為30％至3...

2018-11-01 標(biāo)簽：芯片聯(lián)發(fā)科 ASIC 1.5k 0

國微思爾芯推采用Stratix 10 GX 10M FPGA的3億門原型驗證系統(tǒng)

國微思爾芯發(fā)布3億門原型驗證系統(tǒng)，采用業(yè)界最高容量的 Intel? Stratix? 10 GX 10M FPGAs。

2020-09-08 標(biāo)簽：dsp fpga asic 1.5k 0

高效的代碼校驗讓芯片開發(fā)周期左移

專用集成電路(ASIC)的設(shè)計規(guī)模不斷擴大、復(fù)雜度不斷攀升，這對芯片開發(fā)者的能力和所使用的工具都提出了更高的要求。

2022-06-07 標(biāo)簽：芯片集成電路 asic 1.5k 0

Adam Taylor玩轉(zhuǎn)MicroZed系列第80部分

在Adam Taylor玩轉(zhuǎn)MicroZed系列的前期部分中，我們介紹了IP棧的概念。（見Adam Taylor玩轉(zhuǎn)MicroZed系列第79部分：Zy...

2017-01-13 標(biāo)簽：fpga asic 1.5k 0

S2C發(fā)表最大容量SoC/ASIC原型系統(tǒng)

S2C公司發(fā)表最大容量SoC/ASIC原型系統(tǒng)，Quad S4 TAI Logic Module 能夠容納高達(dá)3,280萬閘的設(shè)計并且擁有 S2C 第4...

2011-04-26 標(biāo)簽：ASIC SoC S2C 1.5k 0

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Protues

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Proteus軟件是英國Lab Center Electronics公司出版的EDA工具軟件（該軟件中國總代理為廣州風(fēng)標(biāo)電子技術(shù)有限公司）。它不僅具有其它EDA工具軟件的仿真功能，還能仿真單片機及外圍器件。
靜電防護

靜電防護

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為防止靜電積累所引起的人身電擊、火災(zāi)和爆炸、電子器件失效和損壞，以及對生產(chǎn)的不良影響而采取的防范措施。其防范原則主要是抑制靜電的產(chǎn)生，加速靜電泄漏，進行靜電中和等。
Altium Designer

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FPGA芯片

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FPGA（Field－Programmable Gate Array），即現(xiàn)場可編程門陣列，它是在PAL、GAL、CPLD等可編程器件的基礎(chǔ)上進一步發(fā)展的產(chǎn)物。
ArduBlock

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ArduBlock軟件是Arduino官方編程環(huán)境的第三方軟件，目前必須依附于Arduino軟件下運行，區(qū)別于Arduino文本式編程環(huán)境，ArduBlock是以圖形化積木搭建的方式編程的，這樣的方式會使編程的可視化和交互性加強，編程門檻降低，即使沒有編程經(jīng)驗的人也可以嘗試給Arduino控制器編寫程序。
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FPGA開發(fā)板在基于MCU、定制ASIC和體積龐大的電線束來實現(xiàn)引擎及控制電子的系統(tǒng)方案已發(fā)展至接近其技術(shù)和應(yīng)用極限，汽車工業(yè)正面臨新的設(shè)計挑戰(zhàn)。過去汽車電子產(chǎn)品的開發(fā)周期是漫長的，而許多汽車制造商現(xiàn)正致力于在更短的時間內(nèi)，裝備消費者所需的新一代汽車。
PCB封裝

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pcb封裝就是把實際的電子元器件，芯片等的各種參數(shù)（比如元器件的大小，長寬，直插，貼片，焊盤的大小，管腳的長寬，管腳的間距等）用圖形方式表現(xiàn)出來，以便可以在畫pcb圖時進行調(diào)用。
QUARTUS II

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Quartus II 是Altera公司推出的綜合性CPLD/FPGA開發(fā)軟件，軟件支持原理圖、VHDL、VerilogHDL以及AHDL（Altera Hardware 支持Description Language）等多種設(shè)計輸入形式，內(nèi)嵌自有的綜合器以及仿真器，可以完成從設(shè)計輸入到硬件配置的完整PLD設(shè)計流程。
語音交互

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PCB封裝庫

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　　Artix-7 系列：相對于 Spartan-6 系列而言，Artix-7 系列功耗降低了一半，成本降低了 35%，采用小型化封裝、統(tǒng)一的 Virtex 系列架構(gòu)，能滿足低成本大批量市場的性能要求，這也正是此前 ASSP、ASIC 和低成本 FPGA 所針對的市場領(lǐng)域。
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面包板是由于板子上有很多小插孔，專為電子電路的無焊接實驗設(shè)計制造的。由于各種電子元器件可根據(jù)需要隨意插入或拔出，免去了焊接，節(jié)省了電路的組裝時間，而且元件可以重復(fù)使用，所以非常適合電子電路的組裝、調(diào)試和訓(xùn)練。
candence

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AXI

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AXI是一種總線協(xié)議，該協(xié)議是ARM公司提出的AMBA3.0協(xié)議中最重要的部分，是一種面向高性能、高帶寬、低延遲的片內(nèi)總線。它的地址/控制和數(shù)據(jù)相位是分離的，支持不對齊的數(shù)據(jù)傳輸，同時在突發(fā)傳輸中，只需要首地址，同時分離的讀寫數(shù)據(jù)通道、并支持Outstanding傳輸訪問和亂序訪問，并更加容易進行時序收斂。AXI是AMBA中一個新的高性能協(xié)議。
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特性阻抗又稱特征阻抗，它不是直流電阻，屬于長線傳輸中的概念。特性阻抗是射頻傳輸線影響無線電波電壓、電流的幅值和相位變化的固有特性，等于各處的電壓與電流的比值，用V/I表示。在射頻電路中，電阻、電容、電感都會阻礙交變電流的流動，合稱阻抗。電阻是吸收電磁能量的，理想電容和電感不消耗電磁能量。
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時鐘源用來為環(huán)形脈沖發(fā)生器提供頻率穩(wěn)定且電平匹配的方波時鐘脈沖信號。它通常由石英晶體振蕩器和與非門組成的正反饋振蕩電路組成，其輸出送至環(huán)形脈沖發(fā)生器。
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　　AD轉(zhuǎn)換采樣頻率指完成一次從模擬轉(zhuǎn)換到數(shù)字的AD轉(zhuǎn)換所需時間的倒數(shù)，模擬量可以是電壓、電流等電信號，也可以是壓力、溫度、濕度、位移、聲音等非電信號；而AD分辨率指數(shù)字量變化一個最小量時模擬信號的變化量。
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　　Kintex-7系列：Kintex-7 系列是一種新型 FPGA，能以不到 Virtex-6 系列一半的價格實現(xiàn)與其相當(dāng)性能，性價比提高了一倍，功耗降低了一半。
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紅外觸摸屏

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