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ASIC是Application Specific Integrated Circuit的英文縮寫，在集成電路界被認(rèn)為是一種為專門目的而設(shè)計(jì)的集成電路。ASIC也是Australian Securities and Investment Commission的英文縮寫，即澳大利亞證券和投資委員會(huì)，它是澳大利亞金融服務(wù)和市場(chǎng)的法定監(jiān)管機(jī)構(gòu)。

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礦機(jī)廠商并未放棄市場(chǎng)，區(qū)塊鏈ASIC即將迎來產(chǎn)品交替期

熟悉半導(dǎo)體廠商指出，事實(shí)上，區(qū)塊鏈ASIC急單確實(shí)貢獻(xiàn)了晶圓代工、后段封測(cè)以及設(shè)計(jì)服務(wù)等廠商2018年上半業(yè)績(jī)表現(xiàn)，如臺(tái)積電、創(chuàng)意、中華精測(cè)、硅格、日月...

2018-09-27 標(biāo)簽：ASIC 區(qū)塊鏈 3.5k 0

賽靈思推出ZynqRFSoC DFE,四大特點(diǎn)滿足5G復(fù)雜需求

為了滿足不斷演進(jìn)的5G NR無線應(yīng)用標(biāo)準(zhǔn)和5G多樣化的需求，賽靈思推出 ZynqRFSoC DFE。

2020-11-17 標(biāo)簽：fpga asic 賽靈思 3.5k 0

FPGA開發(fā)流程：詳解每一環(huán)節(jié)的物理含義和實(shí)現(xiàn)目標(biāo)

FPGA的開發(fā)流程是遵循著ASIC的開發(fā)流程發(fā)展的，發(fā)展到目前為止，F(xiàn)PGA的開發(fā)流程總體按照?qǐng)D1進(jìn)行，有些步驟可能由于其在當(dāng)前項(xiàng)目中的條件的寬度的允許...

2023-01-10 標(biāo)簽：fpga asic eda 3.5k 0

海量流媒體數(shù)據(jù)需要編碼、轉(zhuǎn)碼,ASIC將扮演越來越重要的角色

摩爾定律落幕，云平臺(tái)興起，5G帶動(dòng)將讓互聯(lián)網(wǎng)上流轉(zhuǎn)更多高清視頻，邊緣計(jì)算也成為海量數(shù)據(jù)下的必然產(chǎn)物。

2019-04-11 標(biāo)簽：asic 流媒體 3.5k 0

P4和P4運(yùn)行時(shí)：SDN可編程性的新視野

在軟件化時(shí)代，SDN正在展開其邊界，各行各業(yè)正專注于將網(wǎng)絡(luò)控制置于金字塔頂端 - 從復(fù)雜的硬件到軟件應(yīng)用程序。P4已經(jīng)通過提供低至ASIC的網(wǎng)絡(luò)可編程性...

2022-12-08 標(biāo)簽：控制器 asic 交換機(jī) 3.5k 0

全球首個(gè)7nm芯片的推出引爭(zhēng)議，中國(guó)芯片的成長(zhǎng)需要的不是“數(shù)字游戲”

一家做比特幣礦機(jī)及礦機(jī)芯片的廠商嘉楠耘智對(duì)外宣稱全球首個(gè)7nm芯片進(jìn)入量產(chǎn)階段。按照其官方的說法，該芯片擁有業(yè)內(nèi)最高的算力密度、更低的成本和更大的產(chǎn)能、...

2018-08-14 標(biāo)簽：芯片 asic 3.4k 0

AI芯片成為耗電大戶，負(fù)載功耗接近一個(gè)小國(guó)家？

如今，對(duì)人工智能的需求巨大。法國(guó)施耐德電氣公司估計(jì)，2023年人工智能工作負(fù)載的功耗總計(jì)約為4.3吉瓦（GW），略低于塞浦路斯國(guó)家2021年的功耗（ 4...

2023-11-25 標(biāo)簽：asic SSD 人工智能 3.4k 0

怎么才能寫出高覆蓋率的Verilog代碼？

芯片前端工程中，測(cè)試驗(yàn)證的核心理念：以提高覆蓋率為核心。設(shè)計(jì)工程師需要關(guān)心的主要有行覆蓋率（Block），條件覆蓋率（Expression），翻轉(zhuǎn)覆蓋率...

2021-06-01 標(biāo)簽：芯片 asic 鎖存器 3.4k 0

FPGA在加速AI算法上的獨(dú)特優(yōu)勢(shì)

電子發(fā)燒友網(wǎng)報(bào)道(文/李彎彎)當(dāng)前許多行業(yè)都采用人工智能來解決棘手問題，包括工業(yè)制造領(lǐng)域，隨著工業(yè)4.0在2010年代早期進(jìn)一步演進(jìn)，AI在制造環(huán)境中的...

2022-02-28 標(biāo)簽：fpga 芯片 asic 3.4k 0

徐文偉正式宣布退休，曾主導(dǎo)華為芯片研發(fā)

華為內(nèi)部尊稱徐文偉為大徐總（IT之家備注：“小徐總”為徐直軍，現(xiàn)任華為投資控股有限公司副董事長(zhǎng)、輪值董事長(zhǎng)職位），他帶領(lǐng)團(tuán)隊(duì)完成了華為第一代 C&...

2024-03-25 標(biāo)簽：芯片 asic 華為 3.4k 0

FPGA芯片的未來發(fā)展趨勢(shì)會(huì)是怎樣的

隨著智能化市場(chǎng)需求變化越來越快，定制芯片 (SoC asic) 項(xiàng)目巨減趨勢(shì)已不可逆。采用ASIC方案的投資量大幅增加，周期長(zhǎng), 市場(chǎng)風(fēng)險(xiǎn)大幅加大。

2019-09-06 標(biāo)簽：fpga asic 3.4k 0

ASIC設(shè)計(jì)學(xué)習(xí)工具盤點(diǎn)

RTL代碼規(guī)則檢查工具：nlint，spyglass。這兩個(gè)軟件主要是用于檢查代碼的語法和語義錯(cuò)誤的，并且比其他的工具能檢測(cè)出更多的問題，比如說命名規(guī)格...

2020-06-04 標(biāo)簽：asic 3.4k 0

SystemVerilog如何進(jìn)行有效的功能驗(yàn)證

驗(yàn)證是一個(gè)覆蓋面比較廣的課題，主要包括功能驗(yàn)證、物理驗(yàn)證、時(shí)序驗(yàn)證等。我們常常涉及功能驗(yàn)證，以確保設(shè)計(jì)能夠按照設(shè)計(jì)規(guī)范實(shí)現(xiàn)應(yīng)有功能。為了完成功能驗(yàn)證，我...

2022-08-05 標(biāo)簽：fpga asic 集成芯片 3.4k 0

智原推出LPDDR4/4X PHY，基于三星14LPC FinFET工藝

臺(tái)灣新竹2021年6月29日電 – ASIC設(shè)計(jì)服務(wù)暨IP研發(fā)銷售廠商智原科技（Faraday Technology Corporation，TWSE：...

2021-06-30 標(biāo)簽：asic 多媒體三星 3.3k 0

臺(tái)積電最新5納米應(yīng)用，首批客戶是它們

據(jù)中時(shí)電子報(bào)報(bào)道，比特大陸(Bitmain)和嘉楠耘智(Canaan)這兩家專門開發(fā)應(yīng)用于挖掘加密貨幣的特殊應(yīng)用集成電路（ASIC）的廠商，將成為臺(tái)積電...

2019-12-31 標(biāo)簽：asic 臺(tái)積電 3.3k 0

中國(guó)FPGA產(chǎn)業(yè)，如何在市場(chǎng)上占有一席之地

2008年以來的金融危機(jī)使得半導(dǎo)體行業(yè)平均跌幅大于10%，但是市場(chǎng)數(shù)據(jù)卻顯示FPGA行業(yè)依然強(qiáng)勁增長(zhǎng)。危機(jī)和低迷使ASIC和ASSP制造者為謹(jǐn)慎起見，不...

2012-09-17 標(biāo)簽：FPGA ASIC Xilinx 3.3k 0

國(guó)產(chǎn)化陀螺儀芯片生產(chǎn)商芯動(dòng)聯(lián)科登錄科創(chuàng)板

國(guó)產(chǎn)化陀螺儀芯片生產(chǎn)商芯動(dòng)聯(lián)科登錄科創(chuàng)板安徽芯動(dòng)聯(lián)科微系統(tǒng)股份有限公司簡(jiǎn)稱芯動(dòng)聯(lián)科主營(yíng)業(yè)務(wù)為高性能硅基MEMS慣性傳感器的研發(fā)、測(cè)試與銷售。芯動(dòng)聯(lián)科的...

2023-06-19 標(biāo)簽：asic mems 陀螺儀 3.3k 0

7納米挖礦運(yùn)算ASIC需求將在第四季大增，對(duì)臺(tái)積電第四季營(yíng)運(yùn)而言將是旺上加旺

晶圓代工龍頭臺(tái)積電在日前法人說明會(huì)中，二度下修對(duì)全球晶圓代工市場(chǎng)年成長(zhǎng)率至7%，并下調(diào)全年美元營(yíng)收成長(zhǎng)率至高個(gè)位數(shù)百分比（7～9%），主要是受到加密貨幣...

2018-08-09 標(biāo)簽：asic 臺(tái)積電比特幣 3.3k 0

安森美引發(fā)標(biāo)準(zhǔn)化設(shè)計(jì)潮流力拓消費(fèi)醫(yī)療設(shè)備市場(chǎng)

更高集成度、小型化、高能效、嵌入無線功能的醫(yī)療設(shè)備深受市場(chǎng)歡迎，安森美半導(dǎo)體公司消費(fèi)者健康產(chǎn)品線高級(jí)經(jīng)理Jakob Nielsen為我們闡述安森美如何應(yīng)...

2013-10-23 標(biāo)簽：ASIC 助聽器安森美 3.3k 2

5G與ASIC推動(dòng) 聯(lián)發(fā)科營(yíng)收連續(xù)增長(zhǎng)，高通卻在下滑

從產(chǎn)業(yè)鏈方面人士透露的消息來看，聯(lián)發(fā)科預(yù)計(jì)季度營(yíng)收連續(xù)增長(zhǎng)，是得益于5G芯片和其他專用集成電路（ASIC）產(chǎn)品的推動(dòng)。

2020-07-28 標(biāo)簽：asic 5G 3.3k 0

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Protues

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Proteus軟件是英國(guó)Lab Center Electronics公司出版的EDA工具軟件（該軟件中國(guó)總代理為廣州風(fēng)標(biāo)電子技術(shù)有限公司）。它不僅具有其它EDA工具軟件的仿真功能，還能仿真單片機(jī)及外圍器件。
靜電防護(hù)

靜電防護(hù)

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為防止靜電積累所引起的人身電擊、火災(zāi)和爆炸、電子器件失效和損壞，以及對(duì)生產(chǎn)的不良影響而采取的防范措施。其防范原則主要是抑制靜電的產(chǎn)生，加速靜電泄漏，進(jìn)行靜電中和等。
Altium Designer

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FPGA芯片

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FPGA（Field－Programmable Gate Array），即現(xiàn)場(chǎng)可編程門陣列，它是在PAL、GAL、CPLD等可編程器件的基礎(chǔ)上進(jìn)一步發(fā)展的產(chǎn)物。
ArduBlock

ArduBlock

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ArduBlock軟件是Arduino官方編程環(huán)境的第三方軟件，目前必須依附于Arduino軟件下運(yùn)行，區(qū)別于Arduino文本式編程環(huán)境，ArduBlock是以圖形化積木搭建的方式編程的，這樣的方式會(huì)使編程的可視化和交互性加強(qiáng)，編程門檻降低，即使沒有編程經(jīng)驗(yàn)的人也可以嘗試給Arduino控制器編寫程序。
AD10

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識(shí)別

識(shí)別

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FPGA開發(fā)板

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FPGA開發(fā)板在基于MCU、定制ASIC和體積龐大的電線束來實(shí)現(xiàn)引擎及控制電子的系統(tǒng)方案已發(fā)展至接近其技術(shù)和應(yīng)用極限，汽車工業(yè)正面臨新的設(shè)計(jì)挑戰(zhàn)。過去汽車電子產(chǎn)品的開發(fā)周期是漫長(zhǎng)的，而許多汽車制造商現(xiàn)正致力于在更短的時(shí)間內(nèi)，裝備消費(fèi)者所需的新一代汽車。
PCB封裝

PCB封裝

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pcb封裝就是把實(shí)際的電子元器件，芯片等的各種參數(shù)（比如元器件的大小，長(zhǎng)寬，直插，貼片，焊盤的大小，管腳的長(zhǎng)寬，管腳的間距等）用圖形方式表現(xiàn)出來，以便可以在畫pcb圖時(shí)進(jìn)行調(diào)用。
QUARTUS II

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Quartus II 是Altera公司推出的綜合性CPLD/FPGA開發(fā)軟件，軟件支持原理圖、VHDL、VerilogHDL以及AHDL（Altera Hardware 支持Description Language）等多種設(shè)計(jì)輸入形式，內(nèi)嵌自有的綜合器以及仿真器，可以完成從設(shè)計(jì)輸入到硬件配置的完整PLD設(shè)計(jì)流程。
語音交互

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PCB封裝庫

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AD09

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PDN

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QuickPcb

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Artix-7

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　　Artix-7 系列：相對(duì)于 Spartan-6 系列而言，Artix-7 系列功耗降低了一半，成本降低了 35%，采用小型化封裝、統(tǒng)一的 Virtex 系列架構(gòu)，能滿足低成本大批量市場(chǎng)的性能要求，這也正是此前 ASSP、ASIC 和低成本 FPGA 所針對(duì)的市場(chǎng)領(lǐng)域。
VHDL代碼

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powerlink

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Protel 99 se

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面包板

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面包板是由于板子上有很多小插孔，專為電子電路的無焊接實(shí)驗(yàn)設(shè)計(jì)制造的。由于各種電子元器件可根據(jù)需要隨意插入或拔出，免去了焊接，節(jié)省了電路的組裝時(shí)間，而且元件可以重復(fù)使用，所以非常適合電子電路的組裝、調(diào)試和訓(xùn)練。
candence

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AXI

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AXI是一種總線協(xié)議，該協(xié)議是ARM公司提出的AMBA3.0協(xié)議中最重要的部分，是一種面向高性能、高帶寬、低延遲的片內(nèi)總線。它的地址/控制和數(shù)據(jù)相位是分離的，支持不對(duì)齊的數(shù)據(jù)傳輸，同時(shí)在突發(fā)傳輸中，只需要首地址，同時(shí)分離的讀寫數(shù)據(jù)通道、并支持Outstanding傳輸訪問和亂序訪問，并更加容易進(jìn)行時(shí)序收斂。AXI是AMBA中一個(gè)新的高性能協(xié)議。
特性阻抗

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特性阻抗又稱特征阻抗，它不是直流電阻，屬于長(zhǎng)線傳輸中的概念。特性阻抗是射頻傳輸線影響無線電波電壓、電流的幅值和相位變化的固有特性，等于各處的電壓與電流的比值，用V/I表示。在射頻電路中，電阻、電容、電感都會(huì)阻礙交變電流的流動(dòng)，合稱阻抗。電阻是吸收電磁能量的，理想電容和電感不消耗電磁能量。
時(shí)鐘源

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時(shí)鐘源用來為環(huán)形脈沖發(fā)生器提供頻率穩(wěn)定且電平匹配的方波時(shí)鐘脈沖信號(hào)。它通常由石英晶體振蕩器和與非門組成的正反饋振蕩電路組成，其輸出送至環(huán)形脈沖發(fā)生器。
AD采樣

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　　AD轉(zhuǎn)換采樣頻率指完成一次從模擬轉(zhuǎn)換到數(shù)字的AD轉(zhuǎn)換所需時(shí)間的倒數(shù)，模擬量可以是電壓、電流等電信號(hào)，也可以是壓力、溫度、濕度、位移、聲音等非電信號(hào)；而AD分辨率指數(shù)字量變化一個(gè)最小量時(shí)模擬信號(hào)的變化量。
驅(qū)動(dòng)電流

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Kintex-7

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　　Kintex-7系列：Kintex-7 系列是一種新型 FPGA，能以不到 Virtex-6 系列一半的價(jià)格實(shí)現(xiàn)與其相當(dāng)性能，性價(jià)比提高了一倍，功耗降低了一半。
Protel DXP

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FPGA教程

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紅外觸摸屏

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