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標(biāo)簽 > cpld
CPLD(Complex Programmable Logic Device)復(fù)雜可編程邏輯器件,是從PAL和GAL器件發(fā)展出來(lái)的器件,相對(duì)而言規(guī)模大,結(jié)構(gòu)復(fù)雜,屬于大規(guī)模集成電路范圍。是一種用戶(hù)根據(jù)各自需要而自行構(gòu)造邏輯功能的數(shù)字集成電路。其基本設(shè)計(jì)方法是借助集成開(kāi)發(fā)軟件平臺(tái),用原理圖、硬件描述語(yǔ)言等方法,生成相應(yīng)的目標(biāo)文件,通過(guò)下載電纜(“在系統(tǒng)”編程)將代碼傳送到目標(biāo)芯片中,實(shí)現(xiàn)設(shè)計(jì)的數(shù)字系統(tǒng)。
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電子發(fā)燒友網(wǎng)核心提示 :隨著電子設(shè)計(jì)自動(dòng)化(EDA)技術(shù)的發(fā)展,可編程邏輯器件FPGA/CPLD已經(jīng)在許多方面得到了廣泛應(yīng)用,而UART(通用異步收發(fā)器...
BJ-EPM CPLD開(kāi)發(fā)板:VHDL入門(mén)例程3
該程序?qū)崿F(xiàn)功能:三個(gè)獨(dú)立按鍵控制四個(gè)LED流水燈工作/停止或者左移/右移
通過(guò)C8051F021單片機(jī)和CPLD器件實(shí)現(xiàn)全自動(dòng)對(duì)接焊控制系統(tǒng)的設(shè)計(jì)
全自動(dòng)對(duì)接焊控制系統(tǒng)是在國(guó)產(chǎn)電子式交流(50Hz)自動(dòng)對(duì)焊機(jī)基礎(chǔ)上進(jìn)行研制的,主要由智能控制箱、小型焊接機(jī)頭和逆變弧焊電源三部分構(gòu)成。本系統(tǒng)將原分立元件...
CPLD和16C554在航空發(fā)動(dòng)機(jī)參數(shù)采集器中的應(yīng)用
CPLD和16C554在航空發(fā)動(dòng)機(jī)參數(shù)采集器中的應(yīng)用,利用新的Top-Down設(shè)計(jì)方法,使得系統(tǒng)的設(shè)計(jì)從一開(kāi)始就能夠在系統(tǒng)級(jí)的行為描述上得到驗(yàn)證,有效避...
2012-01-28 標(biāo)簽:發(fā)動(dòng)機(jī)CPLD16C554 5.2k 0
淺談關(guān)于CPLD的多路可控脈沖發(fā)生器設(shè)計(jì)
針對(duì)伺服電機(jī)控制系統(tǒng)中的脈沖發(fā)送需求問(wèn)題,提出了一種利用DDS技術(shù),以單片機(jī)和CPLD為硬件基礎(chǔ)的脈沖輸出頻率、
BJ-EPM CPLD開(kāi)發(fā)板:VHDL入門(mén)例程2
程序?qū)崿F(xiàn)功能:三個(gè)獨(dú)立按鍵控制LED燈亮滅
BJ-EPM CPLD開(kāi)發(fā)板:VHDL入門(mén)例程5
該程序?qū)崿F(xiàn)功能:16位無(wú)符號(hào)數(shù)的乘法運(yùn)算
基于CPLD/FPGA的VHDL語(yǔ)言電路優(yōu)化設(shè)計(jì)
VHDL(Very High Speed Integrated CIRCUITHARDWARE DESCRIPTION Language)是IEEE工業(yè)...
CPLD開(kāi)發(fā)板實(shí)驗(yàn)板,支持EPM240,集成USB轉(zhuǎn)UART芯片CH340G
一 產(chǎn)品簡(jiǎn)介:1、CPLD開(kāi)發(fā)板實(shí)驗(yàn)板,支持EPM240,集成USB轉(zhuǎn)UART芯片CH340G 2、串口輸出控制模塊,支持64路TTL電平輸出 3、串口...
什么叫可編程邏輯器件 可編程邏輯器件有哪些特征和優(yōu)勢(shì)?
可編程邏輯器件(Programmable Logic Device,PLD)是一類(lèi)集成電路器件,可以根據(jù)用戶(hù)的需求進(jìn)行編程和配置,以實(shí)現(xiàn)特定的邏輯功能。...
OI53131A高精度通用計(jì)數(shù)器的功能特點(diǎn)及應(yīng)用范圍
OI53131A型高精度通用計(jì)數(shù)器是一款高精度測(cè)頻測(cè)時(shí)儀器。它測(cè)頻分頻率達(dá)到10位/秒,測(cè)時(shí)單次分辨達(dá)到100ps,機(jī)內(nèi)采用高性能單片機(jī)進(jìn)行控制。整機(jī)方...
FPGA和CPLD的靈活性和低開(kāi)銷(xiāo)串行總線相結(jié)合,能為系統(tǒng)設(shè)計(jì)師提供了大量的系統(tǒng)控制功能,同時(shí)最大限度地減少所需的電路板面積。
FPGA/CPLD能完成任何數(shù)字器件的功能,上至高性能CPU,下至簡(jiǎn)單的74電路,都可以用FPGA/CPLD來(lái)實(shí)現(xiàn)。
什么是CPLD CPLD(Complex Programmable Logic Device)是Complex PLD的簡(jiǎn)稱(chēng),一種較PLD為復(fù)雜的邏輯...
2009-03-30 標(biāo)簽:CPLD 4.2k 0
本系統(tǒng)采用的CPLD為 ATMEL公司生產(chǎn)的ATF1540AS器件,該器件是一種高性能、高密度復(fù)合可編程邏輯器件,簡(jiǎn)稱(chēng)CPLD,本系統(tǒng)主要應(yīng)用于雙CPU...
EDA技術(shù)基礎(chǔ)知識(shí)及數(shù)字系統(tǒng)設(shè)計(jì)實(shí)例
本文著重介紹EDA技術(shù)的發(fā)展、EDA技術(shù)的基本特征及使用EDA技術(shù)的數(shù)字系統(tǒng)設(shè)計(jì)實(shí)例分析
基于FPGA/CPLD設(shè)計(jì)中使用的狀態(tài)機(jī)穩(wěn)定性問(wèn)題解決的方案
在FPGA/CPLD設(shè)計(jì)中頻繁使用的狀態(tài)機(jī),常出現(xiàn)一些穩(wěn)定性問(wèn)題,本文提出了一些解決方法,實(shí)驗(yàn)表明該方法有效地提高了綜合效率. 隨著大規(guī)模和超大規(guī)模FP...
2017-11-24 標(biāo)簽:fpgacpld狀態(tài)機(jī) 4k 0
基于CPLD的ST-BUS總線收發(fā)模塊設(shè)計(jì)
文中所述模塊的電路設(shè)計(jì)采用了先進(jìn)的可編程器件來(lái)實(shí)現(xiàn),便于多種接口的混合接入。鑒于接口種類(lèi)及標(biāo)準(zhǔn)繁多,文中主要討論外部接口與ST-BUS總線通信所需公共模...
基于CoolRunner CPLD的MP3應(yīng)用開(kāi)發(fā)板的設(shè)計(jì)
本文介紹了基于CoolRunner CPLD的MP3應(yīng)用開(kāi)發(fā)板的設(shè)計(jì)流程,驗(yàn)證了利用現(xiàn)有IP Core設(shè)計(jì)的可行性和高效性。在設(shè)計(jì)過(guò)程中,硬件(實(shí)驗(yàn)評(píng)估...
2011-08-18 標(biāo)簽:CPLDMP3開(kāi)發(fā)板 3.9k 0
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