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      標(biāo)簽　>　python

      python

      python

      +關(guān)注57人關(guān)注

      Python由荷蘭數(shù)學(xué)和計(jì)算機(jī)科學(xué)研究學(xué)會(huì)的吉多·范羅蘇姆于1990年代初設(shè)計(jì)，作為一門(mén)叫做ABC語(yǔ)言的替代品。 Python提供了高效的高級(jí)數(shù)據(jù)結(jié)構(gòu)，還能簡(jiǎn)單有效地面向?qū)ο缶幊獭?/p>

      文章：3396個(gè) 瀏覽：90077次 帖子：1504個(gè)

      python資訊

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      2019-08-08 標(biāo)簽：Python卷積神經(jīng)網(wǎng)絡(luò) 8.6k 0

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      2017-11-16 標(biāo)簽：python 8.6k 0

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      2020-11-13 標(biāo)簽：人工智能C++python 8.4k 0

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      2022-06-22 標(biāo)簽：模塊日志python 8.4k 0

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      2019-11-04 標(biāo)簽：HTMLpython 8.4k 0

      用Python編寫(xiě)人工智能

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      決策樹(shù)是聽(tīng)上去比較厲害且又相對(duì)簡(jiǎn)單的算法，但在實(shí)現(xiàn)它的過(guò)程中可能會(huì)對(duì)編程本身有更深的理解、尤其是對(duì)遞歸的利用。

      2017-12-22 標(biāo)簽：人工智能python 8.4k 0

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      2020-09-03 標(biāo)簽：C語(yǔ)言編程語(yǔ)言python 8.4k 0

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      讓我們快速回顧一下第一篇文章中涉及的內(nèi)容。我們討論了PyTorch和張量的基礎(chǔ)知識(shí)，還討論了PyTorch與NumPy的相似之處。

      2020-05-05 標(biāo)簽：pythonpytorch 8.3k 0

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      2019-02-20 標(biāo)簽：python開(kāi)發(fā)工程師 8.2k 0

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      2020-02-05 標(biāo)簽：Excelpython 8.1k 0

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      python布爾值 1. 什么是布爾值 但在Python語(yǔ)言中，布爾類(lèi)型只有兩個(gè)值 True ：表示真值 False ：表示假值 請(qǐng)注意，首字母要大寫(xiě)，...

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      2019-07-31 標(biāo)簽：接收器python串行端口 7.9k 0

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      現(xiàn)介紹另一種通過(guò)Python實(shí)現(xiàn)PLC數(shù)據(jù)可視化呈現(xiàn)于Web端的方案。

      2020-08-30 標(biāo)簽：plcWebpython 7.9k 0

      NVIDIA推出適用于Python的VPF,簡(jiǎn)化開(kāi)發(fā)GPU加速視頻編碼/解碼

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        Proteus軟件是英國(guó)Lab Center Electronics公司出版的EDA工具軟件（該軟件中國(guó)總代理為廣州風(fēng)標(biāo)電子技術(shù)有限公司）。它不僅具有其它EDA工具軟件的仿真功能，還能仿真單片機(jī)及外圍器件。
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        為防止靜電積累所引起的人身電擊、火災(zāi)和爆炸、電子器件失效和損壞，以及對(duì)生產(chǎn)的不良影響而采取的防范措施。其防范原則主要是抑制靜電的產(chǎn)生，加速靜電泄漏，進(jìn)行靜電中和等。
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      • FPGA芯片
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        FPGA（Field－Programmable Gate Array），即現(xiàn)場(chǎng)可編程門(mén)陣列，它是在PAL、GAL、CPLD等可編程器件的基礎(chǔ)上進(jìn)一步發(fā)展的產(chǎn)物。
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        ArduBlock軟件是Arduino官方編程環(huán)境的第三方軟件，目前必須依附于Arduino軟件下運(yùn)行，區(qū)別于Arduino文本式編程環(huán)境，ArduBlock是以圖形化積木搭建的方式編程的，這樣的方式會(huì)使編程的可視化和交互性加強(qiáng)，編程門(mén)檻降低，即使沒(méi)有編程經(jīng)驗(yàn)的人也可以嘗試給Arduino控制器編寫(xiě)程序。
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        Quartus II 是Altera公司推出的綜合性CPLD/FPGA開(kāi)發(fā)軟件，軟件支持原理圖、VHDL、VerilogHDL以及AHDL（Altera Hardware 支持Description Language）等多種設(shè)計(jì)輸入形式，內(nèi)嵌自有的綜合器以及仿真器，可以完成從設(shè)計(jì)輸入到硬件配置的完整PLD設(shè)計(jì)流程。
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        　　Artix-7 系列：相對(duì)于 Spartan-6 系列而言，Artix-7 系列功耗降低了一半， 成本降低了 35%，采用小型化封裝、統(tǒng)一的 Virtex 系列架構(gòu)，能滿(mǎn)足低成本大批量市場(chǎng)的性能要求，這也正是此前 ASSP、ASIC 和低成本 FPGA 所針對(duì)的市場(chǎng)領(lǐng)域。
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      • 面包板
        面包板
        +關(guān)注
        面包板是由于板子上有很多小插孔，專(zhuān)為電子電路的無(wú)焊接實(shí)驗(yàn)設(shè)計(jì)制造的。由于各種電子元器件可根據(jù)需要隨意插入或拔出，免去了焊接，節(jié)省了電路的組裝時(shí)間，而且元件可以重復(fù)使用，所以非常適合電子電路的組裝、調(diào)試和訓(xùn)練。
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        AXI
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        AXI是一種總線(xiàn)協(xié)議，該協(xié)議是ARM公司提出的AMBA3.0協(xié)議中最重要的部分，是一種面向高性能、高帶寬、低延遲的片內(nèi)總線(xiàn)。它的地址/控制和數(shù)據(jù)相位是分離的，支持不對(duì)齊的數(shù)據(jù)傳輸，同時(shí)在突發(fā)傳輸中，只需要首地址，同時(shí)分離的讀寫(xiě)數(shù)據(jù)通道、并支持Outstanding傳輸訪(fǎng)問(wèn)和亂序訪(fǎng)問(wèn)，并更加容易進(jìn)行時(shí)序收斂。AXI是AMBA中一個(gè)新的高性能協(xié)議。
      • 特性阻抗
        特性阻抗
        +關(guān)注
        特性阻抗又稱(chēng)特征阻抗，它不是直流電阻，屬于長(zhǎng)線(xiàn)傳輸中的概念。特性阻抗是射頻傳輸線(xiàn)影響無(wú)線(xiàn)電波電壓、電流的幅值和相位變化的固有特性，等于各處的電壓與電流的比值，用V/I表示。在射頻電路中，電阻、電容、電感都會(huì)阻礙交變電流的流動(dòng)，合稱(chēng)阻抗。電阻是吸收電磁能量的，理想電容和電感不消耗電磁能量。
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        時(shí)鐘源
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        　　Kintex-7系列：Kintex-7 系列是一種新型 FPGA，能以不到 Virtex-6 系列一半的價(jià)格實(shí)現(xiàn)與其相當(dāng)性能，性?xún)r(jià)比提高了一倍，功耗降低了一半。
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