verilog

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Verilog HDL是一種硬件描述語(yǔ)言（HDL:Hardware Description Language），以文本形式來(lái)描述數(shù)字系統(tǒng)硬件的結(jié)構(gòu)和行為的語(yǔ)言，用它可以表示邏輯電路圖、邏輯表達(dá)式，還可以表示數(shù)字邏輯系統(tǒng)所完成的邏輯功能。

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verilog技術(shù)

Verilog HDL語(yǔ)法學(xué)習(xí)筆記

Verilog HDL 語(yǔ) 言最初是作為 Gateway Design Automation 公司（ Gateway DesignAutom...

2026-03-04 標(biāo)簽：仿真器 Verilog HDL 5.3k 0

FPGA 入門(mén)必看：Verilog 與 VHDL 編程基礎(chǔ)解析！

很多開(kāi)發(fā)者第一次接觸FPGA，都會(huì)有同樣的疑問(wèn)：FPGA是硬件，不是軟件，怎么寫(xiě)程序？答案就是用硬件描述語(yǔ)言（HDL），最常用的就是Verilog和VH...

2026-01-19 標(biāo)簽：FPGA Verilog vhdl 475 0

基于FPGA的I2C控制模塊設(shè)計(jì)

I2C_WRITE_WDATA.v模塊實(shí)現(xiàn)I2C寫(xiě)時(shí)序，I2C_Controller (I2C控制器)例化了I2C_WRITE_WDATA.v模塊，同時(shí)...

2025-12-26 標(biāo)簽：FPGA 寄存器 Verilog 5.1k 0

FPGA仿真如何極致壓榨CPU性能

對(duì)于許多FPGA/IC工程師而言，設(shè)計(jì)實(shí)現(xiàn)游刃有余，驗(yàn)證仿真卻常成短板——傳統(tǒng)驗(yàn)證方法面臨兩難困局：學(xué)習(xí)UVM需投入大量時(shí)間成本，而純Verilog自仿...

2025-12-19 標(biāo)簽：FPGA cpu 仿真 4.7k 0

如何使用FPGA實(shí)現(xiàn)SRIO通信協(xié)議

本例程詳細(xì)介紹了如何在FPGA上實(shí)現(xiàn)Serial RapidIO（SRIO）通信協(xié)議，并通過(guò)Verilog語(yǔ)言進(jìn)行編程設(shè)計(jì)。SRIO作為一種高速、低延遲...

2025-11-12 標(biāo)簽：FPGA 通信協(xié)議 Verilog 5.8k 0

如何利用Verilog HDL在FPGA上實(shí)現(xiàn)SRAM的讀寫(xiě)測(cè)試

本篇將詳細(xì)介紹如何利用Verilog HDL在FPGA上實(shí)現(xiàn)SRAM的讀寫(xiě)測(cè)試。SRAM是一種非易失性存儲(chǔ)器，具有高速讀取和寫(xiě)入的特點(diǎn)。在FPGA中實(shí)現(xiàn)...

2025-10-22 標(biāo)簽：FPGA 存儲(chǔ)器 sram 4.4k 0

基于FPGA和LTC2308模數(shù)轉(zhuǎn)換芯片的數(shù)字電壓表設(shè)計(jì)

通過(guò)FPGA對(duì)模數(shù)轉(zhuǎn)換芯片（LTC2308）的采樣控制，實(shí)現(xiàn)一個(gè)簡(jiǎn)易的數(shù)字電壓表。

2025-08-16 標(biāo)簽：FPGA Verilog 數(shù)字電壓表 5.6k 0

RTL級(jí)機(jī)器人電機(jī)控制器的FPGA設(shè)計(jì)

借助Verilog，在FPGA中實(shí)現(xiàn)了帶編碼器的兩臺(tái)電機(jī)的電機(jī)控制系統(tǒng)的RTL級(jí)設(shè)計(jì)。

2025-07-07 標(biāo)簽：FPGA 機(jī)器人 Verilog 2.9k 0

基于FPGA的DVP接口實(shí)現(xiàn)

DVP接口（Digital Video Port）是一種用于數(shù)字視頻傳輸?shù)牟⑿薪涌冢Ｒ?jiàn)于嵌入式系統(tǒng)和圖像傳感器中。DVP直接傳輸數(shù)字視頻信號(hào)，減少模數(shù)...

2025-06-04 標(biāo)簽：FPGA 接口圖像傳感器 2.1k 0

SVA斷言的用法教程

SVA是System Verilog Assertion的縮寫(xiě)，即用SV語(yǔ)言來(lái)描述斷言。斷言是對(duì)設(shè)計(jì)的屬性的描述，用以檢查設(shè)計(jì)是否按照預(yù)期執(zhí)行。

2025-05-15 標(biāo)簽：模塊 Verilog System 3.4k 0

verilog模塊的調(diào)用、任務(wù)和函數(shù)

在做模塊劃分時(shí)，通常會(huì)出現(xiàn)這種情形，某個(gè)大的模塊中包含了一個(gè)或多個(gè)功能子模塊，verilog是通過(guò)模塊調(diào)用或稱(chēng)為模塊實(shí)例化的方式來(lái)實(shí)現(xiàn)這些子模塊與高層模...

2025-05-03 標(biāo)簽：模塊 Verilog 函數(shù) 1.6k 0

Verilog仿真事件中的延時(shí)分析

在實(shí)際電路中存在兩種延遲，慣性延遲 (Inertial delay) 和傳導(dǎo)延遲 (Transport delay)。

2025-04-18 標(biāo)簽：仿真 Verilog 時(shí)序 1.3k 0

在testbench中如何使用阻塞賦值和非阻塞賦值

本文詳細(xì)闡述了在一個(gè)testbench中，應(yīng)該如何使用阻塞賦值與非阻塞賦值。首先說(shuō)結(jié)論，建議在testbench中，對(duì)時(shí)鐘信號(hào)（包括分頻時(shí)鐘）使用阻塞賦...

2025-04-15 標(biāo)簽：仿真 Verilog 阻塞賦值 1.2k 0

Verilog編寫(xiě)規(guī)范

用最右邊的字符下劃線代表低電平有效,高電平有效的信號(hào)不得以下劃線表示,短暫的有效信號(hào)建議采用高電平有效。

2025-04-11 標(biāo)簽：模塊 Verilog 波形 1.1k 0

FPGA Verilog HDL語(yǔ)法之編譯預(yù)處理

Verilog HDL語(yǔ)言和C語(yǔ)言一樣也提供了編譯預(yù)處理的功能。“編譯預(yù)處理”是Verilog HDL編譯系統(tǒng)的一個(gè)組成部分。Verilog HDL語(yǔ)言...

2025-03-27 標(biāo)簽：FPGA Verilog C語(yǔ)言 1.5k 0

FPGA學(xué)習(xí)筆記

線網(wǎng)類(lèi)型表示硬件電路元件之間實(shí)際存在的物理連線，有很多種：wire、tri、wor等等，當(dāng)然日常使用wire最多，其他的都沒(méi)遇到過(guò)。

2025-03-27 標(biāo)簽：FPGA 集成電路 Verilog 1.4k 0

基于Verilog語(yǔ)言實(shí)現(xiàn)CRC校驗(yàn)

CRC即循環(huán)冗余校驗(yàn)碼：是數(shù)據(jù)通信領(lǐng)域中最常用的一種查錯(cuò)校驗(yàn)碼，其特征是信息字段和校驗(yàn)字段的長(zhǎng)度可以任意選定。循環(huán)冗余檢查（CRC）是一種數(shù)據(jù)傳輸檢錯(cuò)功...

2025-03-24 標(biāo)簽：crc Verilog 校驗(yàn)碼 2.6k 0

SDRAM控制器設(shè)計(jì)之按鍵的處理

邊沿檢測(cè)經(jīng)常用于按鍵輸入檢測(cè)電路中，按鍵按下時(shí)輸入信號(hào) key 變?yōu)榈碗娖?，按鍵抬起變?yōu)楦唠娖健．?dāng)輸入的信號(hào)為理想的高低電平時(shí)（不考慮毛刺和抖動(dòng)），邊沿...

2025-03-19 標(biāo)簽：寄存器 Verilog 邊沿檢測(cè) 1.3k 0

一文詳解Verilog HDL

Verilog HDL（Hardware Description Language）是一種硬件描述語(yǔ)言，用于從算法級(jí)、門(mén)級(jí)到開(kāi)關(guān)級(jí)的多種抽象設(shè)計(jì)層次的數(shù)...

2025-03-17 標(biāo)簽：FPGA 寄存器 Verilog 4.3k 0

根據(jù)波形圖編寫(xiě)Verilog代碼

根據(jù)下面的時(shí)序圖實(shí)現(xiàn)這個(gè)組合邏輯電路。

2025-02-17 標(biāo)簽：Verilog 波形圖組合邏輯電路 1.2k 0

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Protues

Protues

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Proteus軟件是英國(guó)Lab Center Electronics公司出版的EDA工具軟件（該軟件中國(guó)總代理為廣州風(fēng)標(biāo)電子技術(shù)有限公司）。它不僅具有其它EDA工具軟件的仿真功能，還能仿真單片機(jī)及外圍器件。
靜電防護(hù)

靜電防護(hù)

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為防止靜電積累所引起的人身電擊、火災(zāi)和爆炸、電子器件失效和損壞，以及對(duì)生產(chǎn)的不良影響而采取的防范措施。其防范原則主要是抑制靜電的產(chǎn)生，加速靜電泄漏，進(jìn)行靜電中和等。
Altium Designer

Altium Designer

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FPGA芯片

FPGA芯片

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FPGA（Field－Programmable Gate Array），即現(xiàn)場(chǎng)可編程門(mén)陣列，它是在PAL、GAL、CPLD等可編程器件的基礎(chǔ)上進(jìn)一步發(fā)展的產(chǎn)物。
ArduBlock

ArduBlock

+關(guān)注

ArduBlock軟件是Arduino官方編程環(huán)境的第三方軟件，目前必須依附于Arduino軟件下運(yùn)行，區(qū)別于Arduino文本式編程環(huán)境，ArduBlock是以圖形化積木搭建的方式編程的，這樣的方式會(huì)使編程的可視化和交互性加強(qiáng)，編程門(mén)檻降低，即使沒(méi)有編程經(jīng)驗(yàn)的人也可以嘗試給Arduino控制器編寫(xiě)程序。
AD10

AD10

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識(shí)別

識(shí)別

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FPGA開(kāi)發(fā)板

FPGA開(kāi)發(fā)板

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FPGA開(kāi)發(fā)板在基于MCU、定制ASIC和體積龐大的電線束來(lái)實(shí)現(xiàn)引擎及控制電子的系統(tǒng)方案已發(fā)展至接近其技術(shù)和應(yīng)用極限，汽車(chē)工業(yè)正面臨新的設(shè)計(jì)挑戰(zhàn)。過(guò)去汽車(chē)電子產(chǎn)品的開(kāi)發(fā)周期是漫長(zhǎng)的，而許多汽車(chē)制造商現(xiàn)正致力于在更短的時(shí)間內(nèi)，裝備消費(fèi)者所需的新一代汽車(chē)。
PCB封裝

PCB封裝

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pcb封裝就是把實(shí)際的電子元器件，芯片等的各種參數(shù)（比如元器件的大小，長(zhǎng)寬，直插，貼片，焊盤(pán)的大小，管腳的長(zhǎng)寬，管腳的間距等）用圖形方式表現(xiàn)出來(lái)，以便可以在畫(huà)pcb圖時(shí)進(jìn)行調(diào)用。
QUARTUS II

QUARTUS II

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Quartus II 是Altera公司推出的綜合性CPLD/FPGA開(kāi)發(fā)軟件，軟件支持原理圖、VHDL、VerilogHDL以及AHDL（Altera Hardware 支持Description Language）等多種設(shè)計(jì)輸入形式，內(nèi)嵌自有的綜合器以及仿真器，可以完成從設(shè)計(jì)輸入到硬件配置的完整PLD設(shè)計(jì)流程。
語(yǔ)音交互

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PCB封裝庫(kù)

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AD09

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PDN

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QuickPcb

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Artix-7

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　　Artix-7 系列：相對(duì)于 Spartan-6 系列而言，Artix-7 系列功耗降低了一半，成本降低了 35%，采用小型化封裝、統(tǒng)一的 Virtex 系列架構(gòu)，能滿(mǎn)足低成本大批量市場(chǎng)的性能要求，這也正是此前 ASSP、ASIC 和低成本 FPGA 所針對(duì)的市場(chǎng)領(lǐng)域。
VHDL代碼

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powerlink

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Protel 99 se

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面包板

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面包板是由于板子上有很多小插孔，專(zhuān)為電子電路的無(wú)焊接實(shí)驗(yàn)設(shè)計(jì)制造的。由于各種電子元器件可根據(jù)需要隨意插入或拔出，免去了焊接，節(jié)省了電路的組裝時(shí)間，而且元件可以重復(fù)使用，所以非常適合電子電路的組裝、調(diào)試和訓(xùn)練。
candence

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AXI

AXI

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AXI是一種總線協(xié)議，該協(xié)議是ARM公司提出的AMBA3.0協(xié)議中最重要的部分，是一種面向高性能、高帶寬、低延遲的片內(nèi)總線。它的地址/控制和數(shù)據(jù)相位是分離的，支持不對(duì)齊的數(shù)據(jù)傳輸，同時(shí)在突發(fā)傳輸中，只需要首地址，同時(shí)分離的讀寫(xiě)數(shù)據(jù)通道、并支持Outstanding傳輸訪問(wèn)和亂序訪問(wèn)，并更加容易進(jìn)行時(shí)序收斂。AXI是AMBA中一個(gè)新的高性能協(xié)議。
特性阻抗

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特性阻抗又稱(chēng)特征阻抗，它不是直流電阻，屬于長(zhǎng)線傳輸中的概念。特性阻抗是射頻傳輸線影響無(wú)線電波電壓、電流的幅值和相位變化的固有特性，等于各處的電壓與電流的比值，用V/I表示。在射頻電路中，電阻、電容、電感都會(huì)阻礙交變電流的流動(dòng)，合稱(chēng)阻抗。電阻是吸收電磁能量的，理想電容和電感不消耗電磁能量。
時(shí)鐘源

時(shí)鐘源

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時(shí)鐘源用來(lái)為環(huán)形脈沖發(fā)生器提供頻率穩(wěn)定且電平匹配的方波時(shí)鐘脈沖信號(hào)。它通常由石英晶體振蕩器和與非門(mén)組成的正反饋振蕩電路組成，其輸出送至環(huán)形脈沖發(fā)生器。
AD采樣

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　　AD轉(zhuǎn)換采樣頻率指完成一次從模擬轉(zhuǎn)換到數(shù)字的AD轉(zhuǎn)換所需時(shí)間的倒數(shù)，模擬量可以是電壓、電流等電信號(hào)，也可以是壓力、溫度、濕度、位移、聲音等非電信號(hào)；而AD分辨率指數(shù)字量變化一個(gè)最小量時(shí)模擬信號(hào)的變化量。
驅(qū)動(dòng)電流

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Kintex-7

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　　Kintex-7系列：Kintex-7 系列是一種新型 FPGA，能以不到 Virtex-6 系列一半的價(jià)格實(shí)現(xiàn)與其相當(dāng)性能，性?xún)r(jià)比提高了一倍，功耗降低了一半。
Protel DXP

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FPGA教程

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紅外觸摸屏

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verilog

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