verilog

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Verilog HDL是一種硬件描述語(yǔ)言（HDL:Hardware Description Language），以文本形式來(lái)描述數(shù)字系統(tǒng)硬件的結(jié)構(gòu)和行為的語(yǔ)言，用它可以表示邏輯電路圖、邏輯表達(dá)式，還可以表示數(shù)字邏輯系統(tǒng)所完成的邏輯功能。

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verilog技術(shù)

淺談Verilog和VHDL的區(qū)別

Verilog和VHDL是兩種廣泛使用的硬件描述語(yǔ)言（HDL），它們用于描述和模擬數(shù)字電路系統(tǒng)的行為和結(jié)構(gòu)。這兩種語(yǔ)言的主要作用是幫助工程師設(shè)計(jì)、仿真和...

2025-02-17 標(biāo)簽：集成電路 Verilog vhdl 3.4k 0

SPI通信總線概述和Verilog實(shí)現(xiàn)

SPI = Serial Peripheral Interface，是串行外圍設(shè)備接口，是一種高速，全雙工，同步的通信總線。

2025-02-07 標(biāo)簽：Verilog SPI 通信總線 2.3k 0

Verilog例化說(shuō)明

Verilog例化說(shuō)明 1.什么是模塊例化？為什么要例化？模塊例化可以理解成模塊調(diào)用。對(duì)于一個(gè)FPGA工程，通常是由一個(gè)頂層模塊與多個(gè)功能子模塊組成，...

2024-12-17 標(biāo)簽：Verilog 數(shù)碼管顯示顯示模塊 3.5k 0

Verilog 電路仿真常見(jiàn)問(wèn)題 Verilog 在芯片設(shè)計(jì)中的應(yīng)用

在現(xiàn)代電子設(shè)計(jì)自動(dòng)化（EDA）領(lǐng)域，Verilog作為一種硬件描述語(yǔ)言，已經(jīng)成為數(shù)字電路設(shè)計(jì)和驗(yàn)證的標(biāo)準(zhǔn)工具。它允許設(shè)計(jì)師以高級(jí)抽象的方式定義電路的行為...

2024-12-17 標(biāo)簽：芯片硬件 Verilog 1.8k 0

Verilog 與 ASIC 設(shè)計(jì)的關(guān)系 Verilog 代碼優(yōu)化技巧

Verilog與ASIC設(shè)計(jì)的關(guān)系 Verilog作為一種硬件描述語(yǔ)言（HDL），在ASIC設(shè)計(jì)中扮演著至關(guān)重要的角色。ASIC（Application...

2024-12-17 標(biāo)簽：asic 硬件 Verilog 1.7k 0

Verilog 測(cè)試平臺(tái)設(shè)計(jì)方法 Verilog FPGA開(kāi)發(fā)指南

Verilog測(cè)試平臺(tái)設(shè)計(jì)方法是Verilog FPGA開(kāi)發(fā)中的重要環(huán)節(jié)，它用于驗(yàn)證Verilog設(shè)計(jì)的正確性和性能。以下是一個(gè)詳細(xì)的Verilog測(cè)試...

2024-12-17 標(biāo)簽：FPGA Verilog 參數(shù) 1.8k 0

如何使用 Verilog 進(jìn)行數(shù)字電路設(shè)計(jì)

使用Verilog進(jìn)行數(shù)字電路設(shè)計(jì)是一個(gè)復(fù)雜但有序的過(guò)程，它涉及從概念設(shè)計(jì)到實(shí)現(xiàn)、驗(yàn)證和優(yōu)化的多個(gè)階段。以下是一個(gè)基本的步驟指南，幫助你理解如何使用Ve...

2024-12-17 標(biāo)簽：數(shù)據(jù)Verilog 數(shù)字電路 2k 0

Verilog與VHDL的比較 Verilog HDL編程技巧

Verilog 與 VHDL 比較 1. 語(yǔ)法和風(fēng)格 Verilog ：Verilog 的語(yǔ)法更接近于 C 語(yǔ)言，對(duì)于有 C 語(yǔ)言背景的工程師來(lái)說(shuō)，學(xué)習(xí)...

2024-12-17 標(biāo)簽：Verilog 編程 vhdl 3.2k 0

三種常見(jiàn)平方根算法的電路設(shè)計(jì)及Verilog實(shí)現(xiàn)與仿真

一、平方根及三種常見(jiàn)平方根算法簡(jiǎn)介數(shù)學(xué)是物理的基礎(chǔ)，是廣大世界的基本組成部分，而數(shù)學(xué)運(yùn)算是數(shù)學(xué)理論的核心部分，數(shù)學(xué)運(yùn)算有加減乘除乘方等基本運(yùn)算，拓展的...

2024-11-26 標(biāo)簽：算法仿真 Verilog 2.1k 0

如何自動(dòng)生成verilog代碼

介紹幾種自動(dòng)生成verilog代碼的方法。

2024-11-05 標(biāo)簽：Verilog 字符串代碼 1.9k 0

FPGA延時(shí)Verilog HDL實(shí)現(xiàn)

可以在任意時(shí)刻啟動(dòng)，可以重復(fù)啟動(dòng)，延時(shí)時(shí)長(zhǎng)可調(diào)，單位可切換（ms/us），在50MHz時(shí)鐘下的延時(shí)范圍是1ms-85899ms/1us-85899us。

2024-11-05 標(biāo)簽：FPGA 仿真 Verilog 1.4k 0

Verilog語(yǔ)法中運(yùn)算符的用法

verilog語(yǔ)法中使用以下兩個(gè)運(yùn)算符可以簡(jiǎn)化我們的位選擇代碼。

2024-10-25 標(biāo)簽：Verilog 代碼語(yǔ)法 3.6k 0

Verilog HDL的基礎(chǔ)知識(shí)

本文繼續(xù)介紹Verilog HDL基礎(chǔ)知識(shí)，重點(diǎn)介紹賦值語(yǔ)句、阻塞與非阻塞、循環(huán)語(yǔ)句、同步與異步、函數(shù)與任務(wù)語(yǔ)法知識(shí)。

2024-10-24 標(biāo)簽：仿真 Verilog HDL 2k 0

基于FPGA實(shí)現(xiàn)數(shù)碼管顯示

本文介紹數(shù)碼管顯示譯碼基本工作原理及Verilog HDL驅(qū)動(dòng)代碼編寫，進(jìn)一步熟練掌握FPGA入門基礎(chǔ)知識(shí)。

2024-10-24 標(biāo)簽：FPGA 顯示屏 Verilog 2.9k 0

Verilog表達(dá)式的位寬確定規(guī)則

很多時(shí)候，Verilog中表達(dá)式的位寬都是被隱式確定的，即使你自己設(shè)計(jì)了位寬，它也是根據(jù)規(guī)則先確定位寬后，再擴(kuò)展到你的設(shè)計(jì)位寬，這常常會(huì)導(dǎo)致結(jié)果產(chǎn)生意想...

2024-10-22 標(biāo)簽：Verilog 運(yùn)算語(yǔ)法 2.5k 0

基于FPGA的JPEG-LS圖像壓縮器介紹

現(xiàn)在來(lái)看一下GitHub上面一個(gè)開(kāi)源的JPEG LS算法的Verilog實(shí)現(xiàn)

2024-10-15 標(biāo)簽：FPGA 算法 Verilog 2.2k 0

雙向IO與IOB詳解

典型的全雙工（Full Duplex）系統(tǒng)如下圖所示，芯片1和芯片2之間有彼此獨(dú)立的數(shù)據(jù)傳輸線，這意味著芯片1和芯片2可以同時(shí)給對(duì)方發(fā)送數(shù)據(jù)而不會(huì)發(fā)生沖...

2024-09-18 標(biāo)簽：FPGA 芯片緩沖器 2.7k 0

D鎖存器的基本實(shí)現(xiàn)

在Verilog HDL中實(shí)現(xiàn)鎖存器（Latch）通常涉及對(duì)硬件描述語(yǔ)言的基本理解，特別是關(guān)于信號(hào)如何根據(jù)控制信號(hào)的變化而保持或更新其值。鎖存器與觸發(fā)器...

2024-08-30 標(biāo)簽：Verilog 鎖存器觸發(fā)器 2.6k 0

verilog系統(tǒng)函數(shù)

（1）fwrite是需要觸發(fā)條件的，需要手動(dòng)添加換行。（2）如果寫放文件的格式為%d，則認(rèn)為是無(wú)符號(hào)數(shù)，

2024-07-05 標(biāo)簽：Verilog 函數(shù) 1.9k 0

Verilog到VHDL轉(zhuǎn)換的經(jīng)驗(yàn)與技巧總結(jié)

Verilog與VHDL語(yǔ)法是互通且相互對(duì)應(yīng)的，如何查看二者對(duì)同一硬件結(jié)構(gòu)的描述，可以借助EDA工具，如Vivado，打開(kāi)Vivado后它里面的語(yǔ)言模板...

2024-04-28 標(biāo)簽：RAM Verilog eda 4.4k 0

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Protues

Protues

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Proteus軟件是英國(guó)Lab Center Electronics公司出版的EDA工具軟件（該軟件中國(guó)總代理為廣州風(fēng)標(biāo)電子技術(shù)有限公司）。它不僅具有其它EDA工具軟件的仿真功能，還能仿真單片機(jī)及外圍器件。
靜電防護(hù)

靜電防護(hù)

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為防止靜電積累所引起的人身電擊、火災(zāi)和爆炸、電子器件失效和損壞，以及對(duì)生產(chǎn)的不良影響而采取的防范措施。其防范原則主要是抑制靜電的產(chǎn)生，加速靜電泄漏，進(jìn)行靜電中和等。
Altium Designer

Altium Designer

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FPGA芯片

FPGA芯片

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FPGA（Field－Programmable Gate Array），即現(xiàn)場(chǎng)可編程門陣列，它是在PAL、GAL、CPLD等可編程器件的基礎(chǔ)上進(jìn)一步發(fā)展的產(chǎn)物。
ArduBlock

ArduBlock

+關(guān)注

ArduBlock軟件是Arduino官方編程環(huán)境的第三方軟件，目前必須依附于Arduino軟件下運(yùn)行，區(qū)別于Arduino文本式編程環(huán)境，ArduBlock是以圖形化積木搭建的方式編程的，這樣的方式會(huì)使編程的可視化和交互性加強(qiáng)，編程門檻降低，即使沒(méi)有編程經(jīng)驗(yàn)的人也可以嘗試給Arduino控制器編寫程序。
AD10

AD10

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識(shí)別

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FPGA開(kāi)發(fā)板

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FPGA開(kāi)發(fā)板在基于MCU、定制ASIC和體積龐大的電線束來(lái)實(shí)現(xiàn)引擎及控制電子的系統(tǒng)方案已發(fā)展至接近其技術(shù)和應(yīng)用極限，汽車工業(yè)正面臨新的設(shè)計(jì)挑戰(zhàn)。過(guò)去汽車電子產(chǎn)品的開(kāi)發(fā)周期是漫長(zhǎng)的，而許多汽車制造商現(xiàn)正致力于在更短的時(shí)間內(nèi)，裝備消費(fèi)者所需的新一代汽車。
PCB封裝

PCB封裝

+關(guān)注

pcb封裝就是把實(shí)際的電子元器件，芯片等的各種參數(shù)（比如元器件的大小，長(zhǎng)寬，直插，貼片，焊盤的大小，管腳的長(zhǎng)寬，管腳的間距等）用圖形方式表現(xiàn)出來(lái)，以便可以在畫pcb圖時(shí)進(jìn)行調(diào)用。
QUARTUS II

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Quartus II 是Altera公司推出的綜合性CPLD/FPGA開(kāi)發(fā)軟件，軟件支持原理圖、VHDL、VerilogHDL以及AHDL（Altera Hardware 支持Description Language）等多種設(shè)計(jì)輸入形式，內(nèi)嵌自有的綜合器以及仿真器，可以完成從設(shè)計(jì)輸入到硬件配置的完整PLD設(shè)計(jì)流程。
語(yǔ)音交互

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PCB封裝庫(kù)

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Artix-7

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　　Artix-7 系列：相對(duì)于 Spartan-6 系列而言，Artix-7 系列功耗降低了一半，成本降低了 35%，采用小型化封裝、統(tǒng)一的 Virtex 系列架構(gòu)，能滿足低成本大批量市場(chǎng)的性能要求，這也正是此前 ASSP、ASIC 和低成本 FPGA 所針對(duì)的市場(chǎng)領(lǐng)域。
VHDL代碼

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Protel 99 se

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面包板是由于板子上有很多小插孔，專為電子電路的無(wú)焊接實(shí)驗(yàn)設(shè)計(jì)制造的。由于各種電子元器件可根據(jù)需要隨意插入或拔出，免去了焊接，節(jié)省了電路的組裝時(shí)間，而且元件可以重復(fù)使用，所以非常適合電子電路的組裝、調(diào)試和訓(xùn)練。
candence

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AXI

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AXI是一種總線協(xié)議，該協(xié)議是ARM公司提出的AMBA3.0協(xié)議中最重要的部分，是一種面向高性能、高帶寬、低延遲的片內(nèi)總線。它的地址/控制和數(shù)據(jù)相位是分離的，支持不對(duì)齊的數(shù)據(jù)傳輸，同時(shí)在突發(fā)傳輸中，只需要首地址，同時(shí)分離的讀寫數(shù)據(jù)通道、并支持Outstanding傳輸訪問(wèn)和亂序訪問(wèn)，并更加容易進(jìn)行時(shí)序收斂。AXI是AMBA中一個(gè)新的高性能協(xié)議。
特性阻抗

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特性阻抗又稱特征阻抗，它不是直流電阻，屬于長(zhǎng)線傳輸中的概念。特性阻抗是射頻傳輸線影響無(wú)線電波電壓、電流的幅值和相位變化的固有特性，等于各處的電壓與電流的比值，用V/I表示。在射頻電路中，電阻、電容、電感都會(huì)阻礙交變電流的流動(dòng)，合稱阻抗。電阻是吸收電磁能量的，理想電容和電感不消耗電磁能量。
時(shí)鐘源

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時(shí)鐘源用來(lái)為環(huán)形脈沖發(fā)生器提供頻率穩(wěn)定且電平匹配的方波時(shí)鐘脈沖信號(hào)。它通常由石英晶體振蕩器和與非門組成的正反饋振蕩電路組成，其輸出送至環(huán)形脈沖發(fā)生器。
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　　AD轉(zhuǎn)換采樣頻率指完成一次從模擬轉(zhuǎn)換到數(shù)字的AD轉(zhuǎn)換所需時(shí)間的倒數(shù)，模擬量可以是電壓、電流等電信號(hào)，也可以是壓力、溫度、濕度、位移、聲音等非電信號(hào)；而AD分辨率指數(shù)字量變化一個(gè)最小量時(shí)模擬信號(hào)的變化量。
驅(qū)動(dòng)電流

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Kintex-7

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　　Kintex-7系列：Kintex-7 系列是一種新型 FPGA，能以不到 Virtex-6 系列一半的價(jià)格實(shí)現(xiàn)與其相當(dāng)性能，性價(jià)比提高了一倍，功耗降低了一半。
Protel DXP

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FPGA教程

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紅外觸摸屏

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