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Versal 產(chǎn)品組合基于 臺積電(TSMC)的 7 nm FinFET 工藝技術(shù),是第一個(gè)將軟件可編程性與特定領(lǐng)域硬件加速和靈活應(yīng)變能力相結(jié)合的平臺,這對于跟上當(dāng)今快速的創(chuàng)新步伐至關(guān)重要。
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如何在Versal平臺實(shí)現(xiàn)兩個(gè)PS I2C控制器的回環(huán)
I2C 總線的兩根信號線 SCL 和 SDA 需要上拉才能正常工作,當(dāng)板卡上沒有合適的硬件設(shè)置或者沒有合適的 I2Cslave 設(shè)備,我們就無法進(jìn)行 I...
Versal Premium SysMon:如何在輔助SLR中對SysMon寄存器進(jìn)行尋址
要在輔助 SLR 中啟用對 Sysmon 寄存器空間的訪問,須在 CIPS 和 NOC GUI 執(zhí)行多個(gè)步驟
Versal 600G DCMAC Subsystem LogiCORE IP產(chǎn)品指南
AMD 自適應(yīng)計(jì)算文檔按一組標(biāo)準(zhǔn)設(shè)計(jì)進(jìn)程進(jìn)行組織,以便幫助您查找當(dāng)前開發(fā)任務(wù)相關(guān)的內(nèi)容。您可以在設(shè)計(jì)中心頁面上訪問 AMD Versal 自適應(yīng) SoC...
Vitis 2022.2 ACAP 設(shè)計(jì)流程強(qiáng)化
在這個(gè)新版本中,AI 引擎相對約束提供了在 AI 引擎內(nèi)控制內(nèi)核相對布局的途徑。這有利于用戶從 AI 引擎陣列獲得更高性能和更充分的利用率。可以將約束定...
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