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      快速理解Verilog語(yǔ)言

      汽車玩家 ? 來(lái)源：今日頭條 ? 作者：電子領(lǐng)學(xué)君 ? 2020-03-22 17:29 ? 次閱讀
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      Verilog HDL簡(jiǎn)稱Verilog，它是使用最廣泛的硬件描述語(yǔ)言。

      誕生時(shí)間：1983年。

      可以分為5個(gè)層次：（自頂向下）

      第一層,系統(tǒng)級(jí)（system）：用高級(jí)語(yǔ)言設(shè)計(jì)模塊的外部性能的模型

      第二層,算法級(jí)（Algorithmic）：用高級(jí)語(yǔ)言實(shí)現(xiàn)設(shè)計(jì)算法的模型

      第三層，寄存器傳輸級(jí)（RTL）：描述數(shù)據(jù)在寄存器之間的流動(dòng)以及如何處理這些數(shù)據(jù)的模型。這是其他高級(jí)語(yǔ)言不具備的能力

      第四層，門級(jí)（gate-level）：描述邏輯門以及邏輯門之間的連接的模型

      第五層，開關(guān)級(jí)（switch-level）：描述器件中三極管和存儲(chǔ)節(jié)點(diǎn)以及它們之間連接的模型

      注：前三層屬于行為級(jí)，第四層屬于邏輯級(jí)，第五層屬于開關(guān)級(jí)

      Verilog的特點(diǎn)：

      1. 它與C語(yǔ)言相似，語(yǔ)法靈活

      2. 能夠抽象出電路行為和結(jié)構(gòu)

      3. 支持邏輯設(shè)計(jì)中層次與范圍的描述

      4. 具有電路仿真和驗(yàn)證機(jī)制

      聲明：本文內(nèi)容及配圖由入駐作者撰寫或者入駐合作網(wǎng)站授權(quán)轉(zhuǎn)載。文章觀點(diǎn)僅代表作者本人，不代表電子發(fā)燒友網(wǎng)立場(chǎng)。文章及其配圖僅供工程師學(xué)習(xí)之用，如有內(nèi)容侵權(quán)或者其他違規(guī)問題，請(qǐng)聯(lián)系本站處理。 舉報(bào)投訴
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