什么是關(guān)鍵路徑?
關(guān)鍵路徑分為兩類:一類是時(shí)序違例的路徑,主要是建立時(shí)間違例;
另一類是時(shí)序沒(méi)有違例,但邏輯級(jí)數(shù)較高的路徑。當(dāng)然,第一類路徑中可能會(huì)包含第二類路徑。
對(duì)于第一類路徑,其違例的原因無(wú)外乎邏輯延遲太大、線延遲太大或者時(shí)鐘Skew太大等。可以根據(jù)具體原因?qū)ΠY下藥。對(duì)于第二類路徑,其“副作用”比較明顯:
工具犧牲了其他路徑換取了這類路徑的收斂,最終我們可能會(huì)看到時(shí)序違例的路徑反倒是那些邏輯級(jí)數(shù)很低甚至為0的路徑,而這類路徑通常已經(jīng)沒(méi)有什么優(yōu)化空間了。此時(shí),要實(shí)現(xiàn)整個(gè)設(shè)計(jì)的時(shí)序收斂就變得捉襟見(jiàn)肘了。
因此,在設(shè)計(jì)早期找到這類路徑至關(guān)重要。
編輯:jq
-
時(shí)鐘
+關(guān)注
關(guān)注
11文章
1971瀏覽量
134987 -
路徑
+關(guān)注
關(guān)注
0文章
50瀏覽量
12770
原文標(biāo)題:Vivado下如何找關(guān)鍵路徑?
文章出處:【微信號(hào):Lauren_FPGA,微信公眾號(hào):FPGA技術(shù)驛站】歡迎添加關(guān)注!文章轉(zhuǎn)載請(qǐng)注明出處。
發(fā)布評(píng)論請(qǐng)先 登錄
利用 NucleiStudio IDE 和 vivado 進(jìn)行軟硬件聯(lián)合仿真
vivado時(shí)序分析相關(guān)經(jīng)驗(yàn)
在Windows10上運(yùn)行vivado使用tcl文件創(chuàng)建E203項(xiàng)目路徑錯(cuò)誤的問(wèn)題
win10環(huán)境下使用vivado生成.bit與.mcs文件
沒(méi)有開(kāi)發(fā)板的情況,在Vivado上進(jìn)行蜂鳥(niǎo)E203的基礎(chǔ)內(nèi)核的drystone跑分
在vivado上進(jìn)行benchmark跑分(微架構(gòu)優(yōu)化之前)
沒(méi)有開(kāi)發(fā)板的情況下,在Vivado上進(jìn)行蜂鳥(niǎo)E203的基礎(chǔ)內(nèi)核的drystone跑分
vcs和vivado聯(lián)合仿真
如何在vivado上基于二進(jìn)制碼對(duì)指令運(yùn)行狀態(tài)進(jìn)行判斷
在vivado上基于二進(jìn)制碼對(duì)指令運(yùn)行狀態(tài)進(jìn)行判斷
vivado仿真時(shí)GSR信號(hào)的影響
STM32CUBEIDE使用UCOS的時(shí)候,頭文件路徑已經(jīng)添加了,依舊提示未找到路徑怎么解決?
Vivado無(wú)法選中開(kāi)發(fā)板的常見(jiàn)原因及解決方法
如何使用One Spin檢查AMD Vivado Design Suite Synth的結(jié)果
基于Vivado下怎么找到關(guān)鍵路徑?
評(píng)論