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RISCV soft JTAG調(diào)試_v1.1

XL FPGA技術(shù)交流 ? 來源:易靈思FPGA技術(shù)交流 ? 作者:易靈思FPGA技術(shù)交流 ? 2024-02-23 16:16 ? 次閱讀
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因為目前軟件的限制,RISCV的邏輯不能同時共用JTAG,所以如果想要同時去調(diào)試邏輯和RISCV的話,可以通過RISCV的soft Jtag來實現(xiàn)。soft Jtag就是通過GPIO來實現(xiàn)的軟件JTAG。這里我們以TI60F225 DEMO來演示。

在使用softJTAG的過程中,首先要把RISCV的IP的調(diào)試選項選擇為soft,也就是Eanble Soft Debug Tap.

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第二,使用softjtag 在通過openOCD來配置時要選擇default_softTap,它對應(yīng)“embedded_swsapphire_socconfig”下面的default_softTap.launch文件。

9acc1912-d11a-11ee-b759-92fbcf53809c.png

第三個要注意的點就是器件的名稱。如果使用的是HardJtag會把ftdi_ti.cfg里面的器件與下面器件的名稱對應(yīng)起來。但是softJtag對應(yīng)的文件不是ftdi_ti.cfg也沒有對應(yīng)的soft.cfg,而是對應(yīng)c232hm_ddhsl_0.cfg,所以要把c232hm_ddhsl_0.cfg里面的器件名稱和下載器的對應(yīng)起來。

打開“embedded_swsapphire_socconfig”下面的default_softTap.launch文件也可以看到調(diào)用文件的路徑指向的是c232hm_ddhsl_0.cfg

打開“embedded_swsapphire_socconfig”下面的default_ti.launch文件也可以看到調(diào)用文件的路徑指向的是ftdi_ti.cfg

在2023.1版本的RISCV中已經(jīng)沒有c232hm_ddhsl_0.cfg文件了。代之的是一個external.cfg文件。

第四,如果使用易靈思下載器一定要連接VREF,并且要確認(rèn)好IO電壓,一定要確認(rèn)好IO電壓。

第五、使用soft Jtag容易出現(xiàn)連接不穩(wěn)定的情況,以下來自Bruce 和Wayne的建議:

在Interface Designer里修改對應(yīng)于JTAG softTAP的GPIO設(shè)置:

1. 打開TMS TDO內(nèi)部弱上拉;

2. 打開TMS TDO TCK TDI GPIO的IO Register 并使用RISCV系統(tǒng)主時鐘驅(qū)動;

3. 如果SoftTAP綁定的是普通的GPIO,打開施密特觸發(fā)器和Slow Slew;

4.TDO 在 fpga輸出的驅(qū)動電流修改到最大;

下面以TMS和TDO為例的設(shè)置情況。

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TMS參數(shù)設(shè)置

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TDO參數(shù)設(shè)置

更新說明:補充器件的名稱在2023.1版本之后的說明。

審核編輯 黃宇

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