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JEDEC制定全新內(nèi)存標(biāo)準(zhǔn),將取代HBM?

Simon觀察 ? 來(lái)源:電子發(fā)燒友網(wǎng) ? 作者:黃山明 ? 2025-12-17 09:29 ? 次閱讀
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電子發(fā)燒友網(wǎng)綜合報(bào)道
隨著人工智能算力需求的指數(shù)級(jí)爆發(fā),數(shù)據(jù)中心對(duì)內(nèi)存的性能、容量與成本平衡提出了前所未有的嚴(yán)苛要求。HBM憑借1024-bit甚至2048-bit的超高位寬,成為AI加速卡的核心配套組件,其無(wú)可匹敵的帶寬與能效比,支撐著大模型訓(xùn)練、自動(dòng)駕駛等密集型計(jì)算任務(wù)的推進(jìn)。

但與此同時(shí),HBM的超高位寬設(shè)計(jì)也帶來(lái)了顯著短板,大量占用寶貴的芯片面積,限制了單顆芯片的堆疊數(shù)量與封裝容量,進(jìn)一步制約了AI加速卡的性能上限,且依賴昂貴的中介層技術(shù),成本居高不下,難以在中高端需求場(chǎng)景中大規(guī)模普及。

正是在這一背景下,全球半導(dǎo)體標(biāo)準(zhǔn)組織JEDEC著手制定全新的“SPHBM4”(標(biāo)準(zhǔn)封裝高帶寬內(nèi)存第四代)內(nèi)存標(biāo)準(zhǔn),試圖在高性能與高性價(jià)比之間找到平衡點(diǎn),為AI內(nèi)存生態(tài)注入新的活力。

SPHBM4最核心的技術(shù)突破,在于通過(guò)4:1串行技術(shù)重構(gòu)了數(shù)據(jù)傳輸架構(gòu),將傳統(tǒng)HBM4需要的2048-bit位寬大幅縮減至512-bit,卻依然能保持同等的HBM4級(jí)別帶寬,且性能表現(xiàn)遠(yuǎn)超當(dāng)前主流的DDR5內(nèi)存。

相較于傳統(tǒng)DDR系列,SPHBM4展現(xiàn)出碾壓性的性能優(yōu)勢(shì)。以DDR5為例,盡管后者憑借16Gb顆粒和3200MT/s速率在消費(fèi)級(jí)市場(chǎng)備受歡迎,但其單條容量上限僅為64GB,理論帶寬也停留在819GB/s。

反觀SPHBM4,借助獨(dú)特的堆疊設(shè)計(jì)和TSV硅通孔技術(shù),單顆芯片即可實(shí)現(xiàn)64GB容量,堆疊后容量更可突破256GB,帶寬更是可以超過(guò)2TB/s。這種跨越式的提升,使得SPHBM4在面對(duì)AI集群、超算中心等高負(fù)載場(chǎng)景時(shí),展現(xiàn)出傳統(tǒng)內(nèi)存難以企及的吞吐能力。

從市場(chǎng)定位來(lái)看,SPHBM4清晰地站在了DDR與HBM之間的中間地帶,填補(bǔ)了當(dāng)前內(nèi)存市場(chǎng)的關(guān)鍵空白。

一方面,相較于DDR5內(nèi)存,SPHBM4的帶寬優(yōu)勢(shì)顯著,能夠滿足AI推理、中小型模型訓(xùn)練等對(duì)數(shù)據(jù)傳輸速度有較高要求的場(chǎng)景,解決了DDR5在高密度計(jì)算中帶寬瓶頸的問(wèn)題;另一方面,與HBM4相比,SPHBM4成本更低、封裝更靈活,無(wú)需承擔(dān)硅中介層帶來(lái)的額外開(kāi)支,適合對(duì)性能有要求但無(wú)需追求極致算力的場(chǎng)景,比如邊緣AI服務(wù)器、工業(yè)級(jí)智能設(shè)備等。

不過(guò),這種定位也決定了SPHBM4并非萬(wàn)能解決方案,它不會(huì)取代GDDR顯存成為顯卡的新選擇。原因在于,SPHBM4雖成本低于HBM4,但仍采用堆疊式設(shè)計(jì),且需要配套的基片接口、TSV技術(shù)與先進(jìn)封裝工藝,成本遠(yuǎn)高于普通GDDR芯片;若用單顆SPHBM4替代多顆GDDR6/7,不僅會(huì)大幅增加顯卡成本,性能提升效果卻并不明顯,不符合消費(fèi)級(jí)顯卡的成本效益邏輯。

值得注意的是,SPHBM4的落地離不開(kāi)關(guān)鍵技術(shù)的支撐,其中TSV硅通孔技術(shù)與先進(jìn)封裝集成技術(shù)是核心。TSV技術(shù)能夠?qū)崿F(xiàn)芯片內(nèi)部垂直方向的高效數(shù)據(jù)傳輸,為多Die堆疊提供穩(wěn)定的連接基礎(chǔ),而先進(jìn)封裝則確保了在縮減位寬的同時(shí),內(nèi)存模塊的散熱效率與信號(hào)完整性不受影響。這些技術(shù)并非全新突破,但SPHBM4通過(guò)對(duì)現(xiàn)有技術(shù)的整合優(yōu)化,實(shí)現(xiàn)了性能、容量與成本的協(xié)同提升,體現(xiàn)出JEDEC在標(biāo)準(zhǔn)制定過(guò)程中對(duì)產(chǎn)業(yè)實(shí)際需求的深度洞察。

對(duì)于整個(gè)內(nèi)存行業(yè)而言,SPHBM4的出現(xiàn)并非簡(jiǎn)單的技術(shù)迭代,更標(biāo)志著AI時(shí)代內(nèi)存技術(shù)開(kāi)始向多元化細(xì)分方向發(fā)展。未來(lái),隨著SPHBM4標(biāo)準(zhǔn)的逐步完善與量產(chǎn)落地,預(yù)計(jì)將與DDR5、HBM4、GDDR等形成互補(bǔ),共同構(gòu)建更具彈性的AI內(nèi)存生態(tài),為不同層級(jí)的算力需求提供精準(zhǔn)支撐,進(jìn)一步加速人工智能技術(shù)在各行業(yè)的滲透與應(yīng)用。
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