深入解析LTC2335 - 18：高性能18位ADC的卓越之選

在電子工程師的日常工作中，模擬 - 數(shù)字轉(zhuǎn)換器（ADC）是至關(guān)重要的組件，它直接影響著系統(tǒng)的性能和精度。今天，我們就來深入探討一款性能卓越的18位ADC——LTC2335 - 18。

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一、產(chǎn)品概述

LTC2335 - 18是一款18位、低噪聲、8通道復(fù)用逐次逼近寄存器（SAR）ADC，具有差分、寬共模輸入范圍的特點。它采用5V低壓電源和靈活的高壓電源（通常為±15V），并集成了低漂移參考和緩沖器（ (V_{REFBUF }=4.096V) ）。這款A(yù)DC的獨特之處在于其SoftSpan技術(shù)，它可以在每次轉(zhuǎn)換時配置為接受±10.24V、0V至10.24V、±5.12V或0V至5.12V的信號，還能通過編程實現(xiàn)自動循環(huán)遍歷一系列通道和范圍，無需用戶額外干預(yù)。

二、關(guān)鍵特性亮點

2.1 高精度與高分辨率

• INL誤差小：最大±3LSB的積分非線性（INL），確保了在±10.24V范圍內(nèi)的高精度轉(zhuǎn)換。
• 無丟失碼：保證18位分辨率下無丟失碼，為數(shù)據(jù)的準確性提供了堅實保障。

  2.2 出色的動態(tài)性能

• 高SNR：典型的單轉(zhuǎn)換信噪比（SNR）達到96.7dB，有效降低了噪聲對信號的干擾。
• 低THD：在 (f_{IN}=2kHz) 時，總諧波失真（THD）典型值為 - 109dB，減少了諧波對信號質(zhì)量的影響。

  2.3 寬輸入范圍與高共模抑制

• 寬輸入共模范圍：允許ADC直接數(shù)字化各種信號，簡化了信號鏈設(shè)計。
• 高CMRR：典型的共模抑制比（CMRR）為118dB，有效抑制了共模信號的干擾。

  2.4 靈活的接口與低功耗

• 雙接口選擇：支持引腳可選的SPI CMOS（1.8V至5V）和LVDS串行接口，能與不同的微控制器和FPGA進行良好通信。
• 低功耗設(shè)計：在1Msps吞吐量下，典型功耗為180mW，還提供了可選的休眠和掉電模式，進一步降低了功耗。

三、技術(shù)參數(shù)詳解

3.1 輸入特性

LTC2335 - 18的模擬輸入引腳可以在較寬的共模輸入范圍內(nèi)采樣電壓差（ (V{IN^+}-V{IN^-}) ），并通過高CMRR抑制共模信號。每個通道的模擬輸入可以用等效電路模型表示，在采集開始時，40pF的采樣電容通過約600Ω的導(dǎo)通電阻連接到模擬輸入引腳。在不同的SoftSpan范圍內(nèi)，它可以處理雙極性和單極性輸入信號，輸出數(shù)據(jù)格式分別為二進制補碼和直二進制。

3.2 參考配置

該ADC支持三種參考配置：

• 內(nèi)部參考與內(nèi)部緩沖器：使用片上低噪聲、低漂移的帶隙參考，輸出2.048V，經(jīng)過參考緩沖器放大后在REFBUF引腳輸出4.096V。
• 外部參考與內(nèi)部緩沖器：通過外部參考源驅(qū)動REFIN引腳，可獲得更精確和低漂移的參考電壓。
• 外部參考且禁用內(nèi)部緩沖器：接地REFIN以禁用內(nèi)部緩沖器，用外部參考電壓驅(qū)動REFBUF引腳，可實現(xiàn)最大輸入信號擺幅和SNR。

3.3 時序與控制

• CNV時序：CNV引腳的上升沿觸發(fā)采樣和轉(zhuǎn)換，轉(zhuǎn)換開始后除非復(fù)位否則不能提前終止。為了獲得最佳性能，應(yīng)使用干凈、低抖動的信號驅(qū)動CNV，并避免在CNV上升沿前后的信號線上出現(xiàn)過渡。
• 內(nèi)部轉(zhuǎn)換時鐘：內(nèi)部時鐘經(jīng)過校準，最大轉(zhuǎn)換時間為550ns，最小采集時間為420ns，保證了1Msps的吞吐量。
• 休眠模式：轉(zhuǎn)換完成后，可將ADC置于休眠模式以降低功耗。在休眠模式下，部分電路關(guān)閉，再次啟動轉(zhuǎn)換時，需將CNV拉低并保持至少420ns。
• 掉電模式：將PD引腳置高，ADC進入掉電模式，轉(zhuǎn)換請求被忽略。退出掉電模式時，需將PD引腳置低，并等待至少10ms（使用內(nèi)部參考緩沖器時需等待200ms）才能啟動轉(zhuǎn)換。
• 復(fù)位時序：連續(xù)兩次將PD引腳置高且中間無轉(zhuǎn)換操作，可觸發(fā)全局復(fù)位，使ADC恢復(fù)到默認狀態(tài)。

3.4 數(shù)字接口

LTC2335 - 18具有CMOS和LVDS串行接口，可通過LVDS/CMOS引腳選擇。

• 串行CMOS I/O模式：數(shù)據(jù)總線包括SCKI、SDI、SCKO和SDO。在數(shù)據(jù)事務(wù)窗口內(nèi)，通過SDI輸入控制字配置SoftSpan范圍和通道，SDO輸出24位數(shù)據(jù)包，包含轉(zhuǎn)換結(jié)果和配置信息。
• 串行LVDS I/O模式：采用差分信號對傳輸信息，數(shù)據(jù)總線包括SCKI、SDI、SCKO和SDO。同樣在數(shù)據(jù)事務(wù)窗口內(nèi)進行配置和數(shù)據(jù)傳輸，支持高達250MHz（500Mbps）的SCKI頻率。

四、應(yīng)用場景與電路設(shè)計

4.1 應(yīng)用場景

LTC2335 - 18適用于多種需要寬動態(tài)范圍和高精度的高壓應(yīng)用，如可編程邏輯控制器、工業(yè)過程控制、電力線監(jiān)測以及測試測量等領(lǐng)域。

4.2 電路設(shè)計要點

• 輸入驅(qū)動電路：為了確保采樣電容在采集期間能夠穩(wěn)定到新的輸入引腳電壓，外部電路應(yīng)能夠提供足夠的電流。對于高阻抗源，建議使用緩沖放大器來驅(qū)動模擬輸入，以保證采集期間的充分穩(wěn)定，并優(yōu)化ADC的線性度和失真性能。
• 輸入濾波：為了減少輸入信號的噪聲和失真，應(yīng)在緩沖放大器之前使用低帶寬濾波器進行濾波。在緩沖器輸出端，由600Ω采樣開關(guān)導(dǎo)通電阻和40pF采樣電容組成的低通RC濾波器可限制輸入帶寬，同時選擇低噪聲密度的緩沖放大器可減少SNR的下降。
• 緩沖任意和全差分模擬輸入信號：由于LTC2335 - 18具有寬共模輸入范圍和高CMRR，可在信號源和ADC輸入引腳之間插入兩個單位增益緩沖器，以確保采樣網(wǎng)絡(luò)在ADC采集時間內(nèi)達到18位分辨率。
• 緩沖單端模擬輸入信號：當單端信號參考電平具有低阻抗且不需要緩沖時，可使用簡化的電路，減少元件數(shù)量、功耗和由于驅(qū)動噪聲引起的SNR下降。

五、總結(jié)

LTC2335 - 18以其高精度、高動態(tài)性能、寬輸入范圍、靈活的接口和低功耗等優(yōu)點，成為了眾多高壓應(yīng)用的理想選擇。在實際設(shè)計中，工程師們需要根據(jù)具體的應(yīng)用需求合理選擇參考配置、輸入驅(qū)動電路和濾波方案，同時注意PCB布局和時序控制，以充分發(fā)揮這款A(yù)DC的性能優(yōu)勢。希望通過本文的介紹，能幫助大家更好地了解和應(yīng)用LTC2335 - 18，在電子設(shè)計中取得更出色的成果。大家在使用過程中有什么疑問或者獨特的經(jīng)驗，歡迎在評論區(qū)分享交流。