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      正點(diǎn)原子開(kāi)拓者FPGA視頻:Quartus II軟件的使用

      電子硬件DIY視頻 ? 來(lái)源：電子硬件DIY視頻 ? 2019-09-19 07:07 ? 次閱讀
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      Quartus II 是Altera公司的綜合性CPLD/FPGA開(kāi)發(fā)軟件，原理圖、VHDL、VerilogHDL以及AHDL（Altera Hardware 支持Description Language）等多種設(shè)計(jì)輸入形式，內(nèi)嵌自有的綜合器以及仿真器，可以完成從設(shè)計(jì)輸入到硬件配置的完整PLD設(shè)計(jì)流程。

      Quartus II可以在Windows、Linux以及Unix上使用，除了可以使用Tcl腳本完成設(shè)計(jì)流程外，提供了完善的用戶圖形界面設(shè)計(jì)方式。具有運(yùn)行速度快，界面統(tǒng)一，功能集中，易學(xué)易用等特點(diǎn)。

      聲明：本文內(nèi)容及配圖由入駐作者撰寫(xiě)或者入駐合作網(wǎng)站授權(quán)轉(zhuǎn)載。文章觀點(diǎn)僅代表作者本人，不代表電子發(fā)燒友網(wǎng)立場(chǎng)。文章及其配圖僅供工程師學(xué)習(xí)之用，如有內(nèi)容侵權(quán)或者其他違規(guī)問(wèn)題，請(qǐng)聯(lián)系本站處理。 舉報(bào)投訴
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        本帖最后由 100dongdong 于 2020-5-16 23:48 編輯 正點(diǎn)原子FPGA開(kāi)拓者開(kāi)發(fā)板，Intel（Altera） FPG
        發(fā)表于 05-16 23:35

        正點(diǎn)原子開(kāi)拓者FPGA開(kāi)發(fā)板資料連載第二十一章 VGA圖片顯示實(shí)驗(yàn)

        1）實(shí)驗(yàn)平臺(tái)：正點(diǎn)原子開(kāi)拓者FPGA 開(kāi)發(fā)板2）摘自《開(kāi)拓者FPGA開(kāi)發(fā)指南》關(guān)注官方微信號(hào)公眾
        發(fā)表于 08-05 11:12

        正點(diǎn)原子開(kāi)拓者FPGA開(kāi)發(fā)板資料連載第四十三章 以太網(wǎng)通信實(shí)驗(yàn)（2）

        1）實(shí)驗(yàn)平臺(tái)：正點(diǎn)原子開(kāi)拓者FPGA 開(kāi)發(fā)板2）摘自《開(kāi)拓者FPGA開(kāi)發(fā)指南》關(guān)注官方微信號(hào)公眾
        發(fā)表于 08-24 16:41

        正點(diǎn)開(kāi)拓者FPGA開(kāi)發(fā)板使用問(wèn)題

        求問(wèn)各位大佬，剛剛?cè)腴T(mén)正點(diǎn)開(kāi)拓者FPGA開(kāi)發(fā)板，用板載pcf8591采集信號(hào)發(fā)生器單一頻率正弦波，再用ip核做fft，結(jié)果和matlab上fft不一樣，請(qǐng)問(wèn)是怎么回事呢？
        發(fā)表于 01-04 09:34

        正點(diǎn)原子開(kāi)拓者FPGA Qsys視頻：uC/GUI圖片/數(shù)字顯示實(shí)驗(yàn)

        該課程是正點(diǎn)原子團(tuán)隊(duì)編寫(xiě)，詳細(xì)講解了quartus中的qsys。也可以從我頭像點(diǎn)進(jìn)去看FPGA verilog相關(guān)的視頻。
        的頭像 發(fā)表于 09-18 07:04 ?2768次閱讀
        <b class='flag-5'>正點(diǎn)</b><b class='flag-5'>原子</b><b class='flag-5'>開(kāi)拓者</b><b class='flag-5'>FPGA</b> Qsys<b class='flag-5'>視頻</b>：uC/GUI圖片/數(shù)字顯示實(shí)驗(yàn)

        正點(diǎn)原子開(kāi)拓者FPGA開(kāi)發(fā)板配套視頻：FPGA是什么

        正點(diǎn)原子開(kāi)拓者FPGA開(kāi)發(fā)板配套視頻
        的頭像 發(fā)表于 09-04 06:02 ?2940次閱讀
        <b class='flag-5'>正點(diǎn)</b><b class='flag-5'>原子</b><b class='flag-5'>開(kāi)拓者</b><b class='flag-5'>FPGA</b>開(kāi)發(fā)板配套<b class='flag-5'>視頻</b>：<b class='flag-5'>FPGA</b>是什么

        正點(diǎn)原子開(kāi)拓者FPGA開(kāi)發(fā)板配套視頻（1）

        正點(diǎn)原子開(kāi)拓者FPGA開(kāi)發(fā)板配套視頻
        的頭像 發(fā)表于 09-04 06:00 ?2759次閱讀
        <b class='flag-5'>正點(diǎn)</b><b class='flag-5'>原子</b><b class='flag-5'>開(kāi)拓者</b><b class='flag-5'>FPGA</b>開(kāi)發(fā)板配套<b class='flag-5'>視頻</b>（1）

        正點(diǎn)原子開(kāi)拓者FPGA視頻:Modelsim軟件的使用

        、和單一內(nèi)核仿真技術(shù)，編譯仿真速度快，編譯的代碼與平臺(tái)無(wú)關(guān)，便于保護(hù)IP核，個(gè)性化的圖形界面和用戶接口，為用戶加快調(diào)錯(cuò)提供強(qiáng)有力的手段，是FPGA/ASIC設(shè)計(jì)的首選仿真軟件。
        的頭像 發(fā)表于 09-19 07:09 ?3397次閱讀
        <b class='flag-5'>正點(diǎn)</b><b class='flag-5'>原子</b><b class='flag-5'>開(kāi)拓者</b><b class='flag-5'>FPGA</b><b class='flag-5'>視頻</b>:Modelsim<b class='flag-5'>軟件</b>的使用

        正點(diǎn)原子開(kāi)拓者FPGA視頻:SignalTap II軟件的使用

        SignalTap II全稱(chēng)SignalTap II Logic Analyzer是第二代系統(tǒng)級(jí)調(diào)試工具，可以捕獲和顯示實(shí)時(shí)信號(hào)，觀察在系統(tǒng)設(shè)計(jì)中的硬件和軟件之間的互相作用。Quartus
        的頭像 發(fā)表于 09-18 07:10 ?2441次閱讀
        <b class='flag-5'>正點(diǎn)</b><b class='flag-5'>原子</b><b class='flag-5'>開(kāi)拓者</b><b class='flag-5'>FPGA</b><b class='flag-5'>視頻</b>:SignalTap <b class='flag-5'>II</b><b class='flag-5'>軟件</b>的使用

        正點(diǎn)原子開(kāi)拓者FPGA Qsys視頻：uCOS II任務(wù)管理與時(shí)間管理（2）

        該課程是正點(diǎn)原子團(tuán)隊(duì)編寫(xiě)，詳細(xì)講解了quartus中的qsys。也可以從我頭像點(diǎn)進(jìn)去看FPGA verilog相關(guān)的視頻。
        的頭像 發(fā)表于 09-17 07:10 ?2078次閱讀
        <b class='flag-5'>正點(diǎn)</b><b class='flag-5'>原子</b><b class='flag-5'>開(kāi)拓者</b><b class='flag-5'>FPGA</b> Qsys<b class='flag-5'>視頻</b>：uCOS <b class='flag-5'>II</b>任務(wù)管理與時(shí)間管理（2）

        正點(diǎn)原子開(kāi)拓者FPGA Qsys視頻：Nios II彩條顯示實(shí)驗(yàn)

        Nios Ⅱ處理器具有完善的軟件開(kāi)發(fā)套件，包括編譯器、集成開(kāi)發(fā)環(huán)境（IDE）、JTAG調(diào)試器、實(shí)時(shí)操作系統(tǒng)（RTOS）和TCP/IP協(xié)議棧。設(shè)計(jì)者能夠用Altera Quartus Ⅱ開(kāi)發(fā)軟件
        的頭像 發(fā)表于 09-17 07:02 ?1939次閱讀
        <b class='flag-5'>正點(diǎn)</b><b class='flag-5'>原子</b><b class='flag-5'>開(kāi)拓者</b><b class='flag-5'>FPGA</b> Qsys<b class='flag-5'>視頻</b>：Nios <b class='flag-5'>II</b>彩條顯示實(shí)驗(yàn)

        正點(diǎn)原子開(kāi)拓者FPGA Qsys視頻：自定義IP核之?dāng)?shù)碼管(2)

        該課程是正點(diǎn)原子團(tuán)隊(duì)編寫(xiě)，詳細(xì)講解了quartus中的qsys。也可以從我頭像點(diǎn)進(jìn)去看FPGA verilog相關(guān)的視頻。
        的頭像 發(fā)表于 09-16 07:07 ?3526次閱讀
        <b class='flag-5'>正點(diǎn)</b><b class='flag-5'>原子</b><b class='flag-5'>開(kāi)拓者</b><b class='flag-5'>FPGA</b> Qsys<b class='flag-5'>視頻</b>：自定義IP核之?dāng)?shù)碼管(2)

        正點(diǎn)原子開(kāi)拓者FPGA Qsys視頻：PIO按鍵控制LED

        該課程是正點(diǎn)原子團(tuán)隊(duì)編寫(xiě)，詳細(xì)講解了quartus中的qsys。也可以從我頭像點(diǎn)進(jìn)去看FPGA verilog相關(guān)的視頻。
        的頭像 發(fā)表于 09-16 07:06 ?3556次閱讀
        <b class='flag-5'>正點(diǎn)</b><b class='flag-5'>原子</b><b class='flag-5'>開(kāi)拓者</b><b class='flag-5'>FPGA</b> Qsys<b class='flag-5'>視頻</b>：PIO按鍵控制LED

        正點(diǎn)原子開(kāi)拓者FPGA Qsys視頻：PIO IRQ

        該課程是正點(diǎn)原子團(tuán)隊(duì)編寫(xiě)，詳細(xì)講解了quartus中的qsys。也可以從我頭像點(diǎn)進(jìn)去看FPGA verilog相關(guān)的視頻。
        的頭像 發(fā)表于 09-16 07:04 ?2230次閱讀
        <b class='flag-5'>正點(diǎn)</b><b class='flag-5'>原子</b><b class='flag-5'>開(kāi)拓者</b><b class='flag-5'>FPGA</b> Qsys<b class='flag-5'>視頻</b>：PIO IRQ

        正點(diǎn)原子開(kāi)拓者FPGA Qsys視頻:Hello World

        該課程是正點(diǎn)原子團(tuán)隊(duì)編寫(xiě)，詳細(xì)講解了quartus中的qsys。也可以從我頭像點(diǎn)進(jìn)去看FPGA verilog相關(guān)的視頻。
        的頭像 發(fā)表于 09-12 07:09 ?4458次閱讀
        <b class='flag-5'>正點(diǎn)</b><b class='flag-5'>原子</b><b class='flag-5'>開(kāi)拓者</b><b class='flag-5'>FPGA</b> Qsys<b class='flag-5'>視頻</b>:Hello World