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      PCB終端匹配電阻設(shè)計(jì)

      2017-04-27 | pdf | 292KB | 次下載 | 1積分

      資料介紹

      　　匹配電阻位置的變化對信號波形的影響

      　　3.1 并聯(lián)終端匹配情況－匹配電阻位于接收端之前如圖 1a 所示。

      　　我們構(gòu)建了三組終端匹配的結(jié)構(gòu)。第一組結(jié)構(gòu)中終端匹配電阻直接與接收器相連（理想狀態(tài)，圖 1a 上）；第二組結(jié)構(gòu)中終端匹配電阻位于距離終端 0.5in.處（圖 1a 中），即有 0.5in.的傳輸線沒有被匹配；第三組結(jié)構(gòu)中終端匹配電阻位于終端 1in.處（圖 1a 下）。驅(qū)動(dòng)器和接收器模型選用 Hyperlynx7.0 自帶的簡易 IBIS 模型：CMOS，3.3V，F(xiàn)AST （該模型驅(qū)動(dòng)波形的上升時(shí)間約為 1.5ns）。傳輸線特征阻抗為 92.9 歐姆，傳輸線總長為 20in. （約為 0.5m 左右），總的延遲時(shí)間為 2.975ns，線寬為 6mil。驅(qū)動(dòng)信號的頻率為 100MHZ，

      匹配電阻
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