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I2c/SPI串行接口標(biāo)準(zhǔn)輸出低功耗從1赫茲到5千赫的輸出數(shù)據(jù)率。設(shè)備可配置為通過兩個(gè)獨(dú)立的慣性喚醒/自由下降事件以及設(shè)備本身的位置生成中斷信號(hào)。具有集成的32級(jí)先進(jìn)先出（FIFO）緩沖區(qū)，允許用戶存儲(chǔ)主機(jī)處理器干預(yù)降低溫度范圍從-40°C到+85°C的數(shù)據(jù)。
設(shè)備核心通過VDD線路供電，而I/O墊通過
VDLO LO線。電源去耦電容器（100 nF陶瓷，10 pF鋁）應(yīng)盡可能靠近設(shè)備的插腳14（常見設(shè)計(jì)實(shí)踐）。所有電壓和接地電源必須同時(shí)存在，以使IC具有適當(dāng)?shù)男阅埽▍⒁妶D5）?？梢砸瞥３講dd的vdd。在這種情況下，測(cè)量鏈斷電。
設(shè)備的功能和測(cè)量的加速度數(shù)據(jù)是可選的，可以通過I？C或SPI接口訪問。使用I？C時(shí)，CS必須系在高處。
不使用的ADC1、Ad2、DC2和ADC3可以被浮置或保持連接到VDD或GNDE功能，兩個(gè)中斷引腳It1和It2的閾值和定時(shí)可以由用戶通過C/SPI接口完全編程。
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