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      電子發(fā)燒友網(wǎng)>電子資料下載>IC datasheet pdf>SN74LVC2G125-Q1,pdf(Dual Bus B

      SN74LVC2G125-Q1,pdf(Dual Bus B

      2010-07-19 | rar | 139 | 次下載 | 3積分

      資料介紹

      The SN74LVC2G125-Q1 is a dual bus buffer gate designed for 1.65-V to 5.5-V VCC operation. This device features dual line drivers with 3-state outputs. The outputs are disabled when the associated output-enable (OE) input is high.

      To ensure the high-impedance state during power up or power down, OE should be tied to VCC through a pullup resistor; the minimum value of the resistor is determined by the current-sinking capability of the driver.

      This device is fully specified for partial-power-down applications using Ioff. The Ioff circuitry disables the outputs, preventing damaging current backflow through the device when it is powered down.

      bus
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