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為了更好地支持網(wǎng)絡(luò)安全，IP碎片重組是IDS/IPS中一個(gè)必不可少的操作。由于采用軟件實(shí)現(xiàn)IP碎片重組的速度很低，很難達(dá)到高速接口的線速處理要求，所以在高速IDS/IPS上應(yīng)采用硬件處理的機(jī)制。本文實(shí)現(xiàn)了一個(gè)基于Altera FPGA的IP碎片重組模塊，可解決IDS/IPS處理IP碎片重組遇到的性能瓶頸問(wèn)題，同時(shí)提供了一種IP碎片攻擊的預(yù)警機(jī)制，其特點(diǎn)是可以根據(jù)設(shè)備資源的使用情況，提供不同程度的警報(bào)信息。借助于QuatusII綜合布線工具，經(jīng)面向硬件電路的仿真驗(yàn)證，本文的方法可實(shí)現(xiàn)OC-48接口（2.5Gb/s）上線速分組的IP碎片重組，并具有硬件開(kāi)銷小，可擴(kuò)展性好的特點(diǎn)。
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