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      電子發(fā)燒友網(wǎng)>電子資料下載>可編程邏輯>FPGA/ASIC>融合DSP設(shè)計(jì)與FPGA硬件實(shí)現(xiàn)

      融合DSP設(shè)計(jì)與FPGA硬件實(shí)現(xiàn)

      2011-05-11 | pdf | 110 KB | 次下載 | 免費(fèi)

      資料介紹

      ?

      System Generator 工具由 MathWorks 與 Xilinx 合作開(kāi)發(fā)而成，DSP 設(shè)計(jì)人員可使用 MATLAB 和Simulink 工具在 FPGA 內(nèi)進(jìn)行開(kāi)發(fā)和仿真來(lái)完善 DSP 設(shè)計(jì)。
      該工具為系統(tǒng)級(jí) DSP 設(shè)計(jì)與 FPGA 硬件實(shí)現(xiàn)的融合起到了橋梁作用，而這一點(diǎn)對(duì)于高性能 DSP 系統(tǒng)的設(shè)計(jì)者來(lái)說(shuō)，正是至關(guān)重要的。這些高性能 DSP 系統(tǒng)包括：3G 無(wú)線基站、VoIP 和 DVB 設(shè)備。通過(guò)使用 Xilinx 的 Virtex-II 體系結(jié)構(gòu)，DSP 的設(shè)計(jì)人員可獲得每秒 6,000 億次 MAC 運(yùn)算的 DSP 性能。
      dsp FPGA
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