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設(shè)計(jì)與驗(yàn)證，很不錯(cuò)的一本書，《設(shè)計(jì)與驗(yàn)證》以實(shí)例講解的方式對(duì)HDL語(yǔ)言的設(shè)計(jì)方法進(jìn)行介紹。全書共分9章，第1章至第3章主要介紹了Verilog HDL語(yǔ)言的基本概念、設(shè)計(jì)流程、語(yǔ)法及建模方式等內(nèi)容；第4章至第6章主要討論如何合理地使用Verilog HDL語(yǔ)言描述高性能的可綜合電路；第7章和第8章重點(diǎn)介紹了如何編寫測(cè)試激勵(lì)以及Verilog的仿真原理；第9章展望HDL語(yǔ)言的發(fā)展趨勢(shì)。
Verilog HDL
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