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      電子發(fā)燒友網(wǎng)>電子資料下載>可編程邏輯>FPGA/ASIC>Xilinx FPGA時鐘資源的學習筆記

      Xilinx FPGA時鐘資源的學習筆記

      2020-12-29 | rar | 0.22 MB | 次下載 | 免費

      資料介紹

      　　在Xilinx的FPGA中，時鐘網(wǎng)絡(luò)資源分為兩大類：全局時鐘資源和區(qū)域時鐘資源。

      　　全局時鐘資源是一種專用互連網(wǎng)絡(luò)，它可以降低時鐘歪斜、占空比失真和功耗，提高抖動容限。Xilinx的全局時鐘資源設(shè)計了專用時鐘緩沖與驅(qū)動結(jié)構(gòu)，從而使全局時鐘到達CLB、IOB和BRAM的延時最小。

      　　區(qū)域時鐘資源是獨立于全局時鐘網(wǎng)絡(luò)的。Xilinx的器件分成若干個時鐘區(qū)域，以Virtex-6為例，Virtex-6的最小器件有6個區(qū)域，最大器件有18個區(qū)域。它與全局時鐘不同，區(qū)域時鐘信號X只能驅(qū)動限定的時鐘區(qū)域。

      　　這里面提到區(qū)域時鐘的概念，需要解釋一下。Xilinx的FPGA器件是通過時鐘區(qū)域來管理時鐘網(wǎng)絡(luò)的，以Virtex-6為例，時鐘區(qū)域的大小固定為40個CLB 高，半個晶片寬。因此大尺寸的器件有更多的時鐘區(qū)域。如下圖所示，下圖中的FPGA器件一共包含6個時鐘區(qū)域，左側(cè)三個右側(cè)三個，從圖可以看出每個區(qū)域高度是2*20CLBs，區(qū)域?qū)挾仁前雮€FPGA芯片的寬度。中間是CMT時鐘管理模塊。

      FPGA 芯片 Xilinx
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