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      電子發(fā)燒友網(wǎng)>電子資料下載>可編程邏輯>FPGA/ASIC>使用FPGA實現(xiàn)RS232串口收發(fā)的仿真資料說明

      使用FPGA實現(xiàn)RS232串口收發(fā)的仿真資料說明

      2021-03-05 | rar | 0.06 MB | 次下載 | 免費

      資料介紹

      　　網(wǎng)上關(guān)于RS-232 的異步收發(fā)介紹得很多，最近沒事學(xué)著摸索用ModelSim 來做時序仿真，就結(jié)合網(wǎng)上的參考資料和自己的琢磨，做了這個東西。

      　　針對我這個小程序結(jié)合FPGA 的開發(fā)流程，主要走了以下幾步：

      　　1. 文本程序輸入（ Verilog HDL ）

      　　2. 功能仿真（ ModelSim，查看邏輯功能是否正確，要寫一個Test Bench）

      　　3. 綜合（ Synplify Pro，程序綜合成網(wǎng)表）

      　　4. 布局布線（ Quartus II ，根據(jù)我選定的FPGA 器件型號，將網(wǎng)表布到器件中，并估算出相應(yīng)的時延）

      　　5. 時序仿真（ ModelSim，根據(jù)時延做進一步仿真）

      FPGA RS232 布局
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