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? n邏輯綜合：決定設(shè)計電路邏輯門的相互連接。 n邏輯綜合的目的：決定電路門級結(jié)構(gòu)、尋求時序和與面積的平衡、尋求功耗與時序的平衡、增強電路的測試性。 n邏輯綜合的過程：首先，綜合工具分析HDL代碼，用一種模型(GTECH) ，對HDL進行映射，這個模型是與技術(shù)庫無關(guān)的；然后，在設(shè)計者的控制下，對這個模型進行邏輯優(yōu)化；最后一步，進行邏輯映射和門級優(yōu)化，將邏輯根據(jù)約束，映射為專門的技術(shù)目標單元庫（target cell library）中的cell，形成了綜合后的網(wǎng)表
ASIC芯片
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