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This application note presents the design of a
parity generator using Philips
Semiconductors PLD, PLS153 or PLS153A,
which enables the designers to customize
their circuits in the form of “sum- of-products”.
The PLA architecture and the 10
bi-directional I/O’s make it possible to
implement the 9-bit parity generator/checker
in one chip without any external wiring
between pins.
parity generator using Philips
Semiconductors PLD, PLS153 or PLS153A,
which enables the designers to customize
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The PLA architecture and the 10
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設(shè)計(jì)
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