資料介紹
預(yù)置(PRE)或清零(CLR)輸入的低電平將設(shè)置或重置輸出,而與其他輸入的電平無關(guān)。當PRE和CLR是無效的(高),在數(shù)據(jù)(D)輸入滿足設(shè)置時間要求的數(shù)據(jù)被轉(zhuǎn)移到上的時鐘脈沖的正沿輸出。時鐘觸發(fā)發(fā)生在一個電壓電平,并且與時鐘脈沖的上升時間沒有直接關(guān)系。在保持時間間隔之后,D輸入端的數(shù)據(jù)可以在不影響輸出端的電平的情況下改變。為了更好地優(yōu)化觸發(fā)器的更高的頻率,CLR輸入覆蓋PRE輸入時,他們都是低的。
觸發(fā)器
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