資料介紹
SN65LVDS301 串行器器件將 27 個(gè)并行數(shù)據(jù)輸入轉(zhuǎn)換 為 1、2 或 3 個(gè)次低壓差分信號(hào) (SubLVDS) 串行輸 出。它從并行 CMOS 輸入接口加載具有 24 個(gè)像素位 和 3 個(gè)控制位的移位寄存器。除了 27 個(gè)數(shù)據(jù)位,該器 件還在 30 位數(shù)據(jù)字中添加了一個(gè)奇偶校驗(yàn)位和兩個(gè)保 留位。每個(gè)字通過像素時(shí)鐘 (PCLK) 鎖存到器件中。奇 偶校驗(yàn)位(奇校驗(yàn))使接收器能夠檢測 single-bit 錯(cuò) 誤。串行移位寄存器的上傳速率為像素時(shí)鐘數(shù)據(jù)速率的 30、15 或 10 倍,具體取決于所使用的串行鏈路數(shù)。 像素時(shí)鐘的一個(gè)副本會(huì)通過單獨(dú)的差分輸出進(jìn)行輸出。 FPC 布線通常將 SN65LVDS301 與顯示屏互連。與并 行信號(hào)相比,LVDS301 輸出顯著降低了 20dB 以上互 連的 EMI。器件本身的電磁輻射非常低,符合 SAE J1752/3 'M' 技術(shù)規(guī)范。
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