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      電子發(fā)燒友網>電子資料下載>電子資料>CDCL1810A 1.8V、10 輸出高性能時鐘分配器數(shù)據(jù)表

      CDCL1810A 1.8V、10 輸出高性能時鐘分配器數(shù)據(jù)表

      2024-08-23 | pdf | 1.59MB | 次下載 | 免費

      資料介紹

      CDCL1810A是一款高性能時鐘分配器?？?a target='_blank' class='arckwlink_none'>編程分頻器（P0和P1）為輸出輸入頻率比的設置提供了較高的靈活性：Four=FiN/P，其中P(P0或P1)=1、2、4、5、8、10、16、20、32、40、80。CDCL1810A支持1個差分LVDS時鐘輸入以及總共10個差分CML輸出。CML輸出為交流耦合時，可兼容LVDS接收器。在認真遵守輸入電壓擺幅和共模電壓限制的情況下，CDCL1810A可支持引腳配置和功能中概述的單端時鐘輸入。
      時鐘 分配器
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