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本文詳細(xì)闡述了在開發(fā)PCI 數(shù)據(jù)采集卡過程中，本地總線和PCI 總線之間基于FIFO
的DMA 模塊設(shè)計，包括其硬件電路設(shè)計和WDM 驅(qū)動程序的編寫。
PCI 總線是先進(jìn)的高性能32/64 位局部總線，可同時支持多組外圍設(shè)備，不受制于處理
器，數(shù)據(jù)吞吐量大（32 位時峰值高達(dá)132MB/S）。連接到PCI 總線上的設(shè)備分為主設(shè)備和從設(shè)備兩類，接口設(shè)計成為PCI 總線與設(shè)備進(jìn)行溝通的橋梁，但是PCI 總線的協(xié)議十分復(fù)雜，目前實現(xiàn)PCI 接口的有效方案分兩種：使用可編程邏輯器件和使用專用總線接口器件。
采用可編程邏輯器件實現(xiàn)PCI 接口的最大好處是比較靈活，作者目前選擇的是Altera
公司Cyclone 系列FPGA，使用Verilog HDL,實現(xiàn)了PCI 總線接口。該接口包含了PCI Slave，PCI Master，PCI Arbiter 和DMA。PCI 總線遵循PCI Local Bus Version 2.3 標(biāo)準(zhǔn)，33MHz工作頻率，32-bit 數(shù)據(jù)位寬，3.3V 工作電壓。對于多種主板具有很好的兼容性
的DMA 模塊設(shè)計，包括其硬件電路設(shè)計和WDM 驅(qū)動程序的編寫。
PCI 總線是先進(jìn)的高性能32/64 位局部總線，可同時支持多組外圍設(shè)備，不受制于處理
器，數(shù)據(jù)吞吐量大（32 位時峰值高達(dá)132MB/S）。連接到PCI 總線上的設(shè)備分為主設(shè)備和從設(shè)備兩類，接口設(shè)計成為PCI 總線與設(shè)備進(jìn)行溝通的橋梁，但是PCI 總線的協(xié)議十分復(fù)雜，目前實現(xiàn)PCI 接口的有效方案分兩種：使用可編程邏輯器件和使用專用總線接口器件。
采用可編程邏輯器件實現(xiàn)PCI 接口的最大好處是比較靈活，作者目前選擇的是Altera
公司Cyclone 系列FPGA，使用Verilog HDL,實現(xiàn)了PCI 總線接口。該接口包含了PCI Slave，PCI Master，PCI Arbiter 和DMA。PCI 總線遵循PCI Local Bus Version 2.3 標(biāo)準(zhǔn)，33MHz工作頻率，32-bit 數(shù)據(jù)位寬，3.3V 工作電壓。對于多種主板具有很好的兼容性
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