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代碼

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代碼就是程序員用開發(fā)工具所支持的語言寫出來的源文件，是一組由字符、符號(hào)或信號(hào)碼元以離散形式表示信息的明確的規(guī)則體系。

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代碼技術(shù)

如何加速PCIe仿真

? 我們?cè)谶M(jìn)行PCIe RTL仿真時(shí)，由于PCIe ltssm協(xié)商過程比較復(fù)雜，導(dǎo)致PCIe ltssm進(jìn)入L0狀態(tài)所花費(fèi)的時(shí)間比較長（大概在20~60...

2023-08-17 標(biāo)簽：寄存器仿真服務(wù)器 2.8k 0

嵌入式內(nèi)存管理介紹

????任何程序運(yùn)行起來都需要分配內(nèi)存空間存放該進(jìn)程的資源信息的，C程序也不例外。C程序中的變量、常量、函數(shù)、代碼等等的信息所存放的區(qū)域都有所不同，不同...

2023-08-17 標(biāo)簽：嵌入式數(shù)據(jù)C語言 2.2k 0

C語言中函數(shù)的基本知識(shí)

函數(shù)是C語言中的基本構(gòu)建塊之一，它允許我們將代碼組織成可重用、模塊化的單元。

2023-08-16 標(biāo)簽：C語言程序函數(shù) 1k 0

C語言中預(yù)定義宏的用法和使用場景

在C語言中，預(yù)定義宏是由編譯器提供的一組特殊標(biāo)識(shí)符，可以在程序中直接使用，無需進(jìn)行額外的定義。

2023-08-16 標(biāo)簽：C語言函數(shù)代碼 986 0

分享50條經(jīng)典的Python一行代碼

今天浩道跟大家分享python學(xué)習(xí)過程中非常經(jīng)典的50條一行代碼，讓大家體驗(yàn)它簡潔而功能強(qiáng)大的特點(diǎn)。同時(shí)給大家分享號(hào)主收集到的所有關(guān)于python的電子...

2023-08-16 標(biāo)簽：Linux 網(wǎng)絡(luò)通信代碼 1.7k 0

談?wù)労蠖思軜?gòu)的演進(jìn)過程：N-Layered和DDD架構(gòu)介紹

在本文中，我們討論了 N-layered、DDD、六邊形、洋蔥和清潔架構(gòu)。這些只是眾多存在的架構(gòu)中的一部分，是一些比較出名的架構(gòu)。你可能還聽說過 BCE...

2023-08-16 標(biāo)簽：嵌入式代碼 MVC 1.3k 0

如何解決引入注冊(cè)機(jī)制問題

問題描述 ????在使用定時(shí)器的過程中最令人苦惱的就是，定義flag，holdtime，每用一次定義就會(huì)導(dǎo)致中斷函數(shù)中標(biāo)志位滿天飛，時(shí)間變量在程序中隨處...

2023-08-16 標(biāo)簽：相機(jī)定時(shí)器函數(shù) 1.4k 0

FPGA的Verilog代碼編寫規(guī)范

　　注：以R起頭的是對(duì)編寫Verilog代碼的IP設(shè)計(jì)者所做的強(qiáng)制性規(guī)定，以G起頭的條款是建議采用的規(guī)范。每個(gè)設(shè)計(jì)者遵守本規(guī)范可鍛煉命名規(guī)范性。

2023-08-15 標(biāo)簽：fpga Verilog RTL 3.7k 0

FPGA HDL代碼實(shí)現(xiàn)過程

小編在本節(jié)完整給出一個(gè)設(shè)計(jì)過程，可利用ISE或Vivado硬件編程軟件實(shí)現(xiàn)。

2023-08-15 標(biāo)簽：fpga 邏輯電路 HDL 3.4k 0

介紹一款簡單強(qiáng)大的時(shí)序圖繪制工具

Wavedrom 是一款功能強(qiáng)大且簡單易用的文本轉(zhuǎn)圖表工具，被廣泛應(yīng)用于生成時(shí)序圖、波形圖等交互式波形。其特點(diǎn)在于使用簡單的文本語法，使得開發(fā)人員能夠以...

2023-08-15 標(biāo)簽：信號(hào)時(shí)鐘時(shí)序圖 1.6萬 0

微前端在大數(shù)據(jù)產(chǎn)品中的應(yīng)用背景和應(yīng)用原理

? 導(dǎo)讀：本文由梯度科技前端研發(fā)部高級(jí)開發(fā)工程師賀信撰寫，主要介紹如何基于前沿開源的前端技術(shù)方案實(shí)現(xiàn)微前端在大數(shù)據(jù)平臺(tái)中的應(yīng)用落地，并對(duì)所取得的應(yīng)用效...

2023-08-14 標(biāo)簽：模塊前端代碼 2.3k 0

yolov5和YOLOX正負(fù)樣本分配策略

整體上在正負(fù)樣本分配中，yolov7的策略算是yolov5和YOLOX的結(jié)合。因此本文先從yolov5和YOLOX正負(fù)樣本分配策略分析入手，后引入到Y(jié)O...

2023-08-14 標(biāo)簽：源碼代碼 4.3k 0

nuere-簡單小巧快速的字符串解析庫

neure是一個(gè)簡單小巧的字符串解析庫, 我在開發(fā)aopt時(shí)為了優(yōu)化編譯時(shí)間而開發(fā)的替代regex的庫. 目前代碼架構(gòu)非常簡單, 性能上比regex更快...

2023-08-14 標(biāo)簽：字符串代碼編譯 1.2k 0

谷歌代碼編輯器Project IDX來了！

Code completion API - 在編寫代碼時(shí)提供代碼自動(dòng)完成建議。API 使用您正在編寫的代碼的上下文來提出建議。代碼完成 API 支持該 ...

2023-08-11 標(biāo)簽：模型代碼編輯器 1.9k 0

基于pid控制方法的操控遙控飛機(jī)實(shí)例

做控制時(shí)，大家經(jīng)常會(huì)有這樣的感受“代碼很豐滿，現(xiàn)實(shí)很骨感”，這是因?yàn)閷⒂?jì)算機(jī)指令轉(zhuǎn)移到實(shí)際硬件時(shí)，由于物體的慣性以及各種非理想化的因素影響，往往會(huì)出現(xiàn)實(shí)...

2023-08-11 標(biāo)簽：硬件 PID PID控制 3.4k 0

如何判斷鏈表是否有環(huán)

如何判斷鏈表是否有環(huán)？

2023-08-10 標(biāo)簽：指針代碼鏈表 1.2k 0

解析C語言斷言函數(shù)的使用

對(duì)于斷言，相信大家都不陌生，大多數(shù)編程語言也都有斷言這一特性。簡單地講，斷言就是對(duì)某種假設(shè)條件進(jìn)行檢查。在 C 語言中，斷言被定義為宏的形式（asse...

2023-08-08 標(biāo)簽：C語言編程語言程序 928 0

CompletableFuture異步多線程是真的優(yōu)雅

雖然 Future 以及相關(guān)使用方法提供了異步執(zhí)行任務(wù)的能力，但是對(duì)于結(jié)果的獲取卻是很不方便，我們必須使用Future.get()的方式阻塞調(diào)用線程，或...

2023-08-07 標(biāo)簽：代碼異步線程 1.4k 0

堆棧內(nèi)存和堆內(nèi)存之間的區(qū)別

編寫有效的代碼需要了解堆棧和堆內(nèi)存，這使其成為學(xué)習(xí)編程的重要組成部分。不僅如此，新程序員或職場老手都應(yīng)該完全熟悉堆棧內(nèi)存和堆內(nèi)存之間的區(qū)別，以便編寫有效...

2023-08-07 標(biāo)簽：計(jì)算機(jī)內(nèi)存 JAVA 1.2k 0

Git的工作原理和基本用法

本文圖解Git中的最常用命令。如果你稍微理解Git的工作原理，這篇文章能夠讓你理解的更透徹。

2023-08-07 標(biāo)簽：文件命令代碼 1.3k 0

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Protues

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Proteus軟件是英國Lab Center Electronics公司出版的EDA工具軟件（該軟件中國總代理為廣州風(fēng)標(biāo)電子技術(shù)有限公司）。它不僅具有其它EDA工具軟件的仿真功能，還能仿真單片機(jī)及外圍器件。
靜電防護(hù)

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為防止靜電積累所引起的人身電擊、火災(zāi)和爆炸、電子器件失效和損壞，以及對(duì)生產(chǎn)的不良影響而采取的防范措施。其防范原則主要是抑制靜電的產(chǎn)生，加速靜電泄漏，進(jìn)行靜電中和等。
Altium Designer

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FPGA芯片

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FPGA（Field－Programmable Gate Array），即現(xiàn)場可編程門陣列，它是在PAL、GAL、CPLD等可編程器件的基礎(chǔ)上進(jìn)一步發(fā)展的產(chǎn)物。
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ArduBlock軟件是Arduino官方編程環(huán)境的第三方軟件，目前必須依附于Arduino軟件下運(yùn)行，區(qū)別于Arduino文本式編程環(huán)境，ArduBlock是以圖形化積木搭建的方式編程的，這樣的方式會(huì)使編程的可視化和交互性加強(qiáng)，編程門檻降低，即使沒有編程經(jīng)驗(yàn)的人也可以嘗試給Arduino控制器編寫程序。
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識(shí)別

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FPGA開發(fā)板在基于MCU、定制ASIC和體積龐大的電線束來實(shí)現(xiàn)引擎及控制電子的系統(tǒng)方案已發(fā)展至接近其技術(shù)和應(yīng)用極限，汽車工業(yè)正面臨新的設(shè)計(jì)挑戰(zhàn)。過去汽車電子產(chǎn)品的開發(fā)周期是漫長的，而許多汽車制造商現(xiàn)正致力于在更短的時(shí)間內(nèi)，裝備消費(fèi)者所需的新一代汽車。
PCB封裝

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pcb封裝就是把實(shí)際的電子元器件，芯片等的各種參數(shù)（比如元器件的大小，長寬，直插，貼片，焊盤的大小，管腳的長寬，管腳的間距等）用圖形方式表現(xiàn)出來，以便可以在畫pcb圖時(shí)進(jìn)行調(diào)用。
QUARTUS II

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Quartus II 是Altera公司推出的綜合性CPLD/FPGA開發(fā)軟件，軟件支持原理圖、VHDL、VerilogHDL以及AHDL（Altera Hardware 支持Description Language）等多種設(shè)計(jì)輸入形式，內(nèi)嵌自有的綜合器以及仿真器，可以完成從設(shè)計(jì)輸入到硬件配置的完整PLD設(shè)計(jì)流程。
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　　Artix-7 系列：相對(duì)于 Spartan-6 系列而言，Artix-7 系列功耗降低了一半，成本降低了 35%，采用小型化封裝、統(tǒng)一的 Virtex 系列架構(gòu)，能滿足低成本大批量市場的性能要求，這也正是此前 ASSP、ASIC 和低成本 FPGA 所針對(duì)的市場領(lǐng)域。
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面包板是由于板子上有很多小插孔，專為電子電路的無焊接實(shí)驗(yàn)設(shè)計(jì)制造的。由于各種電子元器件可根據(jù)需要隨意插入或拔出，免去了焊接，節(jié)省了電路的組裝時(shí)間，而且元件可以重復(fù)使用，所以非常適合電子電路的組裝、調(diào)試和訓(xùn)練。
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AXI是一種總線協(xié)議，該協(xié)議是ARM公司提出的AMBA3.0協(xié)議中最重要的部分，是一種面向高性能、高帶寬、低延遲的片內(nèi)總線。它的地址/控制和數(shù)據(jù)相位是分離的，支持不對(duì)齊的數(shù)據(jù)傳輸，同時(shí)在突發(fā)傳輸中，只需要首地址，同時(shí)分離的讀寫數(shù)據(jù)通道、并支持Outstanding傳輸訪問和亂序訪問，并更加容易進(jìn)行時(shí)序收斂。AXI是AMBA中一個(gè)新的高性能協(xié)議。
特性阻抗

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特性阻抗又稱特征阻抗，它不是直流電阻，屬于長線傳輸中的概念。特性阻抗是射頻傳輸線影響無線電波電壓、電流的幅值和相位變化的固有特性，等于各處的電壓與電流的比值，用V/I表示。在射頻電路中，電阻、電容、電感都會(huì)阻礙交變電流的流動(dòng)，合稱阻抗。電阻是吸收電磁能量的，理想電容和電感不消耗電磁能量。
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時(shí)鐘源用來為環(huán)形脈沖發(fā)生器提供頻率穩(wěn)定且電平匹配的方波時(shí)鐘脈沖信號(hào)。它通常由石英晶體振蕩器和與非門組成的正反饋振蕩電路組成，其輸出送至環(huán)形脈沖發(fā)生器。
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　　AD轉(zhuǎn)換采樣頻率指完成一次從模擬轉(zhuǎn)換到數(shù)字的AD轉(zhuǎn)換所需時(shí)間的倒數(shù)，模擬量可以是電壓、電流等電信號(hào)，也可以是壓力、溫度、濕度、位移、聲音等非電信號(hào)；而AD分辨率指數(shù)字量變化一個(gè)最小量時(shí)模擬信號(hào)的變化量。
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　　Kintex-7系列：Kintex-7 系列是一種新型 FPGA，能以不到 Virtex-6 系列一半的價(jià)格實(shí)現(xiàn)與其相當(dāng)性能，性價(jià)比提高了一倍，功耗降低了一半。
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