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IC設(shè)計(jì)，Integrated Circuit Design，或稱為集成電路設(shè)計(jì)，是電子工程學(xué)和計(jì)算機(jī)工程學(xué)的一個(gè)學(xué)科，其主要內(nèi)容是運(yùn)用專業(yè)的邏輯和電路設(shè)計(jì)技術(shù)設(shè)計(jì)集成電路。
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Vivado在前一段時(shí)間更新了2023.2版本，經(jīng)過一段時(shí)間的使用這個(gè)版本還是很絲滑的，用起來挺舒服。
2024-01-02 標(biāo)簽：IC設(shè)計(jì)仿真RTL 5.7k 0
一位臺(tái)灣工程師透露，大陸從臺(tái)灣挖高端IC人才很瘋狂
一位曾向紫光求職的臺(tái)灣工程師透露，紫光和合肥長(zhǎng)鑫不但握有華亞科工程師名單，而且早已透過電話和微信建立網(wǎng)絡(luò)，一個(gè)一個(gè)挖角，“華亞科的離職主管，都知道要挖誰(shuí)...
2017-03-23 標(biāo)簽：半導(dǎo)體產(chǎn)業(yè)IC設(shè)計(jì)半導(dǎo)體芯片 5.7k 0
模擬IC設(shè)計(jì)原理圖2：寄存器的原理和電路原理圖介紹
寄存器分為鎖存器、觸發(fā)器；是數(shù)字和模擬電路中的核心之一。
2023-10-30 標(biāo)簽：寄存器IC設(shè)計(jì)鎖存器 5.7k 0
引起信號(hào)干擾的原因多種多樣，而其中最容易被忽略的一個(gè)特定原因就是過孔。繼續(xù)閱讀了解如何通過強(qiáng)大的背鉆孔技術(shù)減少PCB設(shè)計(jì)過程中的信號(hào)失真。
2018-06-05 標(biāo)簽：ic設(shè)計(jì)synopsys 5.6k 0
Verilog HDL應(yīng)用及數(shù)字IC設(shè)計(jì)與流程概述
一、HDL的概念和特征 HDL，Hard Discrimination Language的縮寫，翻譯過來就是硬件描述語(yǔ)言。那么什么是硬件描述語(yǔ)言呢？為什...
2020-10-21 標(biāo)簽：fpgaIC設(shè)計(jì)Verilog HDL 5.3k 0
ESD保護(hù)電路的設(shè)計(jì)目的就是要避免工作電路成為ESD的放電通路而遭到損害，保證在任意兩芯片引腳之間發(fā)生的ESD，都有適合的低阻旁路將ESD電流引入電源線...
2019-03-04 標(biāo)簽：ic設(shè)計(jì)esd保護(hù)cmos電路 5.2k 0
數(shù)字IC設(shè)計(jì)中的建立時(shí)間和保持時(shí)間
??本文主要介紹了建立時(shí)間和保持時(shí)間。
2023-06-21 標(biāo)簽：IC設(shè)計(jì)數(shù)字信號(hào)觸發(fā)器 5.2k 0
虛擬現(xiàn)實(shí)與HMD硬件組成及分類盤點(diǎn)
目前的VR、AR廠商也非常樂于與主機(jī)系統(tǒng)廠商合作，比如Oculus與PC品牌廠商合作推出的“Ready PC Program”項(xiàng)目、華碩和Alienwa...
2016-05-04 標(biāo)簽：IC設(shè)計(jì)ARVR 5.1k 1
了解集成電路常見故障類型。掌握集成電路替換的原則、方法和注意事項(xiàng)。可以使維修或替換集成電路事半功倍
2012-04-01 標(biāo)簽：集成電路IC設(shè)計(jì) 5.1k 0
先來談靜電放電(ESD: Electrostatic Discharge)是什么？這應(yīng)該是造成所有電子元器件或集成電路系統(tǒng)造成過度電應(yīng)力破壞的主要元兇。...
2023-04-12 標(biāo)簽：電路IC設(shè)計(jì)靜電放電 5k 0
陶瓷封裝優(yōu)勢(shì)特點(diǎn)及工藝流程分享
芯片設(shè)計(jì)公司對(duì)其多目標(biāo)的IC需進(jìn)行快速封裝，其封裝能在不需繁雜的專業(yè)處理即可直接分析，甚至提供用戶進(jìn)行試用評(píng)價(jià)，在目前高可靠的封裝方面其首選是陶瓷封裝。
2023-04-18 標(biāo)簽：晶圓IC設(shè)計(jì) 4.9k 0
“聯(lián)發(fā)科技首屆校園軟件大賽”等你來挑戰(zhàn)！
聯(lián)發(fā)科技是全球IC設(shè)計(jì)領(lǐng)導(dǎo)廠商，專注于無線通訊及數(shù)字多媒體等技術(shù)領(lǐng)域。本公司提供的芯片整合系統(tǒng)解決方案，在無線通訊、高清數(shù)字電視、光儲(chǔ)存、DVD及藍(lán)光等...
2018-06-22 標(biāo)簽：ic設(shè)計(jì)無線通訊mediatek 4.8k 0
壓力主要控制刻蝕均勻性和刻蝕輪廓，同時(shí)也能影響刻蝕速率和選擇性。改變壓力會(huì)改變電子和離子的平均自由程(MFP),進(jìn)而影響等離子體和刻蝕速率的均勻性。
2023-04-17 標(biāo)簽：半導(dǎo)體IC設(shè)計(jì)刻蝕工藝 4.7k 0
先來談靜電放電(ESD: Electrostatic Discharge)是什么？這應(yīng)該是造成所有電子元器件或集成電路系統(tǒng)造成過度電應(yīng)力破壞的主要元兇。...
2023-04-12 標(biāo)簽：電路IC設(shè)計(jì)靜電放電 4.6k 0
回顧下功耗的定義及其組成部分并總結(jié)降低功耗的常用方案
隨著工藝節(jié)點(diǎn)的不斷發(fā)展（現(xiàn)在普遍是28nm,22nm,16nm,14nm,甚至有的都在做7nm）,芯片的性能需求越來越高，規(guī)模也越來越大
2023-06-29 標(biāo)簽：CMOS寄存器IC設(shè)計(jì) 4.6k 0
如何使用帶有模擬接地層(AGND)和功率接地層(PGND)的開關(guān)穩(wěn)壓器？這是許多開發(fā)人員在設(shè)計(jì)開關(guān)電源時(shí)會(huì)問的一個(gè)問題。一些開發(fā)人員已習(xí)慣于處理數(shù)字接地...
2019-04-10 標(biāo)簽：ic設(shè)計(jì)開關(guān)穩(wěn)壓器 4.4k 0
IC驅(qū)動(dòng)汽車車門自動(dòng)化的原理解析
大趨勢(shì)的產(chǎn)生離不開專用半導(dǎo)體芯片的鋪路。這些芯片需要跟隨先進(jìn)的電源管理概念，驅(qū)動(dòng)從LED等毫瓦級(jí)的負(fù)載到瞬間耗散功率輕易達(dá)到200W的大功率直流電機(jī)。此...
2019-01-11 標(biāo)簽：ic設(shè)計(jì)canbcd 4.4k 0
刻蝕是移除晶圓表面材料，達(dá)到IC設(shè)計(jì)要求的一種工藝過程?？涛g有兩種:一種為圖形 化刻蝕，這種刻蝕能將指定區(qū)域的材料去除，如將光刻膠或光刻版上的圖形轉(zhuǎn)移到...
2023-02-01 標(biāo)簽：MOSFETIC設(shè)計(jì)CMOS芯片 4.4k 0
具有動(dòng)態(tài)過流檢測(cè)功能的智能門鎖電機(jī)驅(qū)動(dòng)IC設(shè)計(jì)方案
電機(jī)堵轉(zhuǎn)檢測(cè)時(shí)間為100 ms。如果在啟動(dòng)后100 ms內(nèi)電機(jī)電流較高，則電機(jī)驅(qū)動(dòng)將自動(dòng)關(guān)閉。
2021-11-19 標(biāo)簽：集成電路IC設(shè)計(jì)智能門鎖 4.4k 0
關(guān)于 Tcl 在 Vivado中的應(yīng)用文章從 Tcl 的基本語(yǔ)法和在 Vivado 中的 應(yīng)用展開，繼上篇《用 Tcl 定制 Vivado 設(shè)計(jì)實(shí)現(xiàn)流程...
2023-05-05 標(biāo)簽：fpgaIC設(shè)計(jì)Xilinx 4.3k 0
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