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PCI-Express（peripheral component interconnect express）是一種高速串行計(jì)算機(jī)擴(kuò)展總線標(biāo)準(zhǔn)，它原來的名稱為“3GIO”，是由英特爾在2001年提出的，旨在替代舊的PCI，PCI-X和AGP總線標(biāo)準(zhǔn)。

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pcie技術(shù)

PCIe總線AC耦合及高速信號調(diào)整技術(shù)

本篇主要介紹PCIe總線的AC耦合電容、總線的去加重等高速信號調(diào)整技術(shù)。 AC耦合電容可以參考之前的文章《邏輯電平之差分互連AC耦合電容（7）》，本文主...

2020-12-22 標(biāo)簽：AC PCIe 耦合電容 1.6萬 0

XDMA/PCIE IP的定制和Block Design的搭建

上一篇內(nèi)容我們已經(jīng)對PCIE協(xié)議進(jìn)行了粗略的講解。那么不明白具體的PCIE協(xié)議，我們就不能在FPGA中使用PCIE來進(jìn)行高速數(shù)據(jù)傳輸了嗎？答案是否定的。...

2022-06-01 標(biāo)簽：fpga Xilinx PCIe 1.6萬 0

PCIe總線的三種錯誤報告方式

PCIe設(shè)備的配置空間中的狀態(tài)與控制寄存器如上圖所示，通過這些寄存器可以使能（或禁止）通過錯誤消息（Error Message）發(fā)送錯誤報告、查詢錯誤狀...

2018-08-23 標(biāo)簽：寄存器總線 PCIe 1.5萬 0

PCI-Express接口連接器知識分析

PCIe鏈路的最大寬度為×32，但是在實(shí)際應(yīng)用中，×32的鏈路寬度極少使用。在一個處理器系統(tǒng)中，一般提供×16的PCIe插槽，并使用PETp0~15、P...

2018-08-21 標(biāo)簽：連接器總線 PCIE 1.5萬 0

Intel至強(qiáng)W9-3495X和AMD銳龍線程撕裂者PRO 5000WX對比介紹

AMD這邊的杠把子則是銳龍線程撕裂者PRO 5995WX，7nm工藝，Zen3架構(gòu)，64核心128線程，32MB二級緩存，256MB三級緩存，基準(zhǔn)頻率2...

2023-02-27 標(biāo)簽：intel PCIe DDR4 1.5萬 0

基于FPGA的PCIe總線接口的DMA控制器的實(shí)現(xiàn)并進(jìn)行仿真驗(yàn)證

本文實(shí)現(xiàn)的基于FPGA的PCIe總線接口的DMA控制器是在Altera PHY IP和Synopsys Core IP的基礎(chǔ)上實(shí)現(xiàn)的，利用Syno...

2018-01-11 標(biāo)簽：fpga 控制器 pcie 1.5萬 0

驅(qū)動miniPCIE網(wǎng)絡(luò)模塊EC20硬件電路設(shè)計(jì)

EC20 R2.1 Mini PCIe-C 模塊是 PCI Express Mini Card 1.2 標(biāo)準(zhǔn)接口 LTE 模塊。本文章主要講解了如何驅(qū)動...

2023-09-15 標(biāo)簽：電路設(shè)計(jì)SIM卡網(wǎng)絡(luò)模塊 1.5萬 0

PCIe物理層實(shí)現(xiàn)了一對收發(fā)差分對，可以實(shí)現(xiàn)全雙工的通信方式

如上圖所示，PCIe物理層實(shí)現(xiàn)了一對收發(fā)差分對，因此可以實(shí)現(xiàn)全雙工的通信方式。需要注意的是，PCIe Spec只是規(guī)定了物理層需要實(shí)現(xiàn)的功能、性能與參數(shù)...

2018-05-31 標(biāo)簽：全雙工 PCIe 物理層 1.5萬 0

PCIE協(xié)議及PCIE體系結(jié)構(gòu)說明

系統(tǒng)軟件對PCIE總線進(jìn)行配置時，首先獲得BAR寄存器的初始化信息，之后根據(jù)處理器系統(tǒng)的配置，將合理的基地址寫入到相應(yīng)的BAR寄存器中，這個過程在BIO...

2023-03-22 標(biāo)簽：Link PCIe PCIE總線 1.4萬 0

PCIe Gen3/Gen4接收端鏈路均衡測試（上篇：理論篇）

在PCIe 3.0和4.0中的鏈路均衡技術(shù)相較于先前代要復(fù)雜得多，這樣一種動態(tài)均衡技術(shù)可以分為兩個方面進(jìn)行討論。

2020-04-07 標(biāo)簽：PCIe Gen4 PCIe Gen3 1.4萬 0

淺析PCIE總線信號分布及使用情況

PCI-Express簡稱PCI-E于2001年春季由Intel公司提出。隨后在2001年底，包括Intel、AMD、DELL、IBM在內(nèi)的20多家業(yè)...

2018-10-18 標(biāo)簽：總線 PCIE 1.4萬 0

PCIe總線的通信機(jī)制

那么為什么要分為Non-Posted和Posted兩種類型呢？對于Memory Writes來說，對效率要求較高，因此采用了Posted的方式。但是這并...

2018-04-24 標(biāo)簽：總線 PCIe 1.3萬 0

Xilinx-HTG系列FPGA開發(fā)板

板載最大支持32GB的DDR4（PL）端以及5GB DDR（PS端）。支持X16 PCIE接口，HTG-VSL1提供了三個Vita 57.4 FMC+...

2022-04-14 標(biāo)簽：fpga Xilinx PCIe 1.2萬 4

pcie4.0插在3.0的主板上會怎么樣

一、引言 PCI Express（PCIe）是一種通用的串行連接標(biāo)準(zhǔn)，用于計(jì)算機(jī)硬件設(shè)備之間的數(shù)據(jù)傳輸。自2003年首次推出以來，PCIe 接口已經(jīng)經(jīng)歷...

2024-07-10 標(biāo)簽：數(shù)據(jù)傳輸主板 PCIe 1.2萬 0

那為什么SSD要用PCIe接口？

和PCIe一樣，SATA也有獨(dú)立的發(fā)送和接收通道，但與PCIe工作模式不一樣：同一時間，只有一條道可以進(jìn)行數(shù)據(jù)傳輸，也就是說，你在一條道上發(fā)送數(shù)據(jù)，另外...

2018-06-25 標(biāo)簽：接口 SSD PCIe 1.2萬 0

超高速模擬開關(guān)芯片CH482/3/4/1/6概述

CH482是QPDT寬帶超速雙向模擬開關(guān)芯片，包含2個差分通道2:1 MUX(共4通道二選一)。

2022-09-06 標(biāo)簽：usb 模擬開關(guān)PCIe 1.2萬 1

一文讀懂PCIe 時鐘結(jié)構(gòu)

參考時鐘獨(dú)立，參考時鐘不需要穿越背板和連接器，從而使PCB設(shè)計(jì)變得更為簡單，使得架構(gòu)更加的靈活。

2023-05-29 標(biāo)簽：PCIe 1.2萬 0

PCIe協(xié)議概述、分類及架構(gòu)

最近幾期，我們將通過專欄的方式向大家介紹一個更加常用的高速接口——PCIe接口。"Peripheral Component Interconn...

2023-09-26 標(biāo)簽：接口計(jì)算機(jī)總線 1.2萬 0

一文詳解Linux PCI驅(qū)動框架

PCIe控制器驅(qū)動，各家的IP實(shí)現(xiàn)不一樣，驅(qū)動的差異可能會很大，單獨(dú)分析一個驅(qū)動畢竟只是個例，應(yīng)該去掌握背后的通用框架；

2021-03-02 標(biāo)簽：控制器 pci總線 Linux 1.2萬 0

利用高速接口IP避免云數(shù)據(jù)流量擁堵

簡介流媒體、監(jiān)視和監(jiān)控數(shù)據(jù)、聯(lián)網(wǎng)傳感器、社交媒體、在線協(xié)作、遠(yuǎn)程學(xué)習(xí)、增強(qiáng)和虛擬現(xiàn)實(shí)、在線游戲……隨著無窮無盡的在線應(yīng)用不斷涌現(xiàn)，在線數(shù)據(jù)量出現(xiàn)激增。...

2022-05-17 標(biāo)簽：soc PCIe 云數(shù)據(jù) 1.2萬 0

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Proteus軟件是英國Lab Center Electronics公司出版的EDA工具軟件（該軟件中國總代理為廣州風(fēng)標(biāo)電子技術(shù)有限公司）。它不僅具有其它EDA工具軟件的仿真功能，還能仿真單片機(jī)及外圍器件。
靜電防護(hù)

靜電防護(hù)

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為防止靜電積累所引起的人身電擊、火災(zāi)和爆炸、電子器件失效和損壞，以及對生產(chǎn)的不良影響而采取的防范措施。其防范原則主要是抑制靜電的產(chǎn)生，加速靜電泄漏，進(jìn)行靜電中和等。
Altium Designer

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FPGA芯片

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FPGA（Field－Programmable Gate Array），即現(xiàn)場可編程門陣列，它是在PAL、GAL、CPLD等可編程器件的基礎(chǔ)上進(jìn)一步發(fā)展的產(chǎn)物。
ArduBlock

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ArduBlock軟件是Arduino官方編程環(huán)境的第三方軟件，目前必須依附于Arduino軟件下運(yùn)行，區(qū)別于Arduino文本式編程環(huán)境，ArduBlock是以圖形化積木搭建的方式編程的，這樣的方式會使編程的可視化和交互性加強(qiáng)，編程門檻降低，即使沒有編程經(jīng)驗(yàn)的人也可以嘗試給Arduino控制器編寫程序。
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pcb封裝就是把實(shí)際的電子元器件，芯片等的各種參數(shù)（比如元器件的大小，長寬，直插，貼片，焊盤的大小，管腳的長寬，管腳的間距等）用圖形方式表現(xiàn)出來，以便可以在畫pcb圖時進(jìn)行調(diào)用。
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Quartus II 是Altera公司推出的綜合性CPLD/FPGA開發(fā)軟件，軟件支持原理圖、VHDL、VerilogHDL以及AHDL（Altera Hardware 支持Description Language）等多種設(shè)計(jì)輸入形式，內(nèi)嵌自有的綜合器以及仿真器，可以完成從設(shè)計(jì)輸入到硬件配置的完整PLD設(shè)計(jì)流程。
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　　Artix-7 系列：相對于 Spartan-6 系列而言，Artix-7 系列功耗降低了一半，成本降低了 35%，采用小型化封裝、統(tǒng)一的 Virtex 系列架構(gòu)，能滿足低成本大批量市場的性能要求，這也正是此前 ASSP、ASIC 和低成本 FPGA 所針對的市場領(lǐng)域。
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面包板是由于板子上有很多小插孔，專為電子電路的無焊接實(shí)驗(yàn)設(shè)計(jì)制造的。由于各種電子元器件可根據(jù)需要隨意插入或拔出，免去了焊接，節(jié)省了電路的組裝時間，而且元件可以重復(fù)使用，所以非常適合電子電路的組裝、調(diào)試和訓(xùn)練。
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AXI是一種總線協(xié)議，該協(xié)議是ARM公司提出的AMBA3.0協(xié)議中最重要的部分，是一種面向高性能、高帶寬、低延遲的片內(nèi)總線。它的地址/控制和數(shù)據(jù)相位是分離的，支持不對齊的數(shù)據(jù)傳輸，同時在突發(fā)傳輸中，只需要首地址，同時分離的讀寫數(shù)據(jù)通道、并支持Outstanding傳輸訪問和亂序訪問，并更加容易進(jìn)行時序收斂。AXI是AMBA中一個新的高性能協(xié)議。
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特性阻抗又稱特征阻抗，它不是直流電阻，屬于長線傳輸中的概念。特性阻抗是射頻傳輸線影響無線電波電壓、電流的幅值和相位變化的固有特性，等于各處的電壓與電流的比值，用V/I表示。在射頻電路中，電阻、電容、電感都會阻礙交變電流的流動，合稱阻抗。電阻是吸收電磁能量的，理想電容和電感不消耗電磁能量。
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時鐘源用來為環(huán)形脈沖發(fā)生器提供頻率穩(wěn)定且電平匹配的方波時鐘脈沖信號。它通常由石英晶體振蕩器和與非門組成的正反饋振蕩電路組成，其輸出送至環(huán)形脈沖發(fā)生器。
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　　AD轉(zhuǎn)換采樣頻率指完成一次從模擬轉(zhuǎn)換到數(shù)字的AD轉(zhuǎn)換所需時間的倒數(shù)，模擬量可以是電壓、電流等電信號，也可以是壓力、溫度、濕度、位移、聲音等非電信號；而AD分辨率指數(shù)字量變化一個最小量時模擬信號的變化量。
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　　Kintex-7系列：Kintex-7 系列是一種新型 FPGA，能以不到 Virtex-6 系列一半的價格實(shí)現(xiàn)與其相當(dāng)性能，性價比提高了一倍，功耗降低了一半。
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紅外觸摸屏

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