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PCI-Express（peripheral component interconnect express）是一種高速串行計(jì)算機(jī)擴(kuò)展總線標(biāo)準(zhǔn)，它原來的名稱為“3GIO”，是由英特爾在2001年提出的，旨在替代舊的PCI，PCI-X和AGP總線標(biāo)準(zhǔn)。

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PCIe 5.0設(shè)計(jì)面臨的挑戰(zhàn)以及仿真案例

本文主要給大家分享一下PCIe5.0的發(fā)展歷程、以及在設(shè)計(jì)、仿真中一些挑戰(zhàn)和如何進(jìn)行仿真

2023-02-03 標(biāo)簽：仿真 PCI 總線 8.2k 0

如何加速海量數(shù)據(jù)和信息的收集和匯聚？

大數(shù)據(jù)和云計(jì)算時(shí)代背景下，數(shù)據(jù)中心和骨干網(wǎng)支撐著海量數(shù)據(jù)的計(jì)算和交互。而海量的數(shù)據(jù)則源自于無數(shù)的手機(jī)和終端個(gè)體，如何加速海量數(shù)據(jù)和信息的收集和匯聚？

2018-05-24 標(biāo)簽：HDMI PCIE 8k 0

Flow Control機(jī)制可以顯著地提高總線的傳輸效率

PCIe Spec規(guī)定，PCIe設(shè)備的每一個(gè)端口（Ports）都必須支持Flow Control機(jī)制，在發(fā)送TLP之前，F(xiàn)low Control必須先檢...

2018-05-24 標(biāo)簽：總線 PCIe 8k 0

幾個(gè)簡(jiǎn)單的例子來熟悉寄存器BAR的機(jī)制

Step1：如圖中（1）所示，未初始化的BAR的低比特（11~4）都是0，高比特（31~12）都是不確定的值。所謂初始化，就是系統(tǒng)（軟件）向整個(gè)BAR都...

2018-05-09 標(biāo)簽：寄存器 PCIe 7.9k 1

利用CXL技術(shù)重構(gòu)基于RDMA的內(nèi)存解耦合

本文提出了一種基于RDMA和CXL的新型低延遲、高可擴(kuò)展性的內(nèi)存解耦合系統(tǒng)Rcmp。其顯著特點(diǎn)是通過CXL提高了基于RDMA系統(tǒng)的性能，并利用RDMA克...

2024-02-29 標(biāo)簽：數(shù)據(jù)中心 PCIe 通信機(jī)制 7.8k 0

PCIe總線的錯(cuò)誤報(bào)告機(jī)制中四個(gè)比較重要的概念

錯(cuò)誤報(bào)告（Error Reporting）：通知系統(tǒng)某個(gè)（或多個(gè)）錯(cuò)誤發(fā)生了。在PCIe總線中，發(fā)生錯(cuò)誤的設(shè)備會(huì)通過錯(cuò)誤消息（Error Messag...

2018-08-17 標(biāo)簽：寄存器總線 PCIe 7.8k 0

常見PCIe電源管理簡(jiǎn)介

電源管理主要包含兩個(gè)部分：PCI-PM電源管理機(jī)制和ASPM電源管理機(jī)制。

2023-12-16 標(biāo)簽：寄存器電源管理 PCIe 7.7k 0

PCIe的Spec中明確規(guī)定只有Root有權(quán)限發(fā)起配置請(qǐng)求

處理器一般不能夠直接發(fā)起配置讀寫請(qǐng)求，因?yàn)槠渲荒墚a(chǎn)生Memory Request和IO Request。這就意味著Root必須要將處理器的相關(guān)請(qǐng)求轉(zhuǎn)換為...

2018-05-04 標(biāo)簽：PCIe Root 7.7k 0

面對(duì)高速鏈路測(cè)試重重挑戰(zhàn)，輕松實(shí)現(xiàn)PCIe 5自動(dòng)多路測(cè)試

本文將重點(diǎn)介紹x16測(cè)試要求的RF開關(guān)配置，這些開關(guān)型號(hào)將支持最多18條通路（PCIe最高一般是x16），也將支持較低的通路數(shù)。

2021-11-16 標(biāo)簽：連接器 RF PCIe 7.7k 0

常見硬盤接口技術(shù)分析

在這場(chǎng)存儲(chǔ)的革命中，為了實(shí)現(xiàn)更快的速度、更廣的使用環(huán)境和更好的體驗(yàn)，硬盤接口技術(shù)也在不斷進(jìn)化革新，從早期的IDE、SCSI接口到主流的SATA、SAS接...

2023-04-04 標(biāo)簽：SATA SCSI IDE 7.7k 0

基于標(biāo)準(zhǔn)的PCI Express多端口作為系統(tǒng)互連的多對(duì)等系統(tǒng)

Kwok Kong在IDT白皮書中描述了使用基于標(biāo)準(zhǔn)的PCI Express多端口作為系統(tǒng)互連的多對(duì)等系統(tǒng)。該白皮書描述了根處理器和端點(diǎn)處理器中存在的不...

2021-04-22 標(biāo)簽：Linux PCI 交換機(jī) 7.6k 0

NVLink技術(shù)之GPU與GPU的通信

在多 GPU 系統(tǒng)內(nèi)部，GPU 間通信的帶寬通常在數(shù)百GB/s以上，PCIe總線的數(shù)據(jù)傳輸速率容易成為瓶頸，且PCIe鏈路接口的串并轉(zhuǎn)換會(huì)產(chǎn)生較大延時(shí)，...

2024-03-27 標(biāo)簽：cpu 數(shù)據(jù)傳輸 NVIDIA 7.6k 0

FPGA PCIe加速卡開源硬件及例程介紹

基于Xilinx Artix-7系列FPGA芯片設(shè)計(jì)的M.2 M-Key FPGA加速卡，引出Artix7-484腳芯片的4條高速GT，最高支持PCIE...

2023-03-24 標(biāo)簽：HDMI SFP PCIe 7.5k 0

聊聊PCIe Bus（PCIe總線）

PCIe接口從2001年發(fā)展至今，在協(xié)議的完整性上已經(jīng)建立足夠高的"護(hù)城河"，重新定義一個(gè)接口協(xié)議在性能上超越PCIe，短期內(nèi)一方面...

2023-04-13 標(biāo)簽：cpu usb PCIe 7.4k 0

基于雙緩沖與單緩沖比較總線設(shè)計(jì)方案

本文介紹了軟件無線電平臺(tái)中基于FPGA的雙緩沖模式PCIExpress（PCIE）總線的設(shè)計(jì)與實(shí)現(xiàn)。設(shè)計(jì)了基于XilinxVirtex-6FPGA的通用...

2014-03-26 標(biāo)簽：FPGA Linux PCIe 7.4k 0

Type0和Type1型配置請(qǐng)求

如果不相等，但是在自己的下一級(jí)總線號(hào)（Secondary Bus Number）和最后一級(jí)總線號(hào)（Subordinate Bus Number）之間，則...

2018-05-06 標(biāo)簽：PCIe type 7.4k 0

PCIe彈性緩存主要用于解決跨時(shí)鐘域問題

需要注意的是PCIe Spec并沒有規(guī)定彈性緩存的具體位置，設(shè)計(jì)者可以將彈性緩存放在8b/10b解碼器之前，也可以把彈性緩存放在8b/10b解碼器之后。...

2018-09-08 標(biāo)簽：解碼器 PCIe 7.3k 0

基于FPGA的PCIE通信測(cè)試

本文介紹一個(gè)FPGA開源項(xiàng)目：PCIE通信。該工程圍繞Vivado軟件中提供的PCIE通信IP核XDMA IP建立。Xilinx提供了XDMA的開源驅(qū)動(dòng)...

2023-09-04 標(biāo)簽：fpga Linux WINDOWS 7.3k 0

關(guān)于PCIe協(xié)議中FPGA的實(shí)現(xiàn)

PCIe鏈路協(xié)議使用“端到端的數(shù)據(jù)傳送方式”，發(fā)送端和接收端中都含有TX(發(fā)送邏輯)和RX(接收邏輯)。

2019-06-19 標(biāo)簽：FPGA PCIe 7.3k 0

分析一下PortB的Header中的Base & Limit寄存器

需要注意的是，Endpoint的需要的NP-MMIO的大小明明只有4KB，PortB的Header卻給其1MB的空間（最小1MB），也就是說剩余的空間都...

2018-05-11 標(biāo)簽：寄存器 PCIe 7.2k 0

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Proteus軟件是英國Lab Center Electronics公司出版的EDA工具軟件（該軟件中國總代理為廣州風(fēng)標(biāo)電子技術(shù)有限公司）。它不僅具有其它EDA工具軟件的仿真功能，還能仿真單片機(jī)及外圍器件。
靜電防護(hù)

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為防止靜電積累所引起的人身電擊、火災(zāi)和爆炸、電子器件失效和損壞，以及對(duì)生產(chǎn)的不良影響而采取的防范措施。其防范原則主要是抑制靜電的產(chǎn)生，加速靜電泄漏，進(jìn)行靜電中和等。
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FPGA芯片

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FPGA（Field－Programmable Gate Array），即現(xiàn)場(chǎng)可編程門陣列，它是在PAL、GAL、CPLD等可編程器件的基礎(chǔ)上進(jìn)一步發(fā)展的產(chǎn)物。
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ArduBlock軟件是Arduino官方編程環(huán)境的第三方軟件，目前必須依附于Arduino軟件下運(yùn)行，區(qū)別于Arduino文本式編程環(huán)境，ArduBlock是以圖形化積木搭建的方式編程的，這樣的方式會(huì)使編程的可視化和交互性加強(qiáng)，編程門檻降低，即使沒有編程經(jīng)驗(yàn)的人也可以嘗試給Arduino控制器編寫程序。
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pcb封裝就是把實(shí)際的電子元器件，芯片等的各種參數(shù)（比如元器件的大小，長寬，直插，貼片，焊盤的大小，管腳的長寬，管腳的間距等）用圖形方式表現(xiàn)出來，以便可以在畫pcb圖時(shí)進(jìn)行調(diào)用。
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Quartus II 是Altera公司推出的綜合性CPLD/FPGA開發(fā)軟件，軟件支持原理圖、VHDL、VerilogHDL以及AHDL（Altera Hardware 支持Description Language）等多種設(shè)計(jì)輸入形式，內(nèi)嵌自有的綜合器以及仿真器，可以完成從設(shè)計(jì)輸入到硬件配置的完整PLD設(shè)計(jì)流程。
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　　Artix-7 系列：相對(duì)于 Spartan-6 系列而言，Artix-7 系列功耗降低了一半，成本降低了 35%，采用小型化封裝、統(tǒng)一的 Virtex 系列架構(gòu)，能滿足低成本大批量市場(chǎng)的性能要求，這也正是此前 ASSP、ASIC 和低成本 FPGA 所針對(duì)的市場(chǎng)領(lǐng)域。
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面包板是由于板子上有很多小插孔，專為電子電路的無焊接實(shí)驗(yàn)設(shè)計(jì)制造的。由于各種電子元器件可根據(jù)需要隨意插入或拔出，免去了焊接，節(jié)省了電路的組裝時(shí)間，而且元件可以重復(fù)使用，所以非常適合電子電路的組裝、調(diào)試和訓(xùn)練。
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AXI是一種總線協(xié)議，該協(xié)議是ARM公司提出的AMBA3.0協(xié)議中最重要的部分，是一種面向高性能、高帶寬、低延遲的片內(nèi)總線。它的地址/控制和數(shù)據(jù)相位是分離的，支持不對(duì)齊的數(shù)據(jù)傳輸，同時(shí)在突發(fā)傳輸中，只需要首地址，同時(shí)分離的讀寫數(shù)據(jù)通道、并支持Outstanding傳輸訪問和亂序訪問，并更加容易進(jìn)行時(shí)序收斂。AXI是AMBA中一個(gè)新的高性能協(xié)議。
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特性阻抗又稱特征阻抗，它不是直流電阻，屬于長線傳輸中的概念。特性阻抗是射頻傳輸線影響無線電波電壓、電流的幅值和相位變化的固有特性，等于各處的電壓與電流的比值，用V/I表示。在射頻電路中，電阻、電容、電感都會(huì)阻礙交變電流的流動(dòng)，合稱阻抗。電阻是吸收電磁能量的，理想電容和電感不消耗電磁能量。
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