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標(biāo)簽 > serdes
SERDES是(串行器)/(解串器)的簡稱。它是一種主流的時(shí)分多路復(fù)用(TDM)、點(diǎn)對(duì)點(diǎn)(P2P)的串行通信技術(shù)。
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基于京微雅格低功耗FPGA的8b/10b SERDES的接口設(shè)計(jì)
隨著系統(tǒng)帶寬不斷增加至多吉比特范圍,并行接口已經(jīng)被高速串行鏈接,或SERDES (串化器/ 解串器)所取代。起初, SERDES 是獨(dú)立的ASSP 或A...
教你如何進(jìn)行Xilinx SerDes調(diào)試
FPGA SERDES的應(yīng)用需要考慮到板級(jí)硬件,SERDES參數(shù)和使用,應(yīng)用協(xié)議等方面。由于這種復(fù)雜性,SERDES的調(diào)試工作對(duì)很多工程師來說是一個(gè)挑戰(zhàn)。
Maxim GMSL SerDes器件的預(yù)加重和均衡
隨著視頻應(yīng)用的快速發(fā)展,數(shù)據(jù)傳輸流量正以指數(shù)級(jí)迅猛增長,迫切需要更高的數(shù)據(jù)傳輸速率。因此,低成本雙絞線(TP)也逐漸受到人們的特別關(guān)注。
本文以TLK3132為例,詳細(xì)介紹了SERDES工作原理和器件特點(diǎn),并以WI系統(tǒng)中的CPRI應(yīng)用需求為例,提供TLK3132的設(shè)計(jì)方法等。
SERDES在數(shù)字系統(tǒng)中高效時(shí)鐘設(shè)計(jì)方案
SERDES在數(shù)字系統(tǒng)中高效時(shí)鐘設(shè)計(jì)方案,無論是在一個(gè)FPGA、SoC還是ASSP中,為任何基于SERDES的協(xié)議選擇一個(gè)參考時(shí)鐘源都是非常具有挑戰(zhàn)性的。
2012-02-16 標(biāo)簽:數(shù)字系統(tǒng)SERDES時(shí)鐘設(shè)計(jì) 1.3萬 0
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