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      標(biāo)簽　>　verilog

      verilog

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      Verilog HDL是一種硬件描述語言（HDL:Hardware Description Language），以文本形式來描述數(shù)字系統(tǒng)硬件的結(jié)構(gòu)和行為的語言，用它可以表示邏輯電路圖、邏輯表達式，還可以表示數(shù)字邏輯系統(tǒng)所完成的邏輯功能。

      文章：716個 瀏覽：114576次 帖子：949個

      verilog技術(shù)

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      我習(xí)慣將驗證空間理解為：驗證中原則上需要覆蓋的芯片所有有可能出現(xiàn)的工作狀態(tài)的集合。為了探索這片廣袤的驗證空間，驗證的時候搞出了帶有約束的隨機測試（con...

      2023-01-21 標(biāo)簽：芯片VerilogSystem 8.2k 0

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      Xilinx-vivado的網(wǎng)表形式有edf和dcp兩個方式，兩個方式各有不同。對于仿真來說，兩者均需轉(zhuǎn)換為verilog的形式進行仿真，只是使用的命令不同。

      2022-12-20 標(biāo)簽：Xilinx仿真Verilog 8.2k 0

      如何用vcs+verdi仿真Verilog文件并查看波形呢？

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      我們以一個簡單的加法器為例，來看下如何用vcs+verdi仿真Verilog文件并查看波形。

      2023-05-08 標(biāo)簽：Verilog加法器VCS 8k 0

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      2021-08-10 標(biāo)簽：VerilogHDL讀寫器 7.9k 0

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      verilog語法：參數(shù)例化、賦值等

      Verilog 2005 版本支持使用省略位寬的方式賦值，’b,’d,’h，采用省略位寬的方式可以向左主動補齊，如果省略了進制符合b/d/h/o,則默認(rèn)...

      2022-11-23 標(biāo)簽：Verilog參數(shù)語法 7.9k 0

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      2018-06-04 標(biāo)簽：fpgaveriloghls 7.8k 0

      vhdl轉(zhuǎn)換為verilog_VHDL和Verilog誰更勝一籌

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      今天給大家分享一個VHDL和Verilog的工具。很多新手初次學(xué)習(xí)FPGA都曾遇到過一個問題：是學(xué)Verilog OR VHDL？

      2020-08-25 標(biāo)簽：Verilogvhdl 7.7k 0

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      FPGA相比MCU而言，在數(shù)據(jù)位操作上有很明顯的優(yōu)勢。FPGA支持任意位拼接以及數(shù)據(jù)截取操作。本篇主要是總結(jié)和分享一些對數(shù)據(jù)位操作的實用語法技巧。內(nèi)容不...

      2023-10-01 標(biāo)簽：fpgamcuVerilog 7.7k 0

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      如果信號從0/1/z變化到x,那么此時的門傳輸延遲為上述三種延遲最小的.另外,在進行仿真時,有些邏輯門的輸出不可能會出現(xiàn)高阻態(tài)z,所以對于這些邏輯門實際...

      2023-04-09 標(biāo)簽：Verilog模型 7.5k 0

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      2018-05-28 標(biāo)簽：verilog矩陣鍵盤 7.5k 0

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      2013-01-24 標(biāo)簽：Verilog源代碼預(yù)處理 7.4k 0

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      2023-03-15 標(biāo)簽：VerilogSystem 7.4k 0

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      Verilog作為一種種硬件描述語言目前已經(jīng)得到了普遍運用。本文主要介紹了Verilog特點、Verilog用途以及Verilog實現(xiàn)74LS194芯片...

      2017-12-22 標(biāo)簽：Verilog74LS194 7.3k 0

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      2023-06-06 標(biāo)簽：FIRVerilogVCS 7.2k 0

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      2022-08-30 標(biāo)簽：Verilog參數(shù) 7.2k 0

      淺談VHDL/Verilog的可綜合性以及對初學(xué)者的一些建議

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      2017-02-11 標(biāo)簽：VerilogHDLVHDL 7.2k 1

      格雷碼與二進制轉(zhuǎn)換

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      格雷碼是一種循環(huán)二進制編碼，特點是相鄰數(shù)變化時只有一位數(shù)據(jù)跳變。

      2023-01-17 標(biāo)簽：二進制仿真Verilog 7.1k 0

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        Protues
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        Proteus軟件是英國Lab Center Electronics公司出版的EDA工具軟件（該軟件中國總代理為廣州風(fēng)標(biāo)電子技術(shù)有限公司）。它不僅具有其它EDA工具軟件的仿真功能，還能仿真單片機及外圍器件。
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        FPGA（Field－Programmable Gate Array），即現(xiàn)場可編程門陣列，它是在PAL、GAL、CPLD等可編程器件的基礎(chǔ)上進一步發(fā)展的產(chǎn)物。
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        ArduBlock軟件是Arduino官方編程環(huán)境的第三方軟件，目前必須依附于Arduino軟件下運行，區(qū)別于Arduino文本式編程環(huán)境，ArduBlock是以圖形化積木搭建的方式編程的，這樣的方式會使編程的可視化和交互性加強，編程門檻降低，即使沒有編程經(jīng)驗的人也可以嘗試給Arduino控制器編寫程序。
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        FPGA開發(fā)板在基于MCU、定制ASIC和體積龐大的電線束來實現(xiàn)引擎及控制電子的系統(tǒng)方案已發(fā)展至接近其技術(shù)和應(yīng)用極限，汽車工業(yè)正面臨新的設(shè)計挑戰(zhàn)。過去汽車電子產(chǎn)品的開發(fā)周期是漫長的，而許多汽車制造商現(xiàn)正致力于在更短的時間內(nèi)，裝備消費者所需的新一代汽車。
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        +關(guān)注
        AXI是一種總線協(xié)議，該協(xié)議是ARM公司提出的AMBA3.0協(xié)議中最重要的部分，是一種面向高性能、高帶寬、低延遲的片內(nèi)總線。它的地址/控制和數(shù)據(jù)相位是分離的，支持不對齊的數(shù)據(jù)傳輸，同時在突發(fā)傳輸中，只需要首地址，同時分離的讀寫數(shù)據(jù)通道、并支持Outstanding傳輸訪問和亂序訪問，并更加容易進行時序收斂。AXI是AMBA中一個新的高性能協(xié)議。
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        特性阻抗又稱特征阻抗，它不是直流電阻，屬于長線傳輸中的概念。特性阻抗是射頻傳輸線影響無線電波電壓、電流的幅值和相位變化的固有特性，等于各處的電壓與電流的比值，用V/I表示。在射頻電路中，電阻、電容、電感都會阻礙交變電流的流動，合稱阻抗。電阻是吸收電磁能量的，理想電容和電感不消耗電磁能量。
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