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標(biāo)簽 > versal
Versal 產(chǎn)品組合基于 臺積電(TSMC)的 7 nm FinFET 工藝技術(shù),是第一個將軟件可編程性與特定領(lǐng)域硬件加速和靈活應(yīng)變能力相結(jié)合的平臺,這對于跟上當(dāng)今快速的創(chuàng)新步伐至關(guān)重要。
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瑞薩電子宣布與賽靈思合作,共同開發(fā)Versal ACAP參考設(shè)計
高性能時鐘與電源解決方案支持Versal ACAP器件,適用于云、網(wǎng)絡(luò)及邊緣應(yīng)用。
AMD Vivado Design Suite 2025.1現(xiàn)已推出
AMD Vivado Design Suite 2025.1 現(xiàn)已推出,支持 AMD Spartan UltraScale+ 和新一代 Versal 器...
如何通過PMC_GPIO喚醒AMD Versal? Adaptive SoC Linux系統(tǒng)
在功耗敏感的系統(tǒng)里,我們通常會在系統(tǒng)空閑的時候?qū)⑾到y(tǒng)休眠,然后可以通過一些外設(shè)的輸入來喚醒系統(tǒng),比如 Uart、USB 和 GPIO。AMD Versa...
第二代AMD Versal Premium系列產(chǎn)品亮點
第二代 AMD Versal Premium 系列提供了全新水平的存儲器和數(shù)據(jù)帶寬,具備 CXL 3.1、PCIe Gen6 和 DDR5/LPDDR5...
Versal ACAP、APU - ELR 錯誤報告序列中加密指令之間的中斷
在 aarch32 模式下,如果執(zhí)行的代碼包含下面的加密指令序列,并且在執(zhí)行第一條加密指令后立即斷言并中斷,ELR 會被記錄為返回地址,產(chǎn)生的錯誤可能會...
Versal ACAP PS GEM - GEM 控制器可能在大型發(fā)送卸載配置中觸發(fā)錯誤的 Amba_Error
當(dāng)在硬件配置中包含“大型發(fā)送卸載 (Large Send Offload)”并在緩沖區(qū)描述符中啟用 LSO 功能時,GEM IP 可能通過中斷狀態(tài)寄存器...
適用于Versal的AMD Vivado 加快FPGA開發(fā)完成Versal自適應(yīng)SoC設(shè)計
設(shè)計、編譯、交付,輕松搞定。更快更高效。 Vivado 設(shè)計套件提供經(jīng)過優(yōu)化的設(shè)計流程,讓傳統(tǒng) FPGA 開發(fā)人員能夠加快完成 Versal 自適應(yīng) S...
AMD Vitis Unified Software Platform 2024.2發(fā)布
近日,全新 AMD Vitis Unified Software Platform 2024.2 版本推出。
AMD技術(shù)賦能西門子FPGA原型設(shè)計解決方案
西門子的 Veloce proFPGA CS 是一款針對軟件驗證和軟硬件系統(tǒng)集成優(yōu)化的原型系統(tǒng)。它是一款基于 FPGA 的邏輯功能驗證級工具。
第二代AMD Versal Premium系列器件的主要應(yīng)用
隨著數(shù)據(jù)中心工作負(fù)載持續(xù)呈指數(shù)級增長,存儲層也需要同等的性能提升才能跟上步伐。第二代 AMD Versal Premium 系列器件為各種存儲應(yīng)用提供了...
2025-01-15 標(biāo)簽:amd數(shù)據(jù)中心Versal 1.3k 0
第二代AMD Versal Premium系列SoC滿足各種CXL應(yīng)用需求
第二代 AMD Versal Premium 系列自適應(yīng) SoC 是一款多功能且可配置的平臺,提供全面的 CXL 3.1 子系統(tǒng)。該系列自適應(yīng) SoC ...
Xilinx推出業(yè)界帶寬最高、計算密度最高的自適應(yīng)平臺——Versal Premium
全新 Versal Premium 系列提供了功耗優(yōu)化網(wǎng)絡(luò)硬核的突破性集成,實現(xiàn)最高速、最安全的網(wǎng)絡(luò)與靈活應(yīng)變的云加速
2020-03-15 標(biāo)簽:fpgaXilinx5G網(wǎng)絡(luò) 1.3k 0
Versal ACAP, RPU - 為調(diào)試寄存器 DBGDSAR 設(shè)置的值錯誤
每個 RPU 處理器都有 1 個 DBGDSAR 寄存器,其中包含其 CoreSight ROM 表的偏移地址。但是,讀取 RPU 的 DBGDSAR ...
Versal ACAP,APU - 跟蹤系統(tǒng)中發(fā)生 ATB 停滯可能引發(fā)處理器死鎖
處理器可使用等待事件 (wait for event, WFE) 或等待中斷 (wait for interrupt, WFI) 機(jī)制來進(jìn)入低功耗狀態(tài)。...
Versal ACAP,APU - 由于舊負(fù)載檢測到異步外部異常中止,導(dǎo)致新負(fù)載誤報同步外部異常中止
在某些條件下,新負(fù)載如果復(fù)用舊器件負(fù)載的分組標(biāo)識 (GID),則可能報告同步外部異常中止,原因是錯誤關(guān)聯(lián)舊器件存儲器訪問所檢測到的外部錯誤。器件負(fù)載快速...
Versal ACAP、APU - DSB 指令后可能會發(fā)生推測性 TLB 填充
Arm 發(fā)行的白皮書 "Cache Speculation Side-channels"用于發(fā)現(xiàn) "Spectre&quo...
Versal ACAP,APU - 當(dāng)有逐出傳輸事務(wù)處于暫掛狀態(tài)時,外部數(shù)據(jù)嗅探可能導(dǎo)致數(shù)據(jù)損壞
如果 Arm Cortex-A72 處理器配置為向處于 UniqueClean (UC) 狀態(tài)的緩存行發(fā)送逐出傳輸事務(wù),那么 Cortex-A72 處理...
2022-08-05 標(biāo)簽:APU數(shù)據(jù)損壞Versal 704 0
借助第二代 AMD VERSAL 實現(xiàn)先進(jìn)醫(yī)療成像
診斷醫(yī)療成像設(shè)備必須能夠產(chǎn)出高質(zhì)量圖像、實現(xiàn)所需的掃描深度,以及顯示實時結(jié)果。設(shè)備中采用的最優(yōu)片上系統(tǒng)( SoC )必須提供所需的應(yīng)用性能、目標(biāo)幀率并實...
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