4.SPI Flash控制器驗證

　　SPI Flash控制器IP核在Modelsim 6.5g上能夠通過功能仿真，下面分析一下SPI Flash頁面編程操作及數(shù)據(jù)讀取操作的功能仿真。

　　4.1 頁面編程操作

　　頁面編程操作仿真波形如圖3所示，圖中截取輸入00H和01H數(shù)據(jù)的波形，最多可連續(xù)輸入一頁 256字節(jié)數(shù)據(jù)。當(dāng)用戶輸入頁面編程指令02H，狀態(tài)機進入txcmd狀態(tài)，頁編程指令02H通過spi_dout傳輸給SPI Flash.當(dāng)tx_bit_cnt計數(shù)到8時，指令傳輸完畢，狀態(tài)機在等待后進入txadd_h狀態(tài)，同時tx_bit_cnt被清零，需寫入數(shù)據(jù)的對應(yīng)存儲空間的起始地址高字節(jié)值89H被傳輸。當(dāng)tx_bit_cnt計數(shù)到8時，高字節(jié)地址值89H被傳輸完畢，狀態(tài)機在等待后進入txadd_m狀態(tài)，同時tx_bit_cnt被清零，同上，地址中間字節(jié)67H和45H被傳輸。當(dāng)add_h、add_m和add_l寄存器的值依次傳輸完畢，狀態(tài)機進入 wait6狀態(tài)，等待用戶輸入需寫入SPI Flash的數(shù)據(jù)。當(dāng)用戶設(shè)定{sel，addr，wr}為10001b，狀態(tài)機進入txdata狀態(tài)，同時tx_new_data被置高，表示要傳輸新寫入的數(shù)據(jù)。在txdata狀態(tài)下，控制器將傳輸寫入的第1字節(jié)數(shù)據(jù)00H，當(dāng)tx_bit_cnt計數(shù)到8時，第1字節(jié)數(shù)據(jù)00H被傳輸完畢，tx_new_data被拉低，tx_empty被拉高，表示當(dāng)前沒有可傳輸?shù)臄?shù)據(jù)，狀態(tài)機進入wait6狀態(tài)，等待新數(shù)據(jù)寫入。直到用戶再次設(shè)定 {sel，addr，wr}為10001b，狀態(tài)機再次進入txdata狀態(tài)，同時tx_new_data被置高，表示寫入的第2字節(jié)數(shù)據(jù)01H將要傳輸。當(dāng)tx_bit_cnt計數(shù)到8，第2字節(jié)數(shù)據(jù)傳輸完畢，tx_new_data被拉低，tx_empty被拉高，狀態(tài)機進入wait6狀態(tài)。由于 GDQ25系列SPI Flash頁面編程一次最多可寫入256字節(jié)數(shù)據(jù)，所以用戶在寫入數(shù)據(jù)時，應(yīng)注意最多寫入256次數(shù)據(jù)，否則超過的數(shù)據(jù)將覆蓋開始的數(shù)據(jù)。當(dāng)狀態(tài)機處于 wait6狀態(tài)而用戶想結(jié)束頁面編程時，可向控制器輸入NOP指令強制結(jié)束當(dāng)前頁面編程操作。狀態(tài)機在接收到NOP指令后將進入clr_cmd狀態(tài)和 idle空閑態(tài)，等待下一條指令的到來。當(dāng)頁面編程操作還沒結(jié)束時，busy將一直被置高。

　　4.2 數(shù)據(jù)讀取操作

　　讀數(shù)據(jù)指令仿真波形如圖4所示。當(dāng)用戶輸入讀數(shù)據(jù)指令03H，狀態(tài)機進入txcmd狀態(tài)，讀數(shù)據(jù)指令通過spi_dout傳輸給SPI Flash。

　　當(dāng)tx_bit_cnt計數(shù)到8時，指令傳輸完畢，狀態(tài)機等待后進入txadd_h狀態(tài)，傳輸要讀出數(shù)據(jù)所在存儲空間起始地址的高字節(jié)，同時tx_bit_cnt清零，以為下一個傳輸作準備。地址高字節(jié)寄存器add_h數(shù)值56H通過spi_dout 傳輸給SPI Flash，當(dāng)tx_bit_cnt計數(shù)到8時，狀態(tài)機進入txadd_m狀態(tài)，傳輸?shù)刂分虚g字節(jié)，同理，控制器在狀態(tài)txadd_m和狀態(tài) txadd_l狀態(tài)下完成傳輸?shù)刂分虚g字節(jié)34H和地址低字節(jié)12H.當(dāng)24位地址傳輸完畢，狀態(tài)機在等待后進入rxdata狀態(tài)，接收從spi_din 輸入的第一字節(jié)數(shù)據(jù)01H.當(dāng)rx_bit_cnt計數(shù)到8時，控制器完成第1字節(jié)數(shù)據(jù)的接收，rx_data顯示為01H，狀態(tài)機狀態(tài)轉(zhuǎn)換為wait8 狀態(tài)，等待用戶設(shè)定{sel，addr，wr}以接收第2字節(jié)。當(dāng)用戶設(shè)定{sel，addr，wr}為10000b時，狀態(tài)機再次進入rxdata狀態(tài)，接收從spi_din輸入的第2字節(jié)數(shù)據(jù)02H，同時rx_ready被拉低，rx_empty被拉高，rd_data被拉高，表示將要讀出新輸入的數(shù)據(jù)。當(dāng)rx_bit_cnt計數(shù)到8時，第2字節(jié)數(shù)據(jù)接收完畢，rx_ready被拉高，rx_empty為低，rd_data顯示新接收的字節(jié)數(shù)據(jù) 02H，狀態(tài)機經(jīng)等待后重新進入wait8狀態(tài)，等待用戶再次設(shè)定{sel，addr，wr}值，接收第3字節(jié)數(shù)據(jù)值，同理，可讀出SPI Flash內(nèi)部所有數(shù)據(jù)。

　　當(dāng)狀態(tài)機處于wait8狀態(tài)而用戶想退出讀數(shù)據(jù)操作時，可向控制器輸入NOP指令強制結(jié)束當(dāng)前讀數(shù)據(jù)操作。狀態(tài)機在接收到NOP指令后將進入clr_cmd狀態(tài)和idle空閑態(tài)，等待下一條指令的到來。當(dāng)讀數(shù)據(jù)操作還沒結(jié)束時，busy將一直置高。

　　5.結(jié)語

　　目前SPI Flash控制器IP核已經(jīng)在XUPV5-LX110T FPGA開發(fā)板上通過硬件測試，并且將作為功能模塊應(yīng)用于SOC芯片設(shè)計。實踐證明，基于FPGA的SPI Flash控制器能夠簡化SPI Flash讀寫操作流程，從而提高SPI Flash的讀寫速度，而操作時不占用CPU資源的特點，將使SPIFlash的讀寫更有優(yōu)勢。