本文翻譯轉(zhuǎn)載于：Cadence Blog

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為推動(dòng)小芯片創(chuàng)新的下一波浪潮，Cadence 成功流片其第三代通用小芯片互連技術(shù)（UCIe）IP 解決方案，在臺(tái)積電先進(jìn)的 N3P 工藝上實(shí)現(xiàn)了業(yè)界領(lǐng)先的每通道 64Gbps 速率。隨著行業(yè)向日益復(fù)雜的 AI、高性能計(jì)算（HPC）和數(shù)據(jù)中心架構(gòu)發(fā)展，對(duì)強(qiáng)大、高帶寬的芯片小芯片互連的需求從未如此迫切。這一里程碑式的成就使 Cadence 處于領(lǐng)先地位，能為要求最嚴(yán)苛的應(yīng)用打造可擴(kuò)展、高能效的多芯片系統(tǒng)。

隨著制程節(jié)點(diǎn)推進(jìn)到 3 納米及以下，系統(tǒng)級(jí)芯片 (SoC) 設(shè)計(jì)人員面臨著一項(xiàng)挑戰(zhàn)：需在優(yōu)化功耗、性能和面積 (PPA) 的同時(shí)，滿足高速、可靠的芯片間通信需求。Cadence UCIe IP 解決方案完全符合 UCIe 規(guī)范，其設(shè)計(jì)初衷就是直接應(yīng)對(duì)這些挑戰(zhàn)。該方案借助臺(tái)積電創(chuàng)新的 N3P 技術(shù)，實(shí)現(xiàn)了出色的能效表現(xiàn)，助力客戶在不犧牲性能的前提下達(dá)成嚴(yán)苛的能耗指標(biāo)。

基于臺(tái)積電 N3P 工藝的64Gbps UCIe IP 子系統(tǒng)流片

Cadence UCIe IP 實(shí)現(xiàn) 64G 速率流片，標(biāo)志著小芯片互連技術(shù)取得了重大突破。該方案支持每通道高達(dá) 64Gbps 的速率，設(shè)計(jì)人員可實(shí)現(xiàn)超高帶寬密度，為可擴(kuò)展的小芯片架構(gòu)開(kāi)辟新的可能性。其靈活且無(wú)縫地整合各類現(xiàn)有接口協(xié)議，例如 AXI、CXS.B、CHI-C2C、PCIe 和 CXL，可快速集成到各種平臺(tái)中，包括 AI 加速器、網(wǎng)絡(luò)設(shè)備和先進(jìn)的數(shù)據(jù)中心系統(tǒng)。

可靠性和集成靈活性是 Cadence UCIe IP 的核心優(yōu)勢(shì)。先進(jìn)的糾錯(cuò)、通道裕量和診斷功能，確保其在異構(gòu)多芯片環(huán)境中穩(wěn)定運(yùn)行。該架構(gòu)的設(shè)計(jì)旨在簡(jiǎn)化系統(tǒng)集成，支持多廠商芯片生態(tài)系統(tǒng)間的無(wú)縫互操作性。

“自 2018 年首次流片以來(lái)，Cadence 便一直處于芯片間互連解決方案的最前沿。2022 年轉(zhuǎn)向 UCIe 技術(shù)后，過(guò)去兩年我們充分展示了第一代和第二代 UCIe 解決方案的硅片驗(yàn)證成果，”Cadence 硅解決方案集團(tuán)市場(chǎng)營(yíng)銷副總裁 Arif Khan 表示。“鑒于 AI 和高性能計(jì)算應(yīng)用對(duì)吞吐量和效率的巨大需求，我們很自豪能夠推出速率可達(dá) 64G 的第三代 UCIe IP。通過(guò)與我們值得信賴的合作伙伴臺(tái)積電合作，我們正在為雙方的客戶帶來(lái)高質(zhì)量、高效的解決方案?！?/p>

面向 AI /高性能計(jì)算應(yīng)用的業(yè)界領(lǐng)先特性

該解決方案可提供 64Gbps 的傳輸性能，在標(biāo)準(zhǔn)封裝中實(shí)現(xiàn)了 3.6Tbps/mm 的出色帶寬密度，在先進(jìn)封裝中更是達(dá)到 21.08Tbps/mm。憑借業(yè)界一流的 PPA（性能、功耗和面積）指標(biāo)，該架構(gòu)針對(duì)高性能計(jì)算 (HPC) 和人工智能 (AI) 應(yīng)用進(jìn)行了優(yōu)化。與所有 Cadence UCIe 系列產(chǎn)品一樣，它支持多種協(xié)議，包括 AXI、CXS、CHI-C2C、PCIe 和CXL.io，并與高速 PHY 無(wú)縫集成，提供完整的 IP 子系統(tǒng)，從而加速設(shè)計(jì)部署進(jìn)程。自校準(zhǔn)功能和基于硬件的啟動(dòng)無(wú)需固件干預(yù)，可實(shí)現(xiàn)快速系統(tǒng)初始化并簡(jiǎn)化設(shè)置。簡(jiǎn)化的時(shí)鐘方案和集成的鎖相環(huán) (PLL)，結(jié)合在電壓和溫度變化范圍內(nèi)的穩(wěn)定性能，確保了可靠性和效率，使設(shè)計(jì)人員能夠?qū)Ｗ⒂诤诵倪壿嬤@一關(guān)鍵環(huán)節(jié)。

憑借這一成果，Cadence 豐富了其全面的 IP 產(chǎn)品組合，為客戶和合作伙伴提供了攻克現(xiàn)代計(jì)算挑戰(zhàn)所需的工具。通過(guò)融合更高的數(shù)據(jù)速率、全面完善的客戶解決方案以及嚴(yán)格的標(biāo)準(zhǔn)合規(guī)性，Cadence 正在助力下一代可擴(kuò)展、高性能的系統(tǒng)。