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主要描述了一種基于FPGA利用Verilog HDL實(shí)現(xiàn)的反正切函數(shù)計(jì)算的優(yōu)化算法。反正切函數(shù)的計(jì)算在相位檢測(cè)，偏振光檢測(cè)等檢測(cè)系統(tǒng)有重要的應(yīng)用。討論了泰勒展開(kāi)式法和直接LUT查找表法缺點(diǎn)，提出一種新的優(yōu)化LUT查找表算法。該算法能夠被綜合器綜合實(shí)現(xiàn)，可以直接集成在FPGA應(yīng)用系統(tǒng)、SOC系統(tǒng)或SOPC系統(tǒng)上，并且經(jīng)軟件仿真和硬件驗(yàn)證，達(dá)到了設(shè)計(jì)要求。
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