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      電子發(fā)燒友網(wǎng)>電子資料下載>可編程邏輯>FPGA/ASIC>簡述邏輯分析儀在FPGA開發(fā)的應用

      簡述邏輯分析儀在FPGA開發(fā)的應用

      2014-09-23 | pdf | 1942KB | 次下載 | 1積分

      資料介紹

      隨著FPGA設計的日益復雜，如今整個設計流程中的實時驗證和調(diào)試已經(jīng)成為當前設計FPGA系統(tǒng)的關鍵部分。在FPGA系統(tǒng)設計完成前，有兩個不同的階段：設計階段，調(diào)試和檢驗階段。設計階段的主要任務是輸入、仿真和RTL設計。調(diào)試和檢驗階段的主要任務是檢驗設計，糾正發(fā)現(xiàn)的任何錯誤。本文將提出使用邏輯分析儀和Altera的Logic Analog Interface相結(jié)合的方法進行在線調(diào)試以達到只使用少量的FPGA管腳查看許多FPGA內(nèi)部信號。如果使用得當，您可以突破非常棘手的FPGA調(diào)試問題。
      FPGA 邏輯分析儀
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